[發明專利]數字信號處理裝置和數字信號處理裝置的控制方法在審
| 申請號: | 202111098833.2 | 申請日: | 2021-09-18 |
| 公開(公告)號: | CN114253881A | 公開(公告)日: | 2022-03-29 |
| 發明(設計)人: | 岡本誠司 | 申請(專利權)人: | 株式會社河合樂器制作所 |
| 主分類號: | G06F13/16 | 分類號: | G06F13/16;G06F3/06 |
| 代理公司: | 北京三友知識產權代理有限公司 11127 | 代理人: | 崔成哲;黃綸偉 |
| 地址: | 日本*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 數字信號 處理 裝置 控制 方法 | ||
1.一種數字信號處理裝置,其特征在于,所述數字信號處理裝置具有:
DRAM,其對突發長度的音頻數據進行突發傳輸;
第1緩沖存儲器,其能夠蓄積所述突發長度的2倍的音頻數據;
控制單元,其以如下方式進行控制,在采樣周期中從所述第1緩沖存儲器的任意地址開始一個字一個字地依次寫入音頻數據,使得將所述第1緩沖存儲器的前半區域的所述突發長度的音頻數據和所述第1緩沖存儲器的后半區域的所述突發長度的音頻數據交替地突發傳輸到所述DRAM;以及
延遲效果實現單元,其使用虛擬移位指針,
所述控制單元以在向所述第1緩沖存儲器的后半區域一個字一個字地依次寫入音頻數據的期間內、將所述第1緩沖存儲器的前半區域的所述突發長度的音頻數據突發傳輸到所述DRAM的方式進行控制,并以在向所述第1緩沖存儲器的前半區域一個字一個字地依次寫入音頻數據的期間內、將所述第1緩沖存儲器的后半區域的所述突發長度的音頻數據突發傳輸到所述DRAM的方式進行控制,并根據以何種程度提前寫入音頻數據,對小于突發長度的延遲長度進行控制。
2.根據權利要求1所述的數字信號處理裝置,其特征在于,
所述數字信號處理裝置還具有第2緩沖存儲器,該第2緩沖存儲器能夠蓄積所述突發長度的2倍的音頻數據,
所述控制單元進行以交替地實施所述突發長度的音頻數據從所述DRAM向所述第2緩沖存儲器的前半區域的突發傳輸、和所述突發長度的音頻數據從所述DRAM向所述第2緩沖存儲器的后半區域的突發傳輸的方式進行控制,從相對于所述突發傳輸的采樣周期而為任意數量的采樣周期后的采樣周期開始,在所述采樣周期中一個字一個字地依次讀出被傳輸到所述第2緩沖存儲器的音頻數據,
所述控制單元以在從所述第2緩沖存儲器的后半區域一個字一個字地依次讀出音頻數據的期間內、從所述DRAM向所述第2緩沖存儲器的前半區域突發傳輸所述突發長度的音頻數據的方式進行控制,并以在從所述第2緩沖存儲器的前半區域一個字一個字地依次讀出音頻數據的期間內、從所述DRAM向所述第2緩沖存儲器的后半區域突發傳輸所述突發長度的音頻數據的方式進行控制,并且,根據以何種程度提前讀出音頻數據,對小于突發長度的延遲長度進行控制。
3.根據權利要求1或2所述的數字信號處理裝置,其特征在于,
所述DRAM是SDRAM。
4.一種數字信號處理裝置的控制方法,該數字信號處理裝置具有對突發長度的音頻數據進行突發傳輸的DRAM、以及能夠蓄積所述突發長度的2倍的音頻數據的第1緩沖存儲器,其特征在于,所述數字信號處理裝置的控制方法具有以下步驟:
在采樣周期中從所述第1緩沖存儲器的任意地址開始一個字一個字地依次寫入音頻數據;以及
以將所述第1緩沖存儲器的前半區域的所述突發長度的音頻數據和所述第1緩沖存儲器的后半區域的所述突發長度的音頻數據交替地突發傳輸到所述DRAM的方式進行控制,
以在向所述第1緩沖存儲器的后半區域一個字一個字地依次寫入音頻數據的期間內、將所述第1緩沖存儲器的前半區域的所述突發長度的音頻數據突發傳輸到所述DRAM的方式進行控制,并以在向所述第1緩沖存儲器的前半區域一個字一個字地依次寫入音頻數據的期間內、將所述第1緩沖存儲器的后半區域的所述突發長度的音頻數據突發傳輸到所述DRAM的方式進行控制,并根據以何種程度提前寫入音頻數據,對小于突發長度的延遲長度進行控制。
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