[發明專利]芯片驗證系統及方法在審
| 申請號: | 202110870878.0 | 申請日: | 2021-07-30 |
| 公開(公告)號: | CN113535496A | 公開(公告)日: | 2021-10-22 |
| 發明(設計)人: | 郭向飛;陳玉平 | 申請(專利權)人: | 北京奕斯偉計算技術有限公司 |
| 主分類號: | G06F11/22 | 分類號: | G06F11/22;G06F11/26;G06F30/398 |
| 代理公司: | 北京鼎佳達知識產權代理事務所(普通合伙) 11348 | 代理人: | 侯菲菲;劉鐵生 |
| 地址: | 100176 北京市大興區北京經*** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 芯片 驗證 系統 方法 | ||
本申請提供一種芯片驗證系統及方法,芯片驗證系統包括:測試事件模塊,用于發出測試指令,測試指令是基于腳本生成的指令,測試指令用于驗證待測芯片的功能;信號生成模塊,用于根據測試指令生成與待測芯片相適應的硬件信號;待測模塊,用于放置待測芯片,使得待測芯片接收硬件信號,并響應硬件信號生成輸出數據;對比模塊,用于獲取輸出數據,并根據輸出數據和預設數據的對比結果確定待測芯片是否通過驗證,預設數據為待測芯片在功能正常的情況下響應硬件信號輸出的數據。無論待測芯片的硬件信息如何變化,信號生成模塊都能夠基于測試指令生成與待測芯片相適應的硬件信號,從而實現對待測芯片的相應功能進行驗證,提高芯片驗證效率。
技術領域
本申請涉及芯片技術領域,尤其涉及一種芯片驗證系統及方法。
背景技術
所謂芯片驗證,是指采用相應的驗證語言、驗證工具、驗證方法,在芯片生產之前驗證芯片的設計是否符合芯片的預期功能,并發現相應的缺陷。
目前,針對芯片驗證,主要是基于通用驗證方法學(Universal VerificationMethodology,UVM)進行前端驗證。具體來說,通過代碼確認與驗證技術(Verification IP,VIP)產生激勵驅動,使得待驗證模塊中的芯片的內部信號翻轉,進而觸發相關功能點,產生輸出。接著,將該輸出與對比模塊的輸出進行對比,進而根據對比結果確定芯片是否通過驗證。
然而,不同的芯片之間存在一定的差異。例如:各芯片的位寬、寄存器地址等存在差異。采用同一個芯片驗證系統,在對不同的芯片進行驗證時,由于所要實現的細節會所有不同,因此在對不同芯片實際進行驗證前,需要根據當前待驗證的芯片的硬件情況對芯片驗證系統中某些功能點進行取舍,才能滿足對不同芯片的同一個功能的驗證。這樣,就會增加芯片驗證工作操作的復雜程度,降低芯片驗證的效率。
發明內容
本申請實施例的目的是提供一種芯片驗證系統及方法,以降低芯片驗證工作的復雜程度,提高芯片驗證的效率。
為解決上述技術問題,本申請實施例提供如下技術方案:
本申請第一方面提供一種芯片驗證系統,所述系統包括:測試事件模塊,用于發出測試指令,所述測試指令是基于腳本生成的指令,所述測試指令用于驗證待測芯片的功能;信號生成模塊,用于根據所述測試指令生成與所述待測芯片相適應的硬件信號;待測模塊,用于放置所述待測芯片,使得所述待測芯片接收所述硬件信號,并響應所述硬件信號生成輸出數據;對比模塊,用于獲取所述輸出數據,并根據所述輸出數據和預設數據的對比結果確定所述待測芯片是否通過驗證,所述預設數據為所述待測芯片在功能正常的情況下響應所述硬件信號輸出的數據。
本申請第二方面提供一種芯片驗證方法,所述方法應用于第一方面中的芯片驗證系統,所述方法包括:發出測試指令,所述測試指令是基于腳本生成的指令,所述測試指令用于驗證待測芯片的功能;根據所述測試指令生成與所述待測芯片相適應的硬件信號;控制所述待測芯片接收所述硬件信號,并響應所述硬件信號生成輸出數據,所述待測模塊用于放置所述待測芯片;獲取所述輸出數據,并根據所述輸出數據和預設數據的對比結果確定所述待測芯片是否通過驗證,所述預設數據為所述待測芯片在功能正常的情況下響應所述硬件信號輸出的數據。
相較于現有技術,本申請第一方面提供的芯片驗證系統,通過設置測試事件模塊和信號生成模塊,在驗證內容確定后,測試事件模塊就能夠將軟件化的測試指令發送至信號生成模塊,而信號生成模塊就能夠基于軟件化的測試指令生成與待測芯片相應的硬件信號,進而使待測芯片處理該硬件信號,從而對待測芯片的相應功能進行驗證。這樣,無論待測芯片的硬件信息如何變化,信號生成模塊都能夠基于測試指令生成與待待測芯片相適應的硬件信號,從而實現對待測芯片的相應功能進行驗證。從而,無需測試人員逐個修改系統中與待測芯片相關的接口,降低驗證工作的復雜程度,提高芯片驗證效率。
本申請第二方面提供的芯片驗證方法,與第一方面提供的芯片驗證系統具有相同或相似的有益效果。
附圖說明
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