[發(fā)明專利]一種提高測(cè)距準(zhǔn)確性的自適應(yīng)單錠檢測(cè)系統(tǒng)的方法有效
| 申請(qǐng)?zhí)枺?/td> | 202110718880.6 | 申請(qǐng)日: | 2021-06-28 |
| 公開(公告)號(hào): | CN113445168B | 公開(公告)日: | 2022-08-23 |
| 發(fā)明(設(shè)計(jì))人: | 劉偉 | 申請(qǐng)(專利權(quán))人: | 蘇州墨空視覺(jué)技術(shù)有限公司 |
| 主分類號(hào): | D01H13/16 | 分類號(hào): | D01H13/16 |
| 代理公司: | 北京同輝知識(shí)產(chǎn)權(quán)代理事務(wù)所(普通合伙) 11357 | 代理人: | 廖娜 |
| 地址: | 215000 江蘇省蘇州市工業(yè)園區(qū)*** | 國(guó)省代碼: | 江蘇;32 |
| 權(quán)利要求書: | 查看更多 | 說(shuō)明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 提高 測(cè)距 準(zhǔn)確性 自適應(yīng) 檢測(cè) 系統(tǒng) 方法 | ||
本發(fā)明涉及一種提高測(cè)距準(zhǔn)確性的自適應(yīng)單錠檢測(cè)系統(tǒng)的方法,采集頭的輸出端與多路增益選擇器的第一輸入端端相連接,有源低通濾波器的輸出端與過(guò)零反向放大電路的輸入端相連接,過(guò)零反向放大電路的第一輸出端與比較器的同向輸入端相連接,過(guò)零反向放大電路的第二輸出端與ADC取樣電路的輸入端相連接,DAC的輸出端與比較器的反向輸入端相連接,ADC取樣電路的輸出端與主處理器的第一輸入端相連接,比較器的輸出端與主處理器的第二輸入端相連接,主處理器的第一輸出端與多路增益選擇器的第二輸入端相連接,主處理器的第二輸出端與DAC的輸入端相連接。本發(fā)明無(wú)需用戶參與便可實(shí)現(xiàn)單錠檢測(cè)的自動(dòng)調(diào)節(jié),且數(shù)據(jù)準(zhǔn)確。
技術(shù)領(lǐng)域
本發(fā)明涉及細(xì)紗機(jī)紡織單錠檢測(cè)相關(guān)技術(shù)領(lǐng)域,尤其涉及一種提高測(cè)距準(zhǔn)確性的自適應(yīng)單錠檢測(cè)系統(tǒng)的方法。
背景技術(shù)
因細(xì)紗機(jī)環(huán)境噪音大,用工成本增加,人員穩(wěn)定性較大,導(dǎo)致熟練擋車工的缺乏,因此當(dāng)環(huán)錠上紗線斷頭時(shí),擋車工有90%時(shí)間用于尋找斷頭位置,人員效率低,目前紡織領(lǐng)域智能改造升級(jí)迫在眉睫,故環(huán)錠檢測(cè)系統(tǒng)呼之欲出。現(xiàn)有技術(shù)需根據(jù)安裝距離及鋼絲圈的粗細(xì)手動(dòng)調(diào)節(jié)增益和閾值,因變量較多,故對(duì)使用者要求較高,操作復(fù)雜,很難做到一次調(diào)整到位且數(shù)據(jù)準(zhǔn)確。
有鑒于上述的缺陷,本設(shè)計(jì)人積極加以研究創(chuàng)新,以期創(chuàng)設(shè)一種提高測(cè)距準(zhǔn)確性的自適應(yīng)單錠檢測(cè)系統(tǒng)的方法,使其更具有產(chǎn)業(yè)上的利用價(jià)值。
發(fā)明內(nèi)容
為解決上述技術(shù)問(wèn)題,本發(fā)明的目的是提供一種提高測(cè)距準(zhǔn)確性的自適應(yīng)單錠檢測(cè)系統(tǒng)的方法。
為實(shí)現(xiàn)上述目的,本發(fā)明采用如下技術(shù)方案:
本發(fā)明目的之一:
一種提高測(cè)距準(zhǔn)確性的自適應(yīng)單錠檢測(cè)系統(tǒng),包括若干個(gè)采集頭,采集頭的輸出端與多路增益選擇器的第一輸入端端相連接,多路增益選擇器的輸出端與一級(jí)放大預(yù)處理電路的輸入端相連接,一級(jí)放大預(yù)處理電路的輸出端與有源低通濾波器的輸入端相連接,有源低通濾波器的輸出端與過(guò)零反向放大電路的輸入端相連接,過(guò)零反向放大電路的第一輸出端與比較器的同向輸入端相連接,過(guò)零反向放大電路的第二輸出端與ADC取樣電路的輸入端相連接,DAC的輸出端與比較器的反向輸入端相連接,ADC取樣電路的輸出端與主處理器的第一輸入端相連接,比較器的輸出端與主處理器的第二輸入端相連接,主處理器的第一輸出端與多路增益選擇器的第二輸入端相連接,主處理器的第二輸出端與DAC的輸入端相連接。
作為本發(fā)明的進(jìn)一步改進(jìn),一級(jí)放大預(yù)處理電路包括芯片U3,芯片U3的型號(hào)為OPA17X,芯片U3的第一引腳與OUT-A端相連接,芯片U3的第二引腳與電阻R4的一端相連接,電阻R4的另一端與芯片U3的第一引腳相連接,電容C2并接在電阻R4上,芯片U3的第二引腳與電阻R1的一端相連接,電阻R1的另一端與電容C6的一端相連接,電容C6的另一端與net-A端相連接,電阻R2的一端與+5V相連接,電阻R2的另一端與電阻R3的一端串聯(lián),電阻R3的另一端接地,電阻R2和電阻R3的相連接處連接至芯片U3的第三引腳,電容C1并接在R3上,芯片U3的第五引腳與+5V相連接,芯片U3的第四引腳接地。
作為本發(fā)明的進(jìn)一步改進(jìn),有源低通濾波器包括芯片U1,芯片U1型號(hào)為OPA17X,芯片U1的第一引腳與OUT-B端相連接,芯片U1的第二引腳與電容C4的一端相連接,電容C4的另一端接地,芯片U1的第二引腳與電阻R6的一端相連接,電阻R6的另一端與電阻R5的一端相連接,電阻R5的另一端與OUT-A端相連接,芯片U1的第三引腳與電容C3的一端相連接,電容C3的另一端與電阻R5的一端相連接,芯片U1的第三引腳與芯片U1的第二引腳相連接,芯片U1的第四引腳與+5V相連接,芯片U1的第五引腳接地。
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