[發(fā)明專利]一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺在審
| 申請?zhí)枺?/td> | 202110597436.3 | 申請日: | 2021-05-31 |
| 公開(公告)號: | CN113341382A | 公開(公告)日: | 2021-09-03 |
| 發(fā)明(設(shè)計)人: | 孫一龍;胡鉞琳;江天祺;吳桐;陳文迪;張有明 | 申請(專利權(quán))人: | 東南大學(xué) |
| 主分類號: | G01S7/36 | 分類號: | G01S7/36;G01S13/02;G01S13/89;G01S13/04 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 面向 智慧 認(rèn)知 無線電 探測 識別 開發(fā) 一體化 平臺 | ||
1.一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺,其特征在于,所述平臺包括寬帶接收模塊、信號智慧認(rèn)知模塊和頻率檢測模塊;
其中寬帶接收模塊通過一個可視化交互平臺輔助電路自動設(shè)計;接收模塊內(nèi)部包括低噪聲放大器、混頻器、濾波器、可編程增益放大器以及數(shù)模轉(zhuǎn)換器基本組件,架構(gòu)可選擇超外差式接收機(jī)或者零中頻式接收機(jī),同時支持用戶自定義電路架構(gòu)、定制技術(shù)指標(biāo);用戶輸入時/頻域形式的信號數(shù)據(jù),經(jīng)過接收機(jī)程序處理后,可顯示輸入輸出信號波形;
信號智慧認(rèn)知模塊處理寬帶接收模塊接收的信號數(shù)據(jù),基于圖像處理/神經(jīng)網(wǎng)絡(luò)算法快速識別信號類型、調(diào)制方式;通過時頻圖和星座圖分析,分辨出LFM、SFM、BPSK、QPSK、8PSK、16QAM、CDMA多種信號調(diào)制方式;
頻率檢測模塊利用全數(shù)字鎖相環(huán)快速鎖定頻率,通過頻率粗估計模塊、基于全數(shù)字鎖相環(huán)的頻率精確測量及跟蹤、頻率估計算法模塊,對空間中大功率信號進(jìn)行快速頻率檢測,并將結(jié)果反饋至寬帶接收模塊使其根據(jù)不同情況動態(tài)調(diào)整寬帶接收模塊內(nèi)部組件的參數(shù)。
2.根據(jù)權(quán)利要求1所述的一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺,其特征在于,所述寬帶接收模塊包括射頻信號讀入功能,讀取以文本形式存儲在計算機(jī)內(nèi)存中的信號采樣數(shù)據(jù);射頻接收機(jī)仿真功能,依據(jù)用戶設(shè)置的接收機(jī)種類以及關(guān)鍵參數(shù),對信號數(shù)據(jù)在時/頻域上進(jìn)行處理,實現(xiàn)接收機(jī)的可重構(gòu)和行為級仿真功能。
3.根據(jù)權(quán)利要求1所述的一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺,其特征在于,所述信號智慧認(rèn)知模塊包括數(shù)字信號數(shù)據(jù)讀入功能,可讀取由寬帶接收模塊處理的數(shù)字信號;利用圖像處理/神經(jīng)網(wǎng)絡(luò)算法,提取信號時頻圖和星座圖特征,辨別信號類型和調(diào)制方式。
4.根據(jù)權(quán)利要求1所述的一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺,其特征在于,所述頻率檢測模塊包含頻率粗估計模塊、基于全數(shù)字鎖相環(huán)的射頻信號頻率精確測量與跟蹤模塊和頻率估計算法模塊;首先利用頻率粗估計模塊實現(xiàn)頻率粗估計,然后由頻率精確測量與跟蹤模塊實現(xiàn)信號頻率精確測量;頻率估計算法模塊的功能為根據(jù)數(shù)控振蕩器的頻率控制字得到當(dāng)前輸入信號的頻率大小。
5.根據(jù)權(quán)利要求2所述的一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺,其特征在于,寬帶接收模塊使用編程語言C++,結(jié)合編程工具在計算機(jī)上實現(xiàn)。
6.根據(jù)權(quán)利要求3所述的一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺,其特征在于,信號智慧認(rèn)知模塊使用編程語言C++,結(jié)合編程工具在計算機(jī)上實現(xiàn)。
7.根據(jù)權(quán)利要求4所述的一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺,其特征在于,頻率檢測模塊使用編程語言C在計算機(jī)上實現(xiàn)。
8.根據(jù)權(quán)利要求4所述的一種面向智慧認(rèn)知無線電的探測識別開發(fā)一體化平臺,其特征在于,頻率檢測模塊使用硬件描述語言Verilog HDL在FPGA上實現(xiàn)。
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