[發明專利]一種TAS幀的處理方法及裝置在審
| 申請號: | 202110583371.7 | 申請日: | 2021-05-27 |
| 公開(公告)號: | CN113438691A | 公開(公告)日: | 2021-09-24 |
| 發明(設計)人: | 陳松;檀甲甲;朱學慶 | 申請(專利權)人: | 翱捷科技股份有限公司 |
| 主分類號: | H04W28/02 | 分類號: | H04W28/02;H04W28/04;H04W28/08 |
| 代理公司: | 上海雙霆知識產權代理事務所(普通合伙) 31415 | 代理人: | 殷曉雪 |
| 地址: | 201203 上海市浦東新區中國*** | 國省代碼: | 上海;31 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 tas 處理 方法 裝置 | ||
本申請公開了一種TAS幀的處理方法。將TAS幀分成高優先級TAS幀和低優先級TAS幀。TAS幀的發送端在未發生TAS沖突時正常發送TAS幀,在發生TAS沖突時根據TAS幀被阻塞的順序以及優先級來調整TAS幀的實際發送時間;還在TAS幀中設置延遲標志,記錄該TAS幀是否被延遲發送以及延遲發送的時長。TAS幀的接收端收到TAS幀之后,如果該TAS幀的延遲標志表明該TAS幀未發生延遲,則正常處理該TAS幀;如果該TAS幀的延遲標志表明該TAS幀發生了延遲,則縮短處理該TAS幀的等待時長,縮短的等待時長等于該TAS幀的延遲標志記錄的延遲發送的時長。本申請修改了DigRF V4協議中的TAS幀處理機制,用來解決TAS沖突場景下存在的問題。
技術領域
本申請涉及一種移動通信的UE(user equipment,用戶設備)芯片設計領域。
背景技術
UE中通常將射頻、基帶分為RFIC(radio-frequency integrated circuit,射頻集成電路)和BBIC(base-band integrated circuit,基帶集成電路)兩個芯片。兩個芯片之間使用稱之為DigRF(Digital RF,數字射頻)的接口進行連接。
在實際的通信芯片設計中,通常BBIC作為MasterIC(主芯片),帶有DSP(DigitalSignal Processor,數字信號處理器),執行效率高,可以并行執行多條指令;例如NR(NewRadio,新無線)和LTE(長期演進技術)可以獨立執行,互不影響。而RFIC通常作為SlaveIC(從芯片),不帶DSP,只有MCU(microcontroller unit,微控制器單元),執行效率低,且只能順序執行;例如當NR和LTE同時有任務需要處理時,只能串行處理。
移動通信中對時間精度要求極高,比如上行發送數據的開始和結束、下行接收數據的開始和結束、AGC(automatic gain control,自動增益控制)調整、ATC(AutomaticTiming Control,自動定時控制)調整、AFC(automatic frequency control,自動頻率控制)調整等,均需要BBIC和RFIC都在精確的時間生效,但RFIC不知道這個時間信息,所以通常是由BBIC通過DigRF接口發送TAS(Timing Accurate Strobe,精準時間指示)幀來觸發RFIC執行相應處理。
以上行發送數據為例,當上行需要在tradio時刻開始發送數據,那么BBIC在tradio時刻之前提前tMacroAdvance時間發送TxStartMacro(打開RFIC側發射通道的命令)給RFIC。RFIC在收到TxStartMacro后先做預處理,生成TxStart(開始發射)的序列(Sequence)。tMacroAdvance需要大于或等于RFIC在收到TxStartMacro后做預處理、生成TxStart的序列的時間。然后BBIC在tradio時刻之前提前twakeupDly+ttransDly時間準備發送TAS幀。twakeupDly表示BBIC的處理延遲,是從TAS幀被Trig(阻塞)到允許發送的時間;ttransDly表示TAS幀的傳輸延遲,是TAS幀發送出去需要的時間;兩者均為固定值。其中ttransDly這段時間需要占用通路。通路是指TxControlLane,所有控制信息都在TxControlLane上串行發送。DigRF V4協議規定TAS幀會連續發送兩次以提高TAS幀發送的成功率。當RFIC收到BBIC發送的TAS幀后,固定延遲一段時間trfDly后(trfDly表示RFIC的處理時間),立即開始執行TxStart的序列,因此能保證RFIC在精確時間開始和/或結束數據的發送和/或接收。
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