[發(fā)明專利]一種用于電容型逐次逼近模數(shù)轉(zhuǎn)換器的電容排序電路有效
| 申請?zhí)枺?/td> | 202110371211.6 | 申請日: | 2021-04-07 |
| 公開(公告)號: | CN113131940B | 公開(公告)日: | 2022-05-31 |
| 發(fā)明(設(shè)計(jì))人: | 樊華;仵欣杰;許童睿;馮全源;蘇華英;王國松 | 申請(專利權(quán))人: | 電子科技大學(xué) |
| 主分類號: | H03M1/46 | 分類號: | H03M1/46 |
| 代理公司: | 電子科技大學(xué)專利中心 51203 | 代理人: | 陳一鑫 |
| 地址: | 611731 四川省成*** | 國省代碼: | 四川;51 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 用于 電容 逐次 逼近 轉(zhuǎn)換器 排序 電路 | ||
1.一種用于差分型逐次逼近模數(shù)轉(zhuǎn)換器的電容排序電路,針對均含有N個(gè)單位電容的正負(fù)電容陣列進(jìn)行排序;正電容陣列的N個(gè)單位電容分別標(biāo)記為CP_0、CP_1、CP_2……CP_N-1;負(fù)電容陣列的N個(gè)單位電容分別標(biāo)記為CN_0、CN_1、CN_2……CN_N-1;所述電容排序電路包括:比較器、待排序電容CP_0~CP_N-1和CN_0~CN_N-1、開關(guān)電路、信號線LINEP_0~LINEP_N-1和LINEN_0~LINEN_N-1、控制輸出模塊;所述比較器的正負(fù)輸入端均分為兩路,一路通過開關(guān)連接共模電壓VCM,另一路分別于正負(fù)電容陣列的上極板相連;待排序正電容陣列每個(gè)電容的輸出端通過開關(guān)電路決定連接信號;待排序負(fù)電容陣列每個(gè)電容的輸出端通過開關(guān)電路決定連接信號,正負(fù)電容陣列的開關(guān)電路分別由信號線LINEP_0~LINEP_N-1和信號線LINEN_0~LINEN_N-1控制;連接信號包括兩種,一種為參考電壓VREF,另一種為連接地;當(dāng)信號線LINEP_0~LINEP_N-1和信號線LINEN_0~LINEN_N-1為高電平時(shí),電容的輸出端與參考電壓VREF相連;當(dāng)信號線LINEP_0~LINEP_N-1和信號線LINEN_0~LINEN_N-1為低電平時(shí),電容的輸出端與地相連;所述開關(guān)電路為每個(gè)待排序電容的輸出端與每條信號線的輸入端之間都設(shè)置的開關(guān)的開關(guān)群;需注意的是在差分型逐次逼近模數(shù)轉(zhuǎn)換器中,將正負(fù)電容陣列相同位置的單位電容看成一個(gè)整體進(jìn)行排序;組成待排序電容C0、C1、C2……CN-1;
對電容的排序通過分別對兩個(gè)電容之間的比較實(shí)現(xiàn);當(dāng)比較CX與CX+1之間的電容大小時(shí),首先關(guān)閉開關(guān),使得正負(fù)陣列的電容上極板全部接VCM;其次,將CP_X的下極板與VREF相連接,正電容陣列其余電容的下極板與地相連;類似的,對應(yīng)的負(fù)電容器陣列的電容CN_X下極板接地,負(fù)電容陣列其余電容的下極板與VREF相連;接著,開關(guān)K0斷開,并將正負(fù)電容陣列電容的下極板的連接信號相互交換,即正電容陣列的CP_X+1的下極板與VREF相連接,正電容陣列其余電容的下極板與地相連;負(fù)電容器陣列的電容CN_X+1下極板接地,負(fù)電容陣列其余電容的下極板與VREF相連;根據(jù)電荷守恒原理,正負(fù)電容陣列上極板的電壓將會發(fā)生變化,通過比較器的輸出高低可以判斷CX與CX+1之間的電容大小;其余電容之間的比較則重復(fù)上述操作。
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