[發明專利]降低壓差的方法、存儲介質、電路結構及電源裝置有效
| 申請號： | 202110232350.0 | 申請日： | 2021-03-03 |
| 公開（公告）號： | CN112600416B | 公開（公告）日： | 2021-06-08 |
| 發明（設計）人： | 吳永俊 | 申請（專利權）人： | 珠海智融科技有限公司 |
| 主分類號： | H02M3/156 | 分類號： | H02M3/156;H02M3/158 |
| 代理公司： | 廣州嘉權專利商標事務所有限公司 44205 | 代理人： | 俞梁清 |
| 地址： | 519000 廣東省珠海市高新*** | 國省代碼： | 廣東;44 |
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| 摘要： | |||
| 搜索關鍵詞： | 降低 方法 存儲 介質 電路 結構 電源 裝置 | ||
1.一種降低壓差的方法，其特征在于，包括以下步驟：
S100、以輸入PWM信號的周期T為基準，隔X個所述周期T，在所述PWM信號中插入時間長度為T1的低電平信號；
S200、確定開關電源電路的SW節點電壓波形信號出現低于所述SW節點電壓的峰值且不為零的波形時，則執行以下任一個步驟；
S310、保持所述X和所述T1的值不變，并返回所述步驟S100；
S320、變更所述X的值，保持所述T1的值不變，并返回所述步驟S100；
S330、變更所述T1的值，保持所述X的值不變，并返回所述步驟S100；
S340、同時變更所述X和所述T1的值，并返回所述步驟S100；
其中，X＞1。
2.根據權利要求1所述的降低壓差的方法，其特征在于，在執行任一步驟的同時，還同時執行以下步驟：
當所述開關電源電路的輸入電壓VIN與輸出電壓VOUT之間的壓差△V達到最小值時，使所述開關電源電路的濾波電感的電感值降低；
其中，所述壓差△V的最小值分別為：
當所述開關電源電路為降壓型時，△V=VIN -VOUT=（1- Dmax）*VIN；
當所述開關電源電路為升壓型時，△V=VIN -VOUT=【1- 1/（1- Dmax）】*VIN；
當所述開關電源電路為升降壓型時，△V=VIN -VOUT=【1-Dmax/（1-Dmax）】*VIN；
其中，Dmax=(T-T1)/ T。
3.根據權利要求1所述的降低壓差的方法，其特征在于，在啟動所述步驟S100前，先輸入指令代碼A、B、C、D中的任意一種，并在所述SW節點電壓波形信號出現低于所述SW節點電壓的峰值且不為零的波形后，確定指令類型，并執行相應的步驟：
確定輸入的是“A”時，則執行所述步驟S310；
確定輸入的是“B”時，則執行所述步驟S320；
確定輸入的是“C”時，則執行所述步驟S330；
確定輸入的是“D”時，則執行所述步驟S340。
4.根據權利要求1至3任一項所述的降低壓差的方法，其特征在于：執行所述步驟S200時，確定所述SW節點電壓波形信號不出現低于所述SW節點電壓的峰值且不為零的波形，則直接執行所述步驟S310。
5.一種計算機可讀存儲介質，其特征在于，所述存儲介質存儲有一個或者多個程序，一個或者多個所述程序可被一個或者多個處理器執行，以實現如權利要求1至4中任一項所述的降低壓差的方法。
6.一種降低壓差的電路結構，其特征在于，包括：
信號發生模塊，用于輸出包含關斷時間的脈沖信號；
與邏輯模塊；所述與邏輯模塊的第一輸入端與PWM信號端電性連接，所述與邏輯模塊的第二輸入端與所述信號發生模塊的輸出端電性連接；所述與邏輯模塊的輸出端與開關電源電路的控制端電性連接；
終端，所述終端的第一輸出端與所述信號發生模塊的控制端電性連接，所述終端的采集端與所述開關電源電路電性連接；
其中，所述終端包括存儲器、處理器及存儲在所述存儲器上并可在所述處理器上運行的計算機程序，所述處理器執行所述程序時實現：
如權利要求1至4中任一項所述的降低壓差的方法。
7.根據權利要求6所述的降低壓差的電路結構，其特征在于：還包括電感旁路模塊，所述電感旁路模塊并聯在所述開關電源電路中的濾波電感上，以降低所述濾波電感的電感值，所述電感旁路模塊的控制端與所述終端的第二輸出端電性連接。
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