[發(fā)明專利]一種基于軟件無線電的機(jī)載信息安全模塊

有效

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• 申請日: 2020-10-23
• 公開（公告）號: CN112422165B
• 公開（公告）日: 2022-06-21
• 發(fā)明（設(shè)計）人: 劉笑凱;陳俊凱;王龍;周林;高超;楊世豪;姬勝凱
• 申請（專利權(quán)）人: 中國電子信息產(chǎn)業(yè)集團(tuán)有限公司第六研究所
• 主分類號: H04B7/185
• 分類號: H04B7/185;H04L9/08
• 代理公司: 北京理工大學(xué)專利中心 11120
• 代理人: 高會允

1.一種基于軟件無線電的機(jī)載信息安全模塊，其特征在于，包括：管理芯片、接口芯片以及編解碼處理單元；

所述編解碼處理單元包括3個獨立的處理芯片，分別為，第一高速處理芯片、第二高速處理芯片以及中速處理芯片；其中第一高速處理芯片和第二高速處理芯片為時鐘最高為740MHz的處理芯片；中速處理芯片為時鐘最高為150MHz的處理芯片；

所述管理芯片與所述接口芯片通過串口連接，用于兩者之間的信息交互；

所述管理芯片與每個處理芯片之間均通過1個8路并口和1個以上的串口連接，用于管理芯片配置處理芯片工作、兩者之間信息交互、監(jiān)控處理芯片工作狀態(tài)；其中并口用于管理芯片加載處理芯片的執(zhí)行程序，并配置處理芯片工作；

所述管理芯片首先獲取待執(zhí)行的任務(wù)，從中獲取任務(wù)的服務(wù)對象信息；所述管理芯片還用于將不同的任務(wù)分別分配到3個處理芯片中，并將任務(wù)分配情況發(fā)送至所述接口芯片；進(jìn)入工作狀態(tài)后接口芯片按分配情況搭建外部電臺與處理芯片的通道，處理芯片根據(jù)任務(wù)分配情況與外部電臺實現(xiàn)數(shù)據(jù)交互，并執(zhí)行分配到的任務(wù)；進(jìn)入工作狀態(tài)之后，管理芯片繼續(xù)獲取新的待執(zhí)行的任務(wù)；

所述接口芯片對外包含8路獨立高速串行總線MGtx及1路以上中低速總線，連接外部電臺接口；所述接口芯片對內(nèi)與每個處理芯片之間各連接8路獨立的串行總線；

所述管理芯片用于評估各處理芯片的實際工作狀態(tài)，根據(jù)實際工作狀態(tài)將不同的任務(wù)分別分配到3個處理芯片中；所述管理芯片還用于獲取各處理芯片的溫度信息和電壓信息，用于判斷處理芯片的健康狀態(tài)；

所述接口芯片用于從外部電臺接口處接收處理數(shù)據(jù)，進(jìn)行緩存，并對緩存數(shù)據(jù)進(jìn)行數(shù)據(jù)識別、校驗處理，判斷接收到的所述處理數(shù)據(jù)是否完整且合法；

所述接口芯片還根據(jù)所述管理芯片的任務(wù)分配情況，實現(xiàn)外部電臺與處理芯片之間的數(shù)據(jù)交換；

所述接口芯片還用于動態(tài)統(tǒng)計各個處理電路的工作量及業(yè)務(wù)完成情況，發(fā)送至管理電路，用于管理電路評估處理電路的實際工作狀態(tài)。

2.如權(quán)利要求1所述的基于軟件無線電的機(jī)載信息安全模塊，其特征在于，所述接口芯片為信息交換FPGA，具體為7K325T芯片，其片上支持32路12.5G收發(fā)器。

3.如權(quán)利要求1所述的基于軟件無線電的機(jī)載信息安全模塊，其特征在于，所述第一和第二高速處理芯片為高速、大規(guī)模處理能力的FPGA芯片；

所述中速處理芯片為中低速、大規(guī)模處理能力的FPGA芯片。

4.如權(quán)利要求1所述的基于軟件無線電的機(jī)載信息安全模塊，其特征在于，所述編解碼處理單元中存儲編解碼算法，采用而又不僅限于RSA算法、ECC加密算法、AES算法、3DES算法、及國密SM系列算法中的一種或多種。

5.如權(quán)利要求1所述的基于軟件無線電的機(jī)載信息安全模塊，其特征在于，所述服務(wù)對象信息包括電臺種類、數(shù)量，每種電臺的具體服務(wù)內(nèi)容、優(yōu)先級以及處理時延。

6.如權(quán)利要求1所述的基于軟件無線電的機(jī)載信息安全模塊，其特征在于，所述管理芯片用于評估各處理芯片的實際工作狀態(tài)，根據(jù)實際工作狀態(tài)將不同的任務(wù)分別分配到3個處理芯片中；

具體包括：若其中1個處理芯片的實際工作狀態(tài)異常，則所述管理電路會將異常的處理芯片的任務(wù)分配給正常的處理芯片，然后復(fù)位該異常的處理芯片，如果復(fù)位之后恢復(fù)正常狀態(tài)，則將原來的任務(wù)分配回到原處理芯片。