[發(fā)明專利]數(shù)據(jù)傳輸電路有效
| 申請?zhí)枺?/td> | 202011004948.6 | 申請日： | 2020-09-21 |
| 公開（公告）號： | CN112148659B | 公開（公告）日： | 2022-02-01 |
| 發(fā)明（設計）人： | 齊雪靜;劉小衛(wèi) | 申請（專利權(quán)）人： | 牛芯半導體（深圳）有限公司 |
| 主分類號： | G06F13/40 | 分類號： | G06F13/40;G06F13/42 |
| 代理公司： | 深圳市隆天聯(lián)鼎知識產(chǎn)權(quán)代理有限公司 44232 | 代理人： | 劉抗美 |
| 地址： | 518000 廣東省深圳市福*** | 國省代碼： | 廣東;44 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 數(shù)據(jù)傳輸 電路 | ||
1.一種數(shù)據(jù)傳輸電路，其特征在于，包括：主通信電路和與所述主通信電路連接的邊帶電路，所述邊帶電路包括：
寄存器模塊，與所述主通信電路電連接，用于接收所述主通信電路寫入所述邊帶電路的通信數(shù)據(jù)；
邊帶輸入模塊，與其它電路連接，用于接收所述其它電路輸入所述邊帶電路的輸入數(shù)據(jù)；
數(shù)據(jù)處理模塊，與所述邊帶輸入模塊電連接，與所述寄存器模塊電連接，用于基于所述輸入數(shù)據(jù)與所述寄存器模塊進行數(shù)據(jù)交互；
邊帶輸出模塊，與所述數(shù)據(jù)處理模塊電連接，用于輸出所述數(shù)據(jù)處理模塊從所述寄存器模塊獲取的輸出數(shù)據(jù)。
2.根據(jù)權(quán)利要求1所述的數(shù)據(jù)傳輸電路，其特征在于，所述邊帶輸入模塊包括：
邊帶輸入子模塊，用于接收所述輸入數(shù)據(jù)；
解碼子模塊，與所述邊帶輸入子模塊電連接，與所述數(shù)據(jù)處理模塊電連接，用于將所述輸入數(shù)據(jù)進行解碼后傳輸至所述數(shù)據(jù)處理模塊。
3.根據(jù)權(quán)利要求1所述的數(shù)據(jù)傳輸電路，其特征在于，所述數(shù)據(jù)處理模塊還包括：
寄存器仲裁子模塊，與所述邊帶輸入模塊電連接，與所述寄存器模塊電連接，用于判定所述輸入數(shù)據(jù)進入所述寄存器模塊的順序，還用于判定所述輸出數(shù)據(jù)輸出所述寄存器模塊的順序。
4.根據(jù)權(quán)利要求3所述的數(shù)據(jù)傳輸電路，其特征在于，所述數(shù)據(jù)處理模塊還包括：
輸出緩存子模塊，與所述寄存器仲裁子模塊電連接，與所述邊帶輸出模塊電連接，用于將所述輸出數(shù)據(jù)進行緩存并傳輸至所述邊帶輸出模塊。
5.根據(jù)權(quán)利要求4所述的數(shù)據(jù)傳輸電路，其特征在于，
所述輸出緩存子模塊與所述主通信電路電連接，用于轉(zhuǎn)發(fā)所述主通信電路輸出的主通信數(shù)據(jù)。
6.根據(jù)權(quán)利要求5所述的數(shù)據(jù)傳輸電路，其特征在于，所述數(shù)據(jù)處理模塊還與所述主通信電路電連接，所述數(shù)據(jù)處理模塊還包括：
數(shù)據(jù)分發(fā)子模塊，與所述邊帶輸入模塊連接，與所述寄存器仲裁子模塊電連接，與所述主通信電路電連接，與所述輸出緩存子模塊電連接，用于將所述輸入數(shù)據(jù)輸入所述寄存器仲裁模塊或所述主通信電路或所述輸出緩存子模塊。
7.根據(jù)權(quán)利要求6所述的數(shù)據(jù)傳輸電路，其特征在于，
所述數(shù)據(jù)分發(fā)子模塊還用于判斷所述輸入數(shù)據(jù)的格式是否有誤，并將判斷結(jié)果發(fā)送至所述輸出緩存子模塊。
8.根據(jù)權(quán)利要求6所述的數(shù)據(jù)傳輸電路，其特征在于，所述其它電路包括第一其它電路和第二其它電路，
所述邊帶輸入模塊有兩個，兩個所述邊帶輸入模塊分別對應所述第一其它電路和所述第二其它電路；
所述邊帶輸出模塊有兩個，兩個所述邊帶輸出模塊分別對應所述第一其它電路和所述第二其它電路；
所述數(shù)據(jù)分發(fā)子模塊有兩個，兩個所述數(shù)據(jù)分發(fā)子模塊分別對應所述第一其它電路和所述第二其它電路；
所述輸出緩存子模塊有兩個，兩個所述輸出緩存子模塊分別對應所述第一其它電路和所述第二其它電路。
9.根據(jù)權(quán)利要求8所述的數(shù)據(jù)傳輸電路，其特征在于，
每個所述數(shù)據(jù)分發(fā)子模塊與兩個所述輸出緩存子模塊電連接，用于判定所述兩個所述輸出緩存子模塊中接收所述輸入數(shù)據(jù)的輸出緩存子模塊。
10.根據(jù)權(quán)利要求5所述的數(shù)據(jù)傳輸電路，其特征在于，所述邊帶輸出模塊包括：
編碼子模塊，與所述數(shù)據(jù)處理模塊電連接，用于對所述輸出數(shù)據(jù)或所述主通信數(shù)據(jù)進行編碼得到編碼數(shù)據(jù)；
邊帶輸出子模塊，與所述編碼子模塊電連接，用于輸出所述編碼數(shù)據(jù)。
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