[發明專利]存儲器設備和操作存儲器設備的方法在審
| 申請號: | 202010547078.0 | 申請日: | 2020-06-16 |
| 公開(公告)號: | CN112542186A | 公開(公告)日: | 2021-03-23 |
| 發明(設計)人: | 梁喆宇 | 申請(專利權)人: | 愛思開海力士有限公司 |
| 主分類號: | G11C7/10 | 分類號: | G11C7/10;G11C7/12;G11C7/18 |
| 代理公司: | 北京市金杜律師事務所 11256 | 代理人: | 董莘 |
| 地址: | 韓國*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 存儲器 設備 操作 方法 | ||
1.一種頁緩沖器,所述頁緩沖器被耦合到存儲器單元,所述頁緩沖器包括:
位線感測電路,所述位線感測電路通過位線與所述存儲器單元耦合,并且所述位線感測電路被配置為執行對被存儲在所述存儲器單元中的第一數據進行感測的位線感測操作;
鎖存器控制電路,所述鎖存器控制電路與所述位線感測電路耦合;
主鎖存器,所述主鎖存器通過所述鎖存器控制電路與所述位線感測電路耦合,并且所述主鎖存器被配置為執行存儲所感測的所述第一數據的主鎖存器操作;以及
高速緩存鎖存器,所述高速緩存鎖存器與所述主鎖存器耦合,并且所述高速緩存鎖存器被配置為執行將被存儲在所述主鎖存器中的第二數據進行存儲的高速緩存鎖存器操作,
其中所述鎖存器控制電路控制所述位線感測電路與所述主鎖存器的連接,使得所述高速緩存鎖存器操作的一時間段與所述位線感測操作的一時間段重疊。
2.根據權利要求1所述的頁緩沖器,其中所述第二數據是在對被存儲在所述存儲器單元中的所述第一數據進行感測的所述位線感測操作之前被存儲在所述主鎖存器中的數據。
3.根據權利要求1所述的頁緩沖器,其中在將被存儲在所述主鎖存器中的所述第二數據存儲在所述高速緩存鎖存器中的所述高速緩存鎖存器操作被執行時,所述位線感測電路啟動所述位線感測操作。
4.根據權利要求3所述的頁緩沖器,其中當所述位線感測操作完成時,所述主鎖存器執行所述主鎖存器操作。
5.根據權利要求1所述的頁緩沖器,其中當所述位線感測操作和所述高速緩存鎖存器操作正被執行時,所述鎖存器控制電路中斷所述位線感測電路與所述主鎖存器的所述連接,以及當所述高速緩存鎖存器操作已經完成時,所述鎖存器控制電路保持所述位線感測電路與所述主鎖存器的所述連接。
6.根據權利要求1所述的頁緩沖器,其中所述鎖存器控制電路包括:
第一開關,被耦合在第一感測節點與第二感測節點之間;以及
第二開關,被耦合在第一節點與第二節點之間,
其中所述位線感測電路被耦合在所述第一感測節點與所述第一節點之間,以及
其中所述主鎖存器和所述高速緩存鎖存器被耦合在所述第二感測節點與所述第二節點之間。
7.根據權利要求6所述的頁緩沖器,其中在所述高速緩存鎖存器操作的某個時段期間,所述鎖存器控制電路接通所述第一開關,并且在所述高速緩存鎖存器操作的整個時段期間,所述鎖存器控制電路關斷所述第二開關。
8.根據權利要求6所述的頁緩沖器,其中在所述主鎖存器操作的某個時間段期間,所述鎖存器控制電路接通所述第二開關。
9.根據權利要求6所述的頁緩沖器,
其中所述鎖存器控制電路還包括第三開關和第四開關,所述第三開關和所述第四開關各自被耦合在接地端子與所述第二節點之間,
其中所述第三開關由所述第二感測節點的電勢控制,以及
其中所述第四開關由用于重置所述主鎖存器或所述高速緩存鎖存器的放電信號控制。
10.一種存儲器設備,包括:
存儲器單元陣列,包括多個存儲器單元;
第一緩沖器,被配置為對被存儲在所述多個存儲器單元中的數據進行感測和存儲;
第二緩沖器,被配置為存儲從所述第一緩沖器傳送的數據;以及
讀取操作控制器,被配置為控制所述第一緩沖器,以執行對被存儲在所述多個存儲器單元之中的第一存儲器單元中的第一數據進行感測和存儲的數據讀取操作,并且所述讀取操作控制器被配置為控制所述第一緩沖器和所述第二緩沖器,使得所述數據讀取操作的一時間段與數據傳輸操作的一時間段重疊,
其中所述數據傳輸操作將被存儲在所述第一緩沖器中的第二數據存儲在所述第二緩沖器中。
11.根據權利要求10所述的存儲器設備,其中所述讀取操作控制器控制所述第一緩沖器,以在所述數據傳輸操作被執行時啟動所述數據讀取操作。
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