[發明專利]包含同步級的行波流水線在審
| 申請號: | 202010534379.X | 申請日: | 2020-06-12 |
| 公開(公告)號: | CN112116933A | 公開(公告)日: | 2020-12-22 |
| 發明(設計)人: | K·沙克瑞;A·F·Z·加萊姆 | 申請(專利權)人: | 美光科技公司 |
| 主分類號: | G11C7/10 | 分類號: | G11C7/10;G11C7/12 |
| 代理公司: | 北京律盟知識產權代理有限責任公司 11287 | 代理人: | 王龍 |
| 地址: | 美國愛*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 包含 同步 行波 流水線 | ||
本申請涉及一種包含同步級的行波流水線。一種行波流水線包含數據路徑和時鐘路徑。數據路徑包含數據輸入節點和數據輸出節點之間的多個行波流水線數據級和同步數據級。同步數據級包含用于鎖存來自同步數據級的數據的第一數據鎖存器。時鐘路徑包含輸入時鐘節點和返回時鐘節點之間的對應于多個行波流水線數據級的多個時鐘級。每個時鐘級具有被配置為等于相應的行波流水線數據級的延遲的延遲。行波流水線包含用于響應于返回時鐘節點上的返回時鐘信號而鎖存數據輸出節點上的數據的第二數據鎖存器。第一數據鎖存器響應于時鐘路徑上的時鐘信號而鎖存來自同步數據級的數據。
技術領域
本公開總體上涉及集成電路裝置中的信號時序。特別地,在一或多個實施例中,本公開涉及一種包含存儲器裝置中的行波流水線和同步級的行波流水線。
背景技術
存儲器裝置通常被提供為計算機或其它電子裝置中的內部半導體集成電路裝置。存在許多不同類型的存儲器,包含隨機存取存儲器(RAM)、只讀存儲器(ROM)、動態隨機存取存儲器(DRAM)、同步動態隨機存取存儲器(SDRAM)和閃存存儲器。
閃存存儲器裝置已發展成廣泛用于電子應用的非易失性存儲器的流行源。閃存存儲器裝置通常使用允許高存儲密度、高可靠性和低功率消耗的單晶體管存儲器單元。通過電荷存儲結構(例如,浮置柵極或電荷陷阱)的編程(其常常稱為寫入)或其它物理現象(例如,相變或極化),存儲器單元的閾值電壓的變化決定了每個單元的數據值。閃存存儲器的常見用途包含個人計算機、平板計算機、數碼相機、數字媒體播放器、蜂窩電話、固態驅動器和可移動存儲器模塊,并且用途正在增長。
行波流水線可以在數據路徑中用于在集成電路的不同部分(諸如存儲器裝置)之間發送或接收數據。在行波流水線中,數據信號和時鐘信號一起移動(例如,被對準)。在行波流水線的每個級中,數據信號和時鐘信號被延遲相同的量。數據信號和時鐘信號到達行波流水線的輸出所花費的時間決定了在輸出處鎖存數據所需的鎖存器(例如,FIFO)級的數量。
由于上面陳述的原因和下面陳述的對于閱讀和理解本說明書的本領域技術人員來說將變得顯而易見的其它原因,在本領域中需要用于在行波流水線中發送或接收數據的替代性方法和用于執行此類方法的系統和設備。
發明內容
一個方面涉及一種行波流水線。所述行波流水線包括:數據路徑,包括數據輸入節點和數據輸出節點之間的多個行波流水線數據級和同步數據級,所述同步數據級包括用于鎖存來自所述同步數據級的數據的第一數據鎖存器;時鐘路徑,包括輸入時鐘節點和返回時鐘節點之間的對應于所述多個行波流水線數據級的多個時鐘級,所述多個時鐘級中的每個時鐘級具有被配置為等于所述多個行波流水線數據級中的所述相應的行波流水線數據級的延遲的延遲;以及第二數據鎖存器,用于響應于所述返回時鐘節點上的返回時鐘信號而鎖存所述數據輸出節點上的所述數據,其中所述第一數據鎖存器響應于所述時鐘路徑上的時鐘信號而鎖存來自所述同步數據級的所述數據。
另一方面涉及一種存儲器。所述存儲器包括存儲器陣列;同步數據級,用于響應于地址信號而從所述存儲器陣列輸出數據,所述同步數據級包括用于鎖存所述輸出數據的第一數據鎖存器;地址路徑,耦合到所述同步數據級的輸入,所述地址路徑包括多個行波流水線地址級;數據路徑,耦合到所述同步數據級的輸出,所述數據路徑包括多個行波流水線數據級;輸入時鐘路徑,包括對應于所述多個行波流水線地址級的多個輸入時鐘級,所述多個輸入時鐘級中的每個輸入時鐘級包括被配置為等于所述多個行波流水線地址級中的所述相應的行波流水線地址級的延遲的延遲;以及返回時鐘路徑,在所述第一數據鎖存器處耦合到所述輸入時鐘路徑,所述返回時鐘路徑包括對應于所述多個行波流水線數據級的多個返回時鐘級,所述多個返回時鐘級中的每個返回時鐘級的延遲等于所述多個行波流水線數據級中的所述相應的行波流水線數據級的延遲,其中所述第一數據鎖存器響應于所述輸入時鐘路徑上的時鐘信號而鎖存所述輸出數據。
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