[發明專利]基于布局環境的單元時序特征分析在審
| 申請號： | 202010411732.5 | 申請日： | 2020-05-15 |
| 公開（公告）號： | CN112685988A | 公開（公告）日： | 2021-04-20 |
| 發明（設計）人： | 江哲維;高章瑞;葉松艷;許力中 | 申請（專利權）人： | 臺灣積體電路制造股份有限公司 |
| 主分類號： | G06F30/392 | 分類號： | G06F30/392;G06F30/398;G06F115/06 |
| 代理公司： | 北京律盟知識產權代理有限責任公司 11287 | 代理人： | 李春秀 |
| 地址： | 中國臺灣新竹市*** | 國省代碼： | 臺灣;71 |
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| 摘要： | |||
| 搜索關鍵詞： | 基于 布局 環境 單元 時序 特征 分析 | ||
【權利要求書】：
1.一種設計集成電路的方法，其由至少一個處理器執行，所述方法包括：
存取集成電路IC的布局，所述布局包括至少一個單元；
基于所述單元的布局環境來確定所述單元的環境群組，所述環境群組與時序表相關聯；及
對所述布局執行時序分析以根據所述時序表確定所述布局是否遵守時序約束規則。
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