[發(fā)明專利]一種應(yīng)用于集成電路的時序控制電路及一種服務(wù)器板卡有效
| 申請?zhí)枺?/td> | 202010153472.6 | 申請日： | 2020-03-06 |
| 公開（公告）號： | CN111400985B | 公開（公告）日： | 2022-06-03 |
| 發(fā)明（設(shè)計）人： | 馮子秋 | 申請（專利權(quán)）人： | 蘇州浪潮智能科技有限公司 |
| 主分類號： | G06F30/347 | 分類號： | G06F30/347 |
| 代理公司： | 北京集佳知識產(chǎn)權(quán)代理有限公司 11227 | 代理人： | 陳麗 |
| 地址： | 215100 江蘇省蘇州市吳*** | 國省代碼： | 江蘇;32 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 應(yīng)用于 集成電路 時序 控制電路 服務(wù)器 板卡 | ||
1.一種應(yīng)用于集成電路的時序控制電路，其特征在于，包括：N個VR，N-1個PNP型三極管以及N-2個或門，N≥3；
其中，N個VR的Vin分別連接Vin電源，N個VR的Vout分別與目標(biāo)集成電路的Pin相連，第i個VR的PG與第i+1個VR的EN相連，N-1個PNP型三極管的集電極均接地，N-2個或門的第一輸入端均與所述Vin電源相連，第j個或門的第二輸入端與第j+2個VR的PG相連，所述第j個或門的輸出端與第j個PNP型三極管的基極相連，所述第j個PNP型三極管的發(fā)射極與第j+1個VR的Vout相連，第N-1個PNP型三極管的基極與所述Vin電源相連，所述第N-1個PNP型三極管的發(fā)射極與第N個VR的Vout相連；1≤i≤N-1，1≤j≤N-2。
2.根據(jù)權(quán)利要求1所述的時序控制電路，其特征在于，N具體為3。
3.根據(jù)權(quán)利要求1所述的時序控制電路，其特征在于，還包括：分壓電路；
其中，所述分壓電路連接在所述Vin電源和所述第N-1個PNP型三極管的基極之間。
4.根據(jù)權(quán)利要求3所述的時序控制電路，其特征在于，所述分壓電路包括：第一電阻和第二電阻；
其中，所述第一電阻的第一端與所述Vin電源相連，所述第一電阻的第二端分別與所述第二電阻的第一端和所述第N-1個PNP型三極管的基極相連，所述第二電阻的第二端與所述第N-1個PNP型三極管的集電極相連。
5.根據(jù)權(quán)利要求1所述的時序控制電路，其特征在于，所述或門包括第一二極管和第二二極管；
其中，所述第一二極管的負(fù)極與所述第二二極管的負(fù)極相連；
相應(yīng)的，所述第一二極管的正極為所述或門的第一輸入端，所述第二二極管的正極為所述或門的第二輸入端，所述第一二極管的負(fù)極和所述第二二極管的負(fù)極共同構(gòu)成所述或門的輸出端。
6.根據(jù)權(quán)利要求1至5任一項所述的時序控制電路，其特征在于，還包括：延遲電路、NPN型三極管和上拉電阻；
其中，所述延遲電路的第一端與所述第N個VR的PG相連，所述延遲電路的第二端與所述NPN型三極管的基極相連，所述NPN型三極管的發(fā)射極接地，所述NPN型三極管的集電極分別與所述上拉電阻和第N-2個或門的第二輸入端相連。
7.根據(jù)權(quán)利要求6所述的時序控制電路，其特征在于，所述延遲電路包括：第三電阻和電容；
其中，所述第三電阻的第一端與所述第N個VR的PG相連，所述第三電阻的第二端分別與所述電容的第一端和所述NPN型三極管的基極相連，所述電容的第二端與所述NPN型三極管的發(fā)射極相連。
8.一種服務(wù)器板卡，其特征在于，包括如權(quán)利要求1至7任一項所述的一種應(yīng)用于集成電路的時序控制電路。
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