[發明專利]存儲器裝置及其操作方法有效
| 申請號: | 202010146931.8 | 申請日: | 2020-03-05 |
| 公開(公告)號: | CN113361679B | 公開(公告)日: | 2023-10-17 |
| 發明(設計)人: | 侯建杕;鄭吳全 | 申請(專利權)人: | 華邦電子股份有限公司 |
| 主分類號: | G06N3/0464 | 分類號: | G06N3/0464;G06F7/523 |
| 代理公司: | 北京同立鈞成知識產權代理有限公司 11205 | 代理人: | 朱穎;臧建明 |
| 地址: | 中國臺灣臺*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 存儲器 裝置 及其 操作方法 | ||
1.一種存儲器裝置,適用于人工智能運算,其特征在于,所述存儲器裝置包括:
模式配置寄存器,存儲權重矩陣信息以及基準地址;
系統存儲器陣列,自所述基準地址起依據所述權重矩陣信息安排特征地圖的多個特征值的存儲地址;
指針器,耦接所述模式配置寄存器以及所述系統存儲器陣列,接收并存儲所述基準地址以及權重矩陣大小,以提供指針信息;以及
運算電路,耦接所述模式配置寄存器以及所述指針器,依據所述指針信息依序或并行讀取所述特征值,
其中所述運算電路包括多個邏輯運算單元,所述運算電路依據所述權重矩陣信息,將選中權重矩陣中的多個權重系數以及對應的所述特征值并行地配置于對應的各所述邏輯運算單元中,并使所述多個邏輯運算單元平行地進行運算,以產生多個中間層特征值,并且所述運算電路輸出所述中間層特征值至處理單元。
2.根據權利要求1所述的存儲器裝置,其特征在于,各所述邏輯運算單元包括乘積累加單元、第一緩沖器、第二緩沖器以及第三緩沖器,所述運算電路依據所述權重矩陣信息將所述權重系數排列配置在所述第一緩沖器,將對應的所述特征值排列配置在所述第二緩沖器,以在所述第三緩沖器提供對應的所述中間層特征值。
3.根據權利要求1所述的存儲器裝置,其特征在于,所述模式配置寄存器更存儲在所述對應區域的卷積運算中所使用的所述特征值的步長設定,
所述指針器經配置而基于所述權重矩陣大小計算出數據長度,且所述指針器包括:
指針寄存器,接收并存儲所述基準地址;以及
數據長度寄存器,接收并存儲所述數據長度,
所述指針器依據當前所述指針寄存器中所存儲的所述基準地址、所述權重矩陣信息以及所述步長設定來更新所述指針寄存器中所存儲的所述基準地址,以提供更新后的所述指針信息,藉此依據所述步長設定于所述特征地圖中進行滑動。
4.根據權利要求1所述的存儲器裝置,其特征在于,所述存儲器裝置包括還包括:
向量陣列,耦接所述模式配置寄存器以及所述運算電路,存儲多個權重矩陣,
其中所述向量陣列依據所述權重矩陣信息自所述權重矩陣中選擇所述選中權重矩陣,以提供至所述運算電路。
5.根據權利要求1所述的存儲器裝置,其特征在于,所述運算電路還包括:
邏輯運算配置單元,依據所述權重矩陣信息,將所述邏輯運算單元分為多個組,以控制同一組的所述邏輯運算單元平行地進行運算,且控制不同組的所述邏輯運算單元依序地進行運算。
6.根據權利要求1所述的存儲器裝置,其特征在于,所述模式配置寄存器更存儲保留信息,
所述存儲器裝置還包括:
反饋控制單元,耦接所述模式配置寄存器、所述系統存儲器陣列以及所述運算電路,依據所述保留信息將所述中間層特征值存回至所述系統存儲器陣列,以作為新的特征值。
7.根據權利要求1所述的存儲器裝置,其特征在于,各所述邏輯運算單元包括算數邏輯單元、第一緩沖器、第二緩沖器以及第三緩沖器,所述運算電路依據所述權重矩陣信息將所述權重系數排列配置在所述第一緩沖器,將對應的所述特征值排列配置在所述第二緩沖器,以在所述第三緩沖器提供對應的所述中間層特征值。
8.根據權利要求1所述的存儲器裝置,其特征在于,各所述邏輯運算單元包括浮點運算器、第一緩沖器、第二緩沖器以及第三緩沖器,所述運算電路依據所述權重矩陣信息將所述權重系數排列配置在所述第一緩沖器,將對應的所述特征值排列配置在所述第二緩沖器,以在所述第三緩沖器提供對應的所述中間層特征值。
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