[發(fā)明專利]GOA電路及顯示面板有效
| 申請?zhí)枺?/td> | 202010128496.6 | 申請日： | 2020-02-28 |
| 公開（公告）號： | CN111199703B | 公開（公告）日： | 2021-07-06 |
| 發(fā)明（設(shè)計）人： | 薛炎 | 申請（專利權(quán)）人： | 深圳市華星光電半導體顯示技術(shù)有限公司 |
| 主分類號： | G09G3/20 | 分類號： | G09G3/20 |
| 代理公司： | 深圳紫藤知識產(chǎn)權(quán)代理有限公司 44570 | 代理人： | 張曉薇 |
| 地址： | 518132 廣東省深*** | 國省代碼： | 廣東;44 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | goa 電路 顯示 面板 | ||
本申請實施例提供的GOA電路及顯示面板，通過減少GOA電路中與第一節(jié)點電性連接的晶體管數(shù)量，從而減少第一節(jié)點的漏電路徑，同時該GOA電路能夠在空白時間內(nèi)對像素電路進行實時補償，進一步提高GOA電路的穩(wěn)定性。
技術(shù)領(lǐng)域
本申請涉及顯示技術(shù)領(lǐng)域，具體涉及一種GOA電路及顯示面板。
背景技術(shù)
陣列基板柵極驅(qū)動技術(shù)(Gate Driveron Array，簡稱GOA)，是將柵極驅(qū)動電路集成在顯示面板的陣列基板上，以實現(xiàn)逐行掃描的驅(qū)動方式，從而可以省掉柵極驅(qū)動電路部分，具有降低生產(chǎn)成本和實現(xiàn)面板窄邊框設(shè)計的優(yōu)點，為多種顯示器所使用。然而，現(xiàn)有的GOA電路電路復雜，自身允許的閾值偏差范圍范圍較小，穩(wěn)定性較差。
發(fā)明內(nèi)容
本申請實施例提供一種GOA電路及顯示面板，以解決現(xiàn)有技術(shù)中GOA電路穩(wěn)定性差的技術(shù)問題。
本申請?zhí)峁┮环NGOA電路，包括：
多級級傳的GOA單元，每一級GOA單元均包括：上拉控制模塊、上拉模塊、第一下拉模塊、第二下拉模塊、第一下拉維持模塊、第二下拉維持模塊、邏輯尋址模塊以及反相器模塊；
所述上拉控制模塊接入第N-2級級傳信號，并電性連接于第一節(jié)點和第四節(jié)點，用于在所述第N-2級級傳信號及所述第四節(jié)點的電位的控制下將所述第N-2級級傳信號輸出至所述第一節(jié)點；
所述上拉模塊接入第一時鐘信號、第二時鐘信號和第三時鐘信號，并電性連接于所述第一節(jié)點、第五節(jié)點、第六節(jié)點以及第七節(jié)點，用于在所述第一節(jié)點的電位控制下輸出本級級傳信號、本級第一掃描信號以及本級第二掃描信號；
所述第一下拉模塊接入第N+2級級傳信號和第一參考低電平信號，并電性連接于所述第一節(jié)點和所述第四節(jié)點，用于根據(jù)所述第N+2級級傳信號、所述第一參考低電平信號及所述第四節(jié)點的電位下拉所述第一節(jié)點的電位；
所述第二下拉模塊接入所述第N-2級級傳信號、重置信號以及第二參考低電平信號，并電性連接于第二節(jié)點以及第三節(jié)點，用于根據(jù)所述第N-2級級傳信號、所述重置信號、所述第二參考低電平信號以及所述第三節(jié)點的電位下拉所述第二節(jié)點的電位；
所述第一下拉維持模塊接入所述第一參考低電平信號，并電性連接于所述第一節(jié)點、所述第二節(jié)點及所述第四節(jié)點，用于在所述第一下拉模塊下拉所述第一節(jié)點的電位后，根據(jù)所述第一參考低電平信號、所述第二節(jié)點的電位及所述第四節(jié)點的電位維持所述第一節(jié)點的低電位；
所述第二下拉維持模塊接入所述第一參考低電平信號與第三參考低電平信號，并電性連接于所述第二節(jié)點、第五節(jié)點、第六節(jié)點以及第七節(jié)點，用于根據(jù)所述第一參考低電平信號、所述第三參考低電平信號以及所述第二節(jié)點的電位維持所述本級級傳信號、所述本級第一掃描信號以及所述本級第二掃描信號的低電位；
所述邏輯尋址模塊接入所述第N-2級級傳信號、參考高電平信號、所述第一參考低電平信號、所述重置信號、第一控制信號以及第二控制信號，并電性連接于所述第一節(jié)點和所述第二節(jié)點，用于在空白時間內(nèi)根據(jù)所述第N-2級級傳信號、所述參考高電平信號、所述重置信號、所述第一控制信號、所述第二控制信號以及所述第二節(jié)點的電位控制所述第一節(jié)點的電位；
所述反相器模塊接入所述第二參考低電平信號和所述參考高電平信號，并電性連接于所述第一節(jié)點及所述第二節(jié)點，用于將所述第二節(jié)點與所述第一節(jié)點的電位保持反相。
在本申請?zhí)峁┑腉OA電路中，所述上拉控制模塊包括：第十一晶體管和第十二晶體管；
所述第十一晶體管的柵極、所述第十一晶體管的源極以及所述第十二晶體管的柵極均接入所述第N-2級級傳信號，所述第十一晶體管的漏極與所述第十二晶體管的源極均電性連接于所述的第四節(jié)點，所述第十二晶體管的漏極電性連接于所述第一節(jié)點。
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