[發明專利]存儲系統在審
| 申請號: | 202010120705.2 | 申請日: | 2020-02-26 |
| 公開(公告)號: | CN112445731A | 公開(公告)日: | 2021-03-05 |
| 發明(設計)人: | 櫻井勢一郎;泉佑治 | 申請(專利權)人: | 鎧俠股份有限公司 |
| 主分類號: | G06F13/16 | 分類號: | G06F13/16;G11C7/10 |
| 代理公司: | 北京律盟知識產權代理有限責任公司 11287 | 代理人: | 張世俊 |
| 地址: | 日本*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 存儲系統 | ||
實施方式提供一種即使不進行狀態讀取也能掌握面單位或芯片單位的忙碌狀態的存儲系統。實施方式的存儲系統(1)具備存儲器控制器(10)、及電連接于存儲器控制器的非易失性存儲器(20)。非易失性存儲器包含:具有多個面(PL0)~(PL7)的存儲器芯片(CP1)。存儲器芯片(CP)包含:控制電路(23)、輸入輸出電路(22)。模式切換電路根據從存儲器控制器接收到第1指令而從第1模式切換到第2模式。輸入輸出電路在模式切換電路為第1模式時,經由第1總線從存儲器控制器接收指令,在所述模式切換電路為第2模式時,經由第1總線將表示多個面中的至少1個面為忙碌狀態的忙碌信息發送到存儲器控制器。
[相關申請]
本申請案享有以日本專利申請案2019-159542號(申請日:2019年9月2日)為基礎申請案的優先權。本申請案通過參照該基礎申請案而包含基礎申請案的全部內容。
技術領域
本發明的實施方式涉及一種存儲系統。
背景技術
在多個存儲器芯片中的一個存儲器芯片為忙碌狀態的情況下,存儲器控制器從存儲器芯片接收忙碌信號。存儲器控制器基于忙碌信號對多個存儲器芯片進行狀態讀取,而確認哪一存儲器芯片為忙碌狀態。
另外,存在1個存儲器芯片包含多個面(plane),以面為單位進行讀取的情況。存儲器控制器按面選擇指令指定出面進行狀態讀取,而確認各面是否為忙碌狀態。
發明內容
實施方式提供一種即使不進行狀態讀取也能掌握面單位或存儲器芯片單位的忙碌狀態的存儲系統。
實施方式的存儲系統具備存儲器控制器、及電連接于存儲器控制器的非易失性存儲器。非易失性存儲器包含:具有多個面的存儲器芯片。存儲器芯片包含:模式切換電路、輸入輸出電路。模式切換電路根據從存儲器控制器接收到第1指令而從第1模式切換到第2模式。輸入輸出電路在模式切換電路為第1模式時,經由第1總線從存儲器控制器接收指令,在模式切換電路為第2模式時,經由第1總線將表示多個面中的至少1個面為忙碌狀態的忙碌信息發送到存儲器控制器。
附圖說明
圖1是表示與主機連接的第1實施方式的存儲系統的構成的框圖。
圖2A是表示第1實施方式的存儲系統內的NAND(Not And,與非)存儲器的輸入輸出電路及控制電路等的構成的框圖。
圖2B是表示第1實施方式的存儲系統內的NAND存儲器的多個面的構成的框圖。
圖3是表示第1實施方式的存儲系統內的存儲器控制器與NAND存儲器的處理的流程圖。
圖4是第1實施方式的存儲系統的一般模式下的各信號的時序圖。
圖5是第1實施方式的存儲系統的切換到忙碌信息模式時的各信號的時序圖。
圖6是第1實施方式的存儲系統的將8比特忙碌信息附加到DQ(數據)信號時的各信號的時序圖。
圖7是表示與主機連接的第2實施方式的存儲系統的構成的框圖。
圖8A是表示第2實施方式的存儲系統內的NAND存儲器的輸入輸出電路及控制電路等的構成的框圖。
圖8B是表示第2實施方式的存儲系統內的NAND存儲器的多個面的構成的框圖。
圖9是表示第2實施方式的存儲系統內的存儲器控制器與NAND存儲器的處理的流程圖。
圖10是第2實施方式的存儲系統的一般模式下的各信號的時序圖。
圖11是在第2實施方式的存儲系統內的NAND存儲器中切換到忙碌信息模式時的各信號的時序圖。
具體實施方式
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