[發(fā)明專利]嵌入式通用串行總線2中繼器在審
| 申請(qǐng)?zhí)枺?/td> | 201980055643.7 | 申請(qǐng)日: | 2019-08-23 |
| 公開(公告)號(hào): | CN112840293A | 公開(公告)日: | 2021-05-25 |
| 發(fā)明(設(shè)計(jì))人: | W·N·貌;D·E·溫特;M·U·厄爾多甘;黃煥章;S·葛亞爾;B·莎爾瑪 | 申請(qǐng)(專利權(quán))人: | 德克薩斯儀器股份有限公司 |
| 主分類號(hào): | G06F3/00 | 分類號(hào): | G06F3/00;G06F13/42 |
| 代理公司: | 北京紀(jì)凱知識(shí)產(chǎn)權(quán)代理有限公司 11245 | 代理人: | 袁策 |
| 地址: | 美國德*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 嵌入式 通用 串行 總線 中繼 | ||
本說明書提供了一種電路(200),其包括:靜噪檢測器(225),其具有耦合到第一節(jié)點(diǎn)(260)并且被配置為用浮置中心抽頭接收差分信號(hào)的正分量的第一輸入端、耦合到第二節(jié)點(diǎn)(262)并被配置為接收差分信號(hào)的負(fù)分量的第二輸入端,以及耦合到邏輯電路(230)的輸出端;第一電阻器(235),其耦合在第一節(jié)點(diǎn)與第三節(jié)點(diǎn)(268)之間;第二電阻器(240),其耦合在第三節(jié)點(diǎn)和第二節(jié)點(diǎn)之間;第三電阻器(245),其耦合在第一節(jié)點(diǎn)和第四節(jié)點(diǎn)(270)之間;第四電阻器(250),其耦合在第四節(jié)點(diǎn)和第二節(jié)點(diǎn)之間;電容器(255),其耦合在第四節(jié)點(diǎn)和接地端子(272)之間;比較器(220),其具有耦合到第三節(jié)點(diǎn)的第一輸入端、耦合到第五節(jié)點(diǎn)(274)的第二輸入端以及耦合到邏輯電路的輸出端。
發(fā)明內(nèi)容
本說明書提供了一種電路。在一些示例中,該電路包括第一放大器、第二放大器、第三放大器、靜噪(squelch)檢測器、第一電阻器、第二電阻器、比較器和邏輯電路。第一放大器具有耦合到第一節(jié)點(diǎn)的第一輸入端、耦合到第二節(jié)點(diǎn)的第二輸入端、第一輸出端,以及第二輸出端。第二放大器具有耦合到第一放大器的第一輸出端的第一輸入端、耦合到第一放大器的第二輸出端的第二輸入端、第一輸出端,以及第二輸出端。第三放大器具有耦合到第二放大器的第一輸出端的第一輸入端、耦合到第二放大器的第二輸出端的第二輸入端、控制輸入端、耦合到第三節(jié)點(diǎn)的第一輸出端,以及耦合到第四節(jié)點(diǎn)的第二輸出端。靜噪檢測器具有耦合到第一節(jié)點(diǎn)的第一輸入端、耦合到第二節(jié)點(diǎn)的第二輸入端,以及輸出端。第一電阻器耦合在第一節(jié)點(diǎn)和第五節(jié)點(diǎn)之間。第二電阻器耦合在第五節(jié)點(diǎn)和第二節(jié)點(diǎn)之間。比較器具有耦合到第五節(jié)點(diǎn)的第一輸入端、耦合到第六節(jié)點(diǎn)的第二輸入端,以及輸出端。邏輯電路具有耦合到靜噪檢測器的輸出端的第一輸入端、耦合到比較器的輸出端的第二輸入端,以及耦合到第三放大器的控制輸入端的輸出端。
本說明書的其他方面提供了一種電路。在一些示例中,該電路包括靜噪檢測器、第一電阻器、第二電阻器、第三電阻器、第四電阻器、第一電容器、比較器和邏輯電路。靜噪檢測器具有耦合到第一節(jié)點(diǎn)的第一輸入端、耦合到第二節(jié)點(diǎn)的第二輸入端,以及輸出端,其中第一節(jié)點(diǎn)被配置為用浮置(floating)中心抽頭接收差分輸入信號(hào)的正分量,并且其中第二節(jié)點(diǎn)被配置為用浮置中心抽頭接收差分輸入信號(hào)的負(fù)分量。第一電阻器耦合在第一節(jié)點(diǎn)和第三節(jié)點(diǎn)之間。第二電阻器耦合在第三節(jié)點(diǎn)和第二節(jié)點(diǎn)之間。第三電阻器耦合在第一節(jié)點(diǎn)和第四節(jié)點(diǎn)之間。第四電阻器耦合在第四節(jié)點(diǎn)和第二節(jié)點(diǎn)之間。第一電容器耦合在第四節(jié)點(diǎn)和接地端子之間。比較器具有耦合到第三節(jié)點(diǎn)的第一輸入端、耦合到第五節(jié)點(diǎn)的第二輸入端,以及輸出端。邏輯電路具有耦合到靜噪檢測器的輸出端的第一輸入端、耦合到邏輯電路的輸出端的第二輸入端,以及輸出端。
本說明書的其他方面提供了一種方法。在一些示例中,該方法包括:在電路處經(jīng)由空閑的差分信號(hào)線接收數(shù)據(jù),對(duì)差分信號(hào)線執(zhí)行靜噪檢測,通過執(zhí)行比較對(duì)參考電壓(VREF)進(jìn)行參考確定共模電壓(Vcm)的值,以及用比較結(jié)果驗(yàn)證靜噪檢測的結(jié)果。
附圖說明
對(duì)于各種示例的詳細(xì)描述,現(xiàn)在將參考附圖,其中:
圖1示出了各種示例中的說明性系統(tǒng)的框圖;
圖2示出了各種示例中的說明性電路的示意圖;
圖3示出了各種示例中的說明性信號(hào)波形的圖示;并且
圖4示出了各種示例中的說明性方法的流程圖。
具體實(shí)施方式
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G06F 電數(shù)字?jǐn)?shù)據(jù)處理
G06F3-00 用于將所要處理的數(shù)據(jù)轉(zhuǎn)變成為計(jì)算機(jī)能夠處理的形式的輸入裝置;用于將數(shù)據(jù)從處理機(jī)傳送到輸出設(shè)備的輸出裝置,例如,接口裝置
G06F3-01 .用于用戶和計(jì)算機(jī)之間交互的輸入裝置或輸入和輸出組合裝置
G06F3-05 .在規(guī)定的時(shí)間間隔上,利用模擬量取樣的數(shù)字輸入
G06F3-06 .來自記錄載體的數(shù)字輸入,或者到記錄載體上去的數(shù)字輸出
G06F3-09 .到打字機(jī)上去的數(shù)字輸出
G06F3-12 .到打印裝置上去的數(shù)字輸出
- 內(nèi)部總線系統(tǒng)
- 一種應(yīng)用于實(shí)時(shí)數(shù)據(jù)處理的多級(jí)總線系統(tǒng)
- 協(xié)議轉(zhuǎn)換裝置
- 基于FPGA的PCI總線控制器及控制方法
- 總線監(jiān)控系統(tǒng)、方法及裝置
- 總線電路以及智能貨架系統(tǒng)
- 用于控制串行數(shù)據(jù)總線系統(tǒng)的方法及總線節(jié)點(diǎn)
- 用于在串行數(shù)據(jù)總線系統(tǒng)中分配地址的方法及總線節(jié)點(diǎn)
- 驗(yàn)證先前分配給總線節(jié)點(diǎn)的地址的正確性的方法
- 用于初始化差分雙線數(shù)據(jù)總線的方法及傳送數(shù)據(jù)的方法





