[發明專利]板卡芯片的數據訪存方法、裝置及計算機可讀存儲介質有效
| 申請號: | 201911367921.0 | 申請日: | 2019-12-26 |
| 公開(公告)號: | CN111026682B | 公開(公告)日: | 2022-03-08 |
| 發明(設計)人: | 尹云峰;任智新;金良 | 申請(專利權)人: | 浪潮(北京)電子信息產業有限公司 |
| 主分類號: | G06F12/123 | 分類號: | G06F12/123;G06F15/78 |
| 代理公司: | 北京集佳知識產權代理有限公司 11227 | 代理人: | 劉新雷 |
| 地址: | 100085 北京市海*** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 板卡 芯片 數據 方法 裝置 計算機 可讀 存儲 介質 | ||
本申請公開了一種板卡芯片的數據訪存方法、裝置及計算機可讀存儲介質。其中,方法應用于內置DDR和高帶寬存儲器的板卡芯片;板卡芯片執行方法如下:當接收到主機端下發的訪存數據請求,若判定待訪存數據存儲在DDR的目標數據塊,則更新高帶寬存儲器的各數據塊的被訪問頻率,并利用DDR中的目標數據塊及相鄰多個數據塊替換高帶寬存儲器中被訪問頻率低于預設頻率閾值的數據塊;若待訪存數據存儲在高帶寬存儲器,則在高帶寬存儲器中進行數據訪存,并更新各數據塊的被訪問頻率。本申請支持數據高并發隨機訪存,極大地降低了數據隨機訪存時間,提高了板卡芯片的數據訪存效率。
技術領域
本申請涉及數據讀取技術領域,特別是涉及一種板卡芯片的數據訪存方法、裝置及計算機可讀存儲介質。
背景技術
隨著板卡芯片的快速發展,例如FPGA板卡(Field-Programmable Gate Array,現場可編程門陣列)和GPU板卡(Graphics Processing Unit,圖形處理器),用戶對快速傳輸信息,也即帶寬的要求也在不斷提高。
相關板卡技術通常都是直接基于突發傳輸形式從DDR的數據塊中訪存數據,而由于DDR的位寬極為有限,能夠支持同時并發隨機訪存的次數很少,導致訪存數據的效率很低下。DDR(Double Data Rate,雙倍速率)已經漸漸不能滿足人們對帶寬的需要,技術發展也已進入了瓶頸期。每秒增加1GB的帶寬將會帶來更多的功耗,這不論對于設計人員還是消費者來說都不是一個明智、高效或合算的選擇。因此,DDR將會漸漸阻礙板卡芯片性能的持續增長。
鑒于此,如何提高板卡芯片的數據訪存效率,支持數據并發隨機訪存,是本領域技術人員需要解決的技術問題。
發明內容
本申請提供了一種板卡芯片的數據訪存方法、裝置及計算機可讀存儲介質,支持數據高并發隨機訪存,極大地降低了數據隨機訪存時間,提高了板卡芯片的數據訪存效率。
為解決上述技術問題,本發明實施例提供以下技術方案:
本發明實施例一方面提供了一種板卡芯片的數據訪存方法,適用于內置DDR和高帶寬存儲器的板卡芯片,包括:
當接收到主機端下發的訪存數據請求,判斷待訪存數據存儲在所述高帶寬存儲器還是所述DDR中;
若所述待訪存數據存儲在所述DDR的目標數據塊,則更新所述高帶寬存儲器的各數據塊的被訪問頻率,并利用所述DDR中的目標數據塊及相鄰多個數據塊替換所述高帶寬存儲器中被訪問頻率低于預設頻率閾值的數據塊;
若所述待訪存數據存儲在所述高帶寬存儲器,則在所述高帶寬存儲器中進行數據訪存,并更新各數據塊的被訪問頻率。
可選的,所述更新所述高帶寬存儲器的各數據塊的被訪問頻率,并利用所述DDR中的目標數據塊及相鄰多個數據塊替換所述高帶寬存儲器中被訪問頻率低于預設頻率閾值的數據塊包括:
將所述高帶寬存儲器中所有數據塊的未命中次數均加1,所述未命中次數用于表示數據塊被訪問頻率;
為所述高帶寬存儲器中未命中次數不低于預設次數閾值的數據塊設置待替換標簽;
利用所述DDR中的目標數據塊及后續多個連續數據塊依次替換設有所述待替換標簽的數據塊。
可選的,所述為所述高帶寬存儲器中未命中次數不低于預設次數閾值的數據塊設置待替換標簽包括:
預先設置多個次數閾值,各次數閾值對應不同優先級別的待替換標簽;
基于所述高帶寬存儲器的當前數據塊的未命中次數與各次數閾值之間的關系,為所述當前數據塊設置相應優先級別的待替換標簽;
相應的,所述利用所述DDR中的目標數據塊及后續多個連續數據塊依次替換設有所述待替換標簽的數據塊包括:
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