[發(fā)明專利]一種緩沖電路及晶振電路在審
| 申請(qǐng)?zhí)枺?/td> | 201911328045.0 | 申請(qǐng)日： | 2019-12-20 |
| 公開（公告）號(hào)： | CN111130534A | 公開（公告）日： | 2020-05-08 |
| 發(fā)明（設(shè)計(jì)）人： | 程龍;馬俠 | 申請(qǐng)（專利權(quán)）人： | 鉅泉光電科技（上海）股份有限公司 |
| 主分類號(hào)： | H03K19/0185 | 分類號(hào)： | H03K19/0185 |
| 代理公司： | 上海光華專利事務(wù)所(普通合伙) 31219 | 代理人： | 余明偉 |
| 地址： | 201210 上海市浦東新區(qū)中國(guó)(上*** | 國(guó)省代碼： | 上海;31 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 緩沖 電路 | ||
1.一種緩沖電路，其特征在于，所述緩沖電路包括：
差分放大單元，用于對(duì)晶振的輸入振蕩信號(hào)和輸出振蕩信號(hào)進(jìn)行差分放大以產(chǎn)生一組差分信號(hào)；
擺幅放大單元，連接于所述差分放大單元，用于對(duì)所述差分放大單元輸出的一組所述差分信號(hào)進(jìn)行擺幅放大以產(chǎn)生一滿擺幅信號(hào)；
輸出單元，連接于所述擺幅放大單元，用于對(duì)所述擺幅放大單元輸出的所述滿擺幅信號(hào)進(jìn)行反相以產(chǎn)生時(shí)鐘信號(hào)。
2.根據(jù)權(quán)利要求1所述的緩沖電路，其特征在于，所述差分放大單元包括：第一運(yùn)算放大器及第二運(yùn)算放大器，其中所述第一運(yùn)算放大器的正相輸入端接入所述輸出振蕩信號(hào)，所述第一運(yùn)算放大器的反相輸入端接入所述輸入振蕩信號(hào)，所述第一運(yùn)算放大器的輸出端作為所述差分放大單元的第一輸出端，所述第二運(yùn)算放大器的正相輸入端接入所述輸入振蕩信號(hào)，所述第二運(yùn)算放大器的反相輸入端接入所述輸出振蕩信號(hào)，所述第二運(yùn)算放大器的輸出端作為所述差分放大單元的第二輸出端。
3.根據(jù)權(quán)利要求1所述的緩沖電路，其特征在于，所述擺幅放大單元包括：一鎖存器，其中所述鎖存器的第一輸入端連接于所述差分放大單元的第一輸出端，所述鎖存器的第二輸入端連接于所述差分放大單元的第二輸出端，所述鎖存器的輸出端作為所述擺幅放大單元的輸出端。
4.根據(jù)權(quán)利要求1所述的緩沖電路，其特征在于，所述輸出單元包括：第一反相器及第二反相器，其中所述第一反相器的輸入端連接于所述擺幅放大單元的輸出端，所述第一反相器的輸出端連接于所述第二反相器的輸入端，所述第二反相器的輸出端作為所述輸出單元的輸出端。
5.一種晶振電路，其特征在于，所述晶振電路包括：
起振電路，用于產(chǎn)生振蕩信號(hào)；
如權(quán)利要求1至4任一項(xiàng)所述的緩沖電路，連接于所述起振電路，用于對(duì)所述起振電路產(chǎn)生的所述振蕩信號(hào)進(jìn)行波形整形以產(chǎn)生時(shí)鐘信號(hào)，同時(shí)對(duì)電源與地之間的噪聲及動(dòng)態(tài)ESD干擾進(jìn)行抑制。
6.根據(jù)權(quán)利要求5所述的晶振電路，其特征在于，所述起振電路包括：電流源、晶振、電阻、MOS管、第一電容及第二電容，其中所述電流源的一端接入電源電壓，所述電流源的另一端連接于所述晶振的一端、所述電阻的一端、所述MOS管的漏極端及所述第一電容的一端，所述晶振的另一端連接于所述電阻的另一端、所述MOS管的柵極端及所述第二電容的一端，所述第一電容的另一端、所述第二電容的另一端及所述MOS管的源極端接地。
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