[發(fā)明專利]一種基于FMC標(biāo)準(zhǔn)的高速接口自環(huán)測(cè)試裝置和測(cè)試方法在審
| 申請(qǐng)?zhí)枺?/td> | 201911178245.2 | 申請(qǐng)日： | 2019-11-27 |
| 公開(kāi)（公告）號(hào)： | CN110912623A | 公開(kāi)（公告）日： | 2020-03-24 |
| 發(fā)明（設(shè)計(jì)）人： | 沙晶晶 | 申請(qǐng)（專利權(quán)）人： | 江蘇信息職業(yè)技術(shù)學(xué)院 |
| 主分類號(hào)： | H04B17/00 | 分類號(hào)： | H04B17/00 |
| 代理公司： | 南京天翼專利代理有限責(zé)任公司 32112 | 代理人： | 朱戈勝 |
| 地址： | 214153 *** | 國(guó)省代碼： | 江蘇;32 |
| 權(quán)利要求書(shū)： | 查看更多 | 說(shuō)明書(shū)： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 基于 fmc 標(biāo)準(zhǔn) 高速 接口 測(cè)試 裝置 方法 | ||
1.一種基于FMC標(biāo)準(zhǔn)的高速接口自環(huán)測(cè)試裝置，其特征在于：包括第一FMC連接器(1)、撥碼開(kāi)關(guān)(2)、時(shí)鐘發(fā)生器(3)和電源模塊(4)；
撥碼開(kāi)關(guān)(2)一端連接于第一FMC連接器(1)的輸入接口(101b)，另一端連接于第一FMC連接器(1)的輸出接口(101a)，輸入接口(101b)和輸出接口(101a)構(gòu)成FMC接口(101)；撥碼開(kāi)關(guān)(2)用于控制第一FMC連接器(1)的同一條鏈路輸入與輸出之間的通斷從而進(jìn)行自環(huán)測(cè)試；
時(shí)鐘發(fā)生器(3)連接于第一FMC連接器(1)的時(shí)鐘信號(hào)端用于給第一FMC連接器(1)提供參考時(shí)鐘；
電源模塊(4)的輸入端連接于第一FMC連接器(1)的電源輸出端，電源模塊(4)輸出端連接于時(shí)鐘發(fā)生器(3)的電源端用于給時(shí)鐘發(fā)生器(3)提供工作電壓。
2.根據(jù)權(quán)利要求1所述的基于FMC標(biāo)準(zhǔn)的高速接口自環(huán)測(cè)試裝置，其特征在于：所述第一FMC連接器(1)所有鏈路的輸入接口(101b)與輸出接口(101a)之間均設(shè)有撥碼開(kāi)關(guān)(2)。
3.根據(jù)權(quán)利要求1所述的基于FMC標(biāo)準(zhǔn)的高速接口自環(huán)測(cè)試裝置，其特征在于：所述時(shí)鐘發(fā)生器(3)用于產(chǎn)生156.25MHz的參考時(shí)鐘。
4.根據(jù)權(quán)利要求1所述的基于FMC標(biāo)準(zhǔn)的高速接口自環(huán)測(cè)試裝置，其特征在于：所述電源模塊(4)用于將被測(cè)載板供給的12V電壓轉(zhuǎn)換為2.5V；電源模塊(4)采用NCP1575低電壓降壓型控制器進(jìn)行電壓轉(zhuǎn)換。
5.根據(jù)權(quán)利要求1所述的基于FMC標(biāo)準(zhǔn)的高速接口自環(huán)測(cè)試裝置，其特征在于：所述第一FMC連接器(1)采用的是HPC連接器。
6.一種基于FMC標(biāo)準(zhǔn)的高速接口自環(huán)測(cè)試方法，其特征在于，使用權(quán)利要求1至5任一項(xiàng)所述的基于FMC標(biāo)準(zhǔn)的高速接口自環(huán)測(cè)試裝置，所述測(cè)試方法步驟包括：
S1：將自環(huán)測(cè)試裝置與被測(cè)載板連接；
S2：被測(cè)載板上電運(yùn)行；
S3：被測(cè)載板上FPGA(5)是否接收到自環(huán)測(cè)試裝置發(fā)送的參考時(shí)鐘，接收到參考時(shí)鐘時(shí)執(zhí)行步驟S4；
S4：將撥碼開(kāi)關(guān)(2)撥至連接端，鏈路接通；
S5：被測(cè)載板上FPGA(5)向各發(fā)送接口(501a)同時(shí)發(fā)送測(cè)試數(shù)據(jù)，被測(cè)載板上FPGA(5)從各接收接口(501b)接收測(cè)試數(shù)據(jù)，并校驗(yàn)接收數(shù)據(jù)是否與發(fā)送數(shù)據(jù)一致；
S6：將撥碼開(kāi)關(guān)(2)撥至斷開(kāi)一端，鏈路斷開(kāi)；
S7：被測(cè)載板上FPGA(5)向各發(fā)送接口(501a)同時(shí)發(fā)送測(cè)試數(shù)據(jù)，被測(cè)載板上FPGA(5)從各接收接口(501b)同時(shí)接收測(cè)試數(shù)據(jù)，并檢驗(yàn)是否能夠接收到數(shù)據(jù)；
S8：對(duì)比S5和S7的測(cè)試結(jié)果，若S5步驟中接收數(shù)據(jù)與發(fā)送數(shù)據(jù)一致且S7步驟中無(wú)法接收到數(shù)據(jù)，則判斷該載板接口(501)正常；否則，判斷該載板接口(501)有故障。
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