[發(fā)明專利]帶內波動抑制裝置和射頻系統

有效

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• 申請日: 2019-11-04
• 公開（公告）號: CN110995293B
• 公開（公告）日: 2022-06-07
• 發(fā)明（設計）人: 馬超;金淮東;李華鴻
• 申請（專利權）人: 三維通信股份有限公司
• 主分類號: H04B1/04
• 分類號: H04B1/04;H04B1/10;H04B1/12;H04B7/155
• 代理公司: 杭州華進聯浙知識產權代理有限公司 33250
• 代理人: 單長芳

本發(fā)明提供了一種帶內波動抑制裝置和射頻系統。其中，該帶內波動抑制裝置包括：阻抗調節(jié)模塊、聲表面波濾波器模塊，阻抗調節(jié)模塊耦合至聲表面波濾波器模塊；其中，阻抗調節(jié)模塊用于調節(jié)應用電路的阻抗，以使得聲表面波濾波器模塊的頻率響應特性與應用電路在工作頻率范圍內的帶內波動的響應特性相反。通過本發(fā)明，解決了相關技術中因采用FPGA抑制帶內波動而對FPGA的運算頻率要求高的問題，避免了帶內波動抑制裝置對FPGA的運算頻率的依賴。

技術領域

本發(fā)明涉及通信領域，特別是涉及一種帶內波動抑制裝置和射頻系統。

背景技術

直放站是一種基站射頻拉遠設備。直放站由天線、射頻雙工器、低噪聲放大器、混頻器、電調衰減器、濾波器、功率放大器等元器件或模塊組成，包括上、下行兩種鏈路。直放站工作的基本原理是：用前向天線將基站的下行信號接收進直放機，通過低噪放大器將有用信號放大，抑制信號中的噪聲信號，提高信噪比；再經下變頻至中頻信號，經濾波器濾波，中頻放大，再移頻上變頻至射頻，經功率放大器放大，由后向天線發(fā)射到移動臺；同時利用后向天線接收移動臺上行信號，沿相反的路徑由上行鏈路進行與下行鏈路相同的處理：即經過低噪放大器、下變頻器、濾波器、中放、上變頻器、功率放大器再發(fā)射到基站，從而達到基站與移動臺的雙向通信。

直放站或者其他的射頻拉遠設備的射頻系統中，由于射頻系統中模擬器件的搭配、數字信號干擾等會導致射頻系統的工作頻率范圍內最大電平和最小電平存在差值，即帶內波動。例如，雙工器、濾波器在通帶內頻率響應的不平坦就會導致帶內波動。

直放站或者其他的射頻拉遠設備中通常要求帶內波動不大于3dB。在相關技術中通常采用現場可編程門陣列(Field Programmable Gate Array，簡稱FPGA)來抑制帶內波動。例如，采用FPGA實現一個有限長單位沖激響應濾波器(Finite Impulse Response，簡稱FIR)后，通過在直放站的模數轉換器(Analog-to-Digital Converter，簡稱ADC)后的數字中頻信號加入FIR濾波器來補償射頻系統的帶內波動。FIR濾波器抑制射頻系統的帶內波動的原理是根據原始的數字中頻信號生成與帶內波動的頻率響應相反的反饋信號，并利用反饋信號對數字中頻信號進行補償，以抵消帶內波動。然而，采用上述方式抑制帶內波動不僅會導致FPGA資源被占用，還對FPGA的運算頻率有比較高的要求。

發(fā)明內容

基于此，本發(fā)明提供一種帶內波動抑制裝置和射頻系統，用以解決相關技術中因采用FPGA抑制帶內波動而對FPGA的運算頻率要求高的問題。

第一方面，本發(fā)明提供一種帶內波動抑制裝置，所述帶內波動抑制裝置包括：阻抗調節(jié)模塊、聲表面波濾波器模塊，所述阻抗調節(jié)模塊耦合至所述聲表面波濾波器模塊，其中，所述阻抗調節(jié)模塊用于調節(jié)應用電路的阻抗，以使得所述聲表面波濾波器模塊的頻率響應特性與所述應用電路在工作頻率范圍內的帶內波動的響應特性相反。

在一種可能的實現方式中，所述阻抗調節(jié)模塊耦合至所述聲表面波濾波器模塊的輸入端和/或輸出端。

在一種可能的實現方式中，所述阻抗調節(jié)模塊包括：第一阻抗調節(jié)模塊和第二阻抗調節(jié)模塊，其中，所述第一阻抗調節(jié)模塊耦合至所述聲表面波濾波器模塊的輸入端，所述第二阻抗調節(jié)模塊耦合至所述聲表面波濾波器模塊的輸出端。

在一種可能的實現方式中，所述第一阻抗調節(jié)模塊和所述第二阻抗調節(jié)模塊具有相同的電路拓撲結構。

在一種可能的實現方式中，所述第一阻抗調節(jié)模塊和所述第二阻抗調節(jié)模塊具有不同的電路拓撲結構。

在一種可能的實現方式中，所述阻抗調節(jié)模塊包括：所述阻抗調節(jié)模塊包括：一個或者多個阻抗調節(jié)子電路；所述多個阻抗調節(jié)子電路之間的連接方式為串聯和/或并聯。

在一種可能的實現方式中，所述阻抗調節(jié)子電路包括以下至少之一：L型阻抗調節(jié)子電路、T型阻抗調節(jié)子電路、π型阻抗調節(jié)子電路。