[發明專利]一種I2S通信的實現方法和裝置在審
| 申請號： | 201911030449.1 | 申請日： | 2019-10-28 |
| 公開（公告）號： | CN112799993A | 公開（公告）日： | 2021-05-14 |
| 發明（設計）人： | 吳剛;王智芳;蔣秀鋒;馮肄禹 | 申請（專利權）人： | 成都鼎橋通信技術有限公司 |
| 主分類號： | G06F13/42 | 分類號： | G06F13/42 |
| 代理公司： | 北京德琦知識產權代理有限公司 11018 | 代理人： | 孫清然;王琦 |
| 地址： | 610041 四川省成都市高新*** | 國省代碼： | 四川;51 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 i2s 通信 實現 方法 裝置 | ||
1.一種I2S通信的實現方法，其特征在于，包括：
a、進行處理器的串行外設接口SPI和通用輸入與輸出GPIO的初始化，其中，在所述GPIO的初始化中配置用于模擬LRCK端口的引腳；
b、從待傳輸音頻數據中，取出預設長度的數據，按位依次填充至所述發送緩存區進行發送，觸發SPI的發送中斷；
c、在所述SPI的發送中斷中，對所述用于模擬LRCK端口的引腳進行電平翻轉，并且，如果所述待傳輸音頻數據中存在未發送的數據，則從所述未發送的數據中取出所述長度的數據，按位依次填充至所述發送緩存區進行發送，再次觸發SPI的發送中斷之后，重復執行步驟c。
2.如權利要求1所述的方法，其特征在于：所述發送緩存區為一個先進先出FIFO隊列。
3.如權利要求1所述的方法，其特征在于：所述處理器為微控制器MCU芯片或者片上系統SOC芯片。
4.一種I2S通信的實現裝置，其特征在于，包括：處理器，所述處理器用于：
a、進行處理器的串行外設接口SPI和通用輸入與輸出GPIO的初始化，其中，在所述GPIO的初始化中配置用于模擬LRCK端口的引腳；
b、從待傳輸音頻數據中，取出預設長度的數據，按位依次填充至所述發送緩存區進行發送，觸發SPI的發送中斷；
c、在所述SPI的發送中斷中，對所述用于模擬LRCK端口的引腳進行電平翻轉，并且，如果所述待傳輸音頻數據中存在未發送的數據，則從所述未發送的數據中取出所述長度的數據，按位依次填充至所述發送緩存區進行發送，再次觸發SPI的發送中斷之后，重復執行步驟c。
5.如權利要求4所述的裝置，其特征在于：所述發送緩存區為一個先進先出FIFO隊列。
6.如權利要求4所述的裝置，其特征在于：所述處理器為微控制器MCU芯片和片上系統SOC芯片。
7.一種非易失性計算機可讀存儲介質，所述非易失性計算機可讀存儲介質存儲指令，其特征在于，所述指令在由處理器執行時使得所述處理器執行如權利要求1至3中任一項所述的I2S通信的實現方法的步驟。
8.一種電子設備，其特征在于，包括如權利要求7所述的非易失性計算機可讀存儲介質、以及可訪問所述非易失性計算機可讀存儲介質的所述處理器。
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