[發明專利]5G NR標準的LDPC編碼的實現方法和裝置在審
| 申請號： | 201910979059.2 | 申請日： | 2019-10-15 |
| 公開（公告）號： | CN112671504A | 公開（公告）日： | 2021-04-16 |
| 發明（設計）人： | 陶雄強;胡嘉欣;張永旸;閆麗新;滿小明 | 申請（專利權）人： | 普天信息技術有限公司 |
| 主分類號： | H04L1/00 | 分類號： | H04L1/00;H03M13/11 |
| 代理公司： | 北京路浩知識產權代理有限公司 11002 | 代理人： | 王文思 |
| 地址： | 100080 北京*** | 國省代碼： | 北京;11 |
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| 摘要： | |||
| 搜索關鍵詞： | nr 標準 ldpc 編碼 實現 方法 裝置 | ||
本發明實施例提供一種5G NR標準的LDPC編碼的實現方法和裝置。所述方法包括：獲取LDPC編碼的校驗矩陣H；對所述校驗矩陣H按照指定尺寸進行分解，得到分解后的校驗矩陣；根據分解后的校驗矩陣對校驗公式進行分解；根據分解后的校驗公式求解校驗比特w，并根據所述校驗比特w進行LDPC編碼。本發明實施例能夠降低矩陣處理所需的處理量，使得5G NR標準的LDPC編碼的實現可以有更低的資源消耗及更低的處理時延。
技術領域
本發明涉及通信技術領域，尤其涉及一種5G NR標準的LDPC編碼的實現方法和裝置。
背景技術
LDPC((Low Density Parity Check，低密度奇偶校驗碼)碼是一種具有稀疏校驗矩陣的分組糾錯碼。幾乎適用于所有的信道，因此成為編碼界近年來的研究熱點。它的性能逼近香農限，且描述和實現簡單，易于進行理論分析和研究，譯碼簡單且可實行并行操作，適合硬件實現。該編碼方式目前已經被5G NR標準采用，用于業務信道編碼。
目前5G NR標準中的LDPC編碼需要生成校驗比特w，使其滿足其中c為需要編碼的比特，H為校驗矩陣。H矩陣組成時，先生成基矩陣HBG，HBG為46×68或者42×52維矩陣，之后用Zc×Zc的矩陣替換HBG中的每個元素獲得，其中Zc×Zc的最大維數可以達到384×384，也就是校驗矩陣H的最大維數可以達到16128×19968維。雖然其使用的是稀疏校驗矩陣，可以在處理上做一些優化，但也對處理器的計算提出了較高的挑戰，很多場景處理器需要借助外部加速器才能實現如此大量的運算。
發明內容
針對現有技術問題，本發明實施例提供一種5G NR標準的LDPC編碼的實現方法和裝置。
本發明實施例提供一種5G NR標準的LDPC編碼的實現方法，所述方法包括：
獲取LDPC編碼的校驗矩陣H；
對所述校驗矩陣H按照指定尺寸進行分解，得到分解后的校驗矩陣；
根據分解后的校驗矩陣對校驗公式進行分解，所述校驗公式為其中，c為需要編碼的比特，w為校驗比特；
根據分解后的校驗公式求解校驗比特w，并根據所述校驗比特w進行LDPC編碼。
本發明實施例提供一種5G NR標準的LDPC編碼的實現裝置，所述裝置包括：
獲取單元，用于獲取LDPC編碼的校驗矩陣H；
第一分解單元，用于對所述校驗矩陣H按照指定尺寸進行分解，得到分解后的校驗矩陣；
第二分解單元，用于根據分解后的校驗矩陣對校驗公式進行分解，所述校驗公式為其中，c為需要編碼的比特，w為校驗比特；
處理單元，用于根據分解后的校驗公式求解校驗比特w，并根據所述校驗比特w進行LDPC編碼。
本發明實施例還提供一種電子設備，包括存儲器、處理器以及存儲在存儲器上并可在處理器上運行的計算機程序，所述處理器執行所述程序時實現上述5G NR標準的LDPC編碼的實現方法。
本發明實施例還提供一種非暫態計算機可讀存儲介質，其上存儲有計算機程序，所述程序被處理器執行時實現上述5G NR標準的LDPC編碼的實現方法。
本發明實施例提供的5G NR標準的LDPC編碼的實現方法和裝置，通過將校驗矩陣進行分解，并將校驗公式進行分解，根據分解后的校驗公式將w的及計算拆解為了兩步計算w1和w2，能夠降低矩陣處理所需的處理量，使得5G NR標準的LDPC編碼的實現可以有更低的資源消耗及更低的處理時延。
附圖說明
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