[發(fā)明專利]在FPGA上實(shí)現(xiàn)高效合約調(diào)用的方法及裝置有效
| 申請(qǐng)?zhí)枺?/td> | 201910913458.9 | 申請(qǐng)日: | 2019-09-25 |
| 公開(公告)號(hào): | CN110688341B | 公開(公告)日: | 2021-01-29 |
| 發(fā)明(設(shè)計(jì))人: | 潘國(guó)振;魏長(zhǎng)征;閆鶯 | 申請(qǐng)(專利權(quán))人: | 支付寶(杭州)信息技術(shù)有限公司 |
| 主分類號(hào): | G06F15/78 | 分類號(hào): | G06F15/78;G06F21/53;G06F21/71;G06F21/62;G06F21/60 |
| 代理公司: | 北京博思佳知識(shí)產(chǎn)權(quán)代理有限公司 11415 | 代理人: | 李威 |
| 地址: | 310000 浙江省杭州市*** | 國(guó)省代碼: | 浙江;33 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | fpga 實(shí)現(xiàn) 高效 合約 調(diào)用 方法 裝置 | ||
1.一種在FPGA上實(shí)現(xiàn)高效合約調(diào)用的方法,包括:
FPGA結(jié)構(gòu)向自身包含的FPGA芯片加載已部署的電路邏輯配置文件,以在所述FPGA芯片上分別形成片上處理器和片上緩存;其中,所述FPGA結(jié)構(gòu)還包含與所述FPGA芯片相連的外部存儲(chǔ);
所述FPGA結(jié)構(gòu)確定所屬區(qū)塊鏈節(jié)點(diǎn)接收到的交易調(diào)用的智能合約;
所述FPGA結(jié)構(gòu)從所述片上緩存讀取所述智能合約的代碼程序以供所述片上處理器運(yùn)行,所述代碼程序由所述FPGA結(jié)構(gòu)從所述外部存儲(chǔ)獲取并緩存至所述片上緩存;
所述FPGA結(jié)構(gòu)確定所述片上處理器需要從所述代碼程序中讀取的操作指令;
所述FPGA結(jié)構(gòu)在所述片上緩存中不存在所述操作指令的情況下,從所述外部存儲(chǔ)獲取所述操作指令并緩存至所述片上緩存,以進(jìn)一步提供至所述片上處理器。
2.根據(jù)權(quán)利要求1所述的方法,所述FPGA結(jié)構(gòu)從所述外部存儲(chǔ)獲取所述操作指令并緩存至所述片上緩存,包括:
所述FPGA結(jié)構(gòu)從所述外部存儲(chǔ)獲取包含所述操作指令的代碼程序段,并緩存至所述片上緩存。
3.根據(jù)權(quán)利要求2所述的方法,所述FPGA結(jié)構(gòu)從所述外部存儲(chǔ)獲取包含所述操作指令的代碼程序段,包括:
所述FPGA結(jié)構(gòu)確定所述操作指令在所述外部存儲(chǔ)中的起始存儲(chǔ)地址;
所述FPGA結(jié)構(gòu)從所述外部存儲(chǔ)獲取包含所述起始存儲(chǔ)地址的預(yù)設(shè)地址段,所述代碼程序段位于所述預(yù)設(shè)地址段。
4.根據(jù)權(quán)利要求3所述的方法,所述預(yù)設(shè)地址段包括所述起始存儲(chǔ)地址和位于所述起始存儲(chǔ)地址之后的地址。
5.根據(jù)權(quán)利要求3所述的方法,所述預(yù)設(shè)地址段的長(zhǎng)度為所述片上緩存中的單個(gè)緩存塊的緩存長(zhǎng)度。
6.根據(jù)權(quán)利要求2所述的方法,所述FPGA結(jié)構(gòu)從所述外部存儲(chǔ)獲取所述操作指令并緩存至所述片上緩存,還包括:
所述FPGA結(jié)構(gòu)在所述片上緩存內(nèi)的所述代碼程序段的已讀取比例達(dá)到預(yù)設(shè)比例的情況下,從所述外部存儲(chǔ)預(yù)獲取所述代碼程序段之后的其他代碼程序段,并緩存至所述片上緩存。
7.根據(jù)權(quán)利要求1所述的方法,所述代碼程序被加密后存儲(chǔ)于所述外部存儲(chǔ)中;所述方法還包括:
所述FPGA結(jié)構(gòu)通過(guò)所述FPGA芯片上的解密模塊對(duì)所述代碼程序進(jìn)行解密,以將解密后的代碼程序緩存至所述片上緩存;
其中,所述解密模塊由所述FPGA芯片加載所述已部署的電路邏輯配置文件而形成。
8.根據(jù)權(quán)利要求1所述的方法,還包括:
所述FPGA結(jié)構(gòu)通過(guò)所述FPGA芯片上的預(yù)處理模塊對(duì)所述代碼程序進(jìn)行預(yù)處理,以將預(yù)處理后的代碼程序緩存至所述片上緩存;
其中,所述預(yù)處理模塊由所述FPGA芯片加載所述已部署的電路邏輯配置文件而形成。
9.根據(jù)權(quán)利要求8所述的方法,所述預(yù)處理包括以下至少之一:將代碼程序所含的各個(gè)字段解析并轉(zhuǎn)換為預(yù)設(shè)數(shù)據(jù)結(jié)構(gòu);調(diào)整所述代碼程序中的跳轉(zhuǎn)指令的偏移量。
10.根據(jù)權(quán)利要求1所述的方法,所述片上緩存中包含若干緩存塊;其中,包含智能合約中首條操作指令的緩存塊對(duì)應(yīng)于相對(duì)更大的權(quán)重,以使其在所述片上緩存中的存留時(shí)長(zhǎng)相對(duì)更長(zhǎng)。
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