[發(fā)明專利]一種芯片驅(qū)動EQ值最優(yōu)值確定方法及裝置有效
| 申請?zhí)枺?/td> | 201910566868.0 | 申請日: | 2019-06-27 |
| 公開(公告)號: | CN110377971B | 公開(公告)日: | 2022-07-08 |
| 發(fā)明(設(shè)計)人: | 武寧 | 申請(專利權(quán))人: | 蘇州浪潮智能科技有限公司 |
| 主分類號: | G06F30/398 | 分類號: | G06F30/398;G06F115/12 |
| 代理公司: | 濟(jì)南誠智商標(biāo)專利事務(wù)所有限公司 37105 | 代理人: | 王汝銀 |
| 地址: | 215100 江蘇省蘇州市吳*** | 國省代碼: | 江蘇;32 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 芯片 驅(qū)動 eq 最優(yōu) 確定 方法 裝置 | ||
1.一種芯片驅(qū)動EQ值最優(yōu)值確定方法,其特征是,包括以下步驟:
結(jié)合目標(biāo)阻抗典型組合對鏈路進(jìn)行芯片EQ數(shù)值掃描;
所述EQ數(shù)值為芯片模型中調(diào)制信號發(fā)送能量的EQ值;
所述結(jié)合目標(biāo)阻抗典型組合對鏈路進(jìn)行芯片EQ數(shù)值掃描,具體包括:
確定目標(biāo)阻抗管控的上下限指標(biāo),確定阻抗上限值、阻抗下限值和目標(biāo)阻抗典型通道組合方式;
使用芯片全部EQ數(shù)值對典型通道組合進(jìn)行模擬仿真;
所述確定阻抗上限值、阻抗下限值和目標(biāo)阻抗典型通道組合方式,具體包括:
PCB阻抗在設(shè)計時,定義出目標(biāo)阻抗管控的上下限指標(biāo),即阻抗上限值、阻抗下限值,利用統(tǒng)計分析的方式,對阻抗上限值、阻抗下限值和目標(biāo)阻抗值進(jìn)行排列組合,建立5種阻抗值不同的排列組合方式,分別為全部目標(biāo)阻抗值組合、全部阻抗上限值組合、全部阻抗下限值組合、阻抗上限值-阻抗下限值-阻抗上限值-阻抗下限值組合、阻抗下限值-阻抗上限值-阻抗下限值-阻抗上限值組合五種通道組合方式;
所述使用芯片全部EQ數(shù)值對典型通道組合進(jìn)行模擬仿真,具體包括:
獲取芯片全部EQ數(shù)值,利用每一組EQ數(shù)值分別對五種通道組合方式進(jìn)行通道仿真模擬;
獲取全部EQ數(shù)值掃描結(jié)果,輸出模擬眼圖結(jié)果最高幅值點(diǎn)下對應(yīng)的EQ數(shù)值為最優(yōu)值;
所述獲取全部EQ數(shù)值掃描結(jié)果,輸出模擬眼圖結(jié)果最高幅值點(diǎn)下對應(yīng)的EQ數(shù)值為最優(yōu)值,具體包括:
輸出全部模擬眼圖結(jié)果數(shù)值和其對應(yīng)的EQ數(shù)值組合,生成EQ數(shù)值對應(yīng)眼圖幅值變化示意圖;
選擇EQ數(shù)值對應(yīng)五種通道組合仿真的眼圖結(jié)果相加平均后,均值最大對應(yīng)的一組EQ數(shù)值為相對最佳選擇值。
2.如權(quán)利要求1所述的芯片驅(qū)動EQ值最優(yōu)值確定方法,其特征是,所述生成EQ數(shù)值對應(yīng)眼圖幅值變化示意圖,具體包括:
利用JMP統(tǒng)計分析軟件進(jìn)行歸納整理后生成EQ數(shù)值對應(yīng)眼圖幅值變化示意圖。
3.一種芯片驅(qū)動EQ值最優(yōu)值確定裝置,其特征是,包括:
芯片EQ掃描模塊,結(jié)合目標(biāo)阻抗典型組合對鏈路進(jìn)行芯片EQ數(shù)值掃描;
所述EQ數(shù)值為芯片模型中調(diào)制信號發(fā)送能量的EQ值;
所述結(jié)合目標(biāo)阻抗典型組合對鏈路進(jìn)行芯片EQ數(shù)值掃描,具體包括:
確定目標(biāo)阻抗管控的上下限指標(biāo),確定阻抗上限值、阻抗下限值和目標(biāo)阻抗典型通道組合方式;
使用芯片全部EQ數(shù)值對典型通道組合進(jìn)行模擬仿真;
所述確定阻抗上限值、阻抗下限值和目標(biāo)阻抗典型通道組合方式,具體包括:
PCB阻抗在設(shè)計時,定義出目標(biāo)阻抗管控的上下限指標(biāo),即阻抗上限值、阻抗下限值,利用統(tǒng)計分析的方式,對阻抗上限值、阻抗下限值和目標(biāo)阻抗值進(jìn)行排列組合,建立5種阻抗值不同的排列組合方式,分別為全部目標(biāo)阻抗值組合、全部阻抗上限值組合、全部阻抗下限值組合、阻抗上限值-阻抗下限值-阻抗上限值-阻抗下限值組合、阻抗下限值-阻抗上限值-阻抗下限值-阻抗上限值組合五種通道組合方式;
所述使用芯片全部EQ數(shù)值對典型通道組合進(jìn)行模擬仿真,具體包括:
獲取芯片全部EQ數(shù)值,利用每一組EQ數(shù)值分別對五種通道組合方式進(jìn)行通道仿真模擬;
EQ最優(yōu)值確定模塊,獲取全部EQ數(shù)值掃描結(jié)果,輸出模擬眼圖結(jié)果最高幅值點(diǎn)下對應(yīng)的EQ數(shù)值為最優(yōu)值;
所述獲取全部EQ數(shù)值掃描結(jié)果,輸出模擬眼圖結(jié)果最高幅值點(diǎn)下對應(yīng)的EQ數(shù)值為最優(yōu)值,具體包括:
輸出全部模擬眼圖結(jié)果數(shù)值和其對應(yīng)的EQ數(shù)值組合,生成EQ數(shù)值對應(yīng)眼圖幅值變化示意圖;
選擇EQ數(shù)值對應(yīng)五種通道組合仿真的眼圖結(jié)果相加平均后,均值最大對應(yīng)的一組EQ數(shù)值為相對最佳選擇值。
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