[發明專利]數據儲存裝置、存儲器控制電路與其監測方法有效
| 申請號: | 201910332136.5 | 申請日: | 2019-04-24 |
| 公開(公告)號: | CN110047550B | 公開(公告)日: | 2021-10-15 |
| 發明(設計)人: | 吳若華;陳政宇 | 申請(專利權)人: | 合肥沛睿微電子股份有限公司 |
| 主分類號: | G11C29/08 | 分類號: | G11C29/08;G06F13/16 |
| 代理公司: | 北京國昊天誠知識產權代理有限公司 11315 | 代理人: | 南霆;程爽 |
| 地址: | 230012 安徽省合肥市新站區文*** | 國省代碼: | 安徽;34 |
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| 摘要: | |||
| 搜索關鍵詞: | 數據 儲存 裝置 存儲器 控制電路 與其 監測 方法 | ||
1.一種數據儲存裝置,其特征在于,耦接至少一個數據儲存區塊,所述數據儲存裝置包含:
連接接口,所述連接接口包括有多個數據接腳以及多個電源接腳,其中,所述數據儲存裝置通過所述多個電源接腳來接收電源,所述數據儲存裝置通過所述多個數據接腳耦接主機,所述數據儲存裝置通過所述多個電源接腳的至少一個接腳耦接外部裝置,所述連接接口符合通信接口的電氣特性規范;
電力線通信電路,耦接所述連接接口的所述多個電源接腳的至少一個接腳,通過所述連接接口的所述多個電源接腳的至少一個接腳來擷取所述外部裝置通過電源總線所發送的已編碼信號,并解碼所述已編碼信號以產生已解碼信號,以及對響應信號進行載波操作,以將所述響應信號載波至所述電源總線上,使得所述外部裝置通過所述電源總線接收所述響應信號,其中,所述已編碼信號代表關聯于監測程序的至少一個指令;
儲存控制電路,耦接至所述連接接口以及所述電力線通信電路,用以通過所述連接接口來接收來自所述主機的至少一個命令,并依據所述至少一個命令來存取所述至少一個數據儲存區塊,以及根據所述外部裝置所輸出的所述已解碼信號,以產生所述響應信號,其中,所述響應信號包括有所述至少一個數據儲存區塊的一狀態。
2.如權利要求1所述的數據儲存裝置,其特征在于,依據所述響應信號以偵錯所述至少一個數據儲存區塊被偵錯。
3.如權利要求2所述的數據儲存裝置,其特征在于,所述響應信號包括有所述至少一個數據儲存區塊的一地址。
4.如權利要求1所述的數據儲存裝置,其特征在于,所述電力線通信電路包括有:
接口電路,耦接所述儲存控制電路;
收發器,耦接所述多個電源接腳的所述至少一個接腳;
載波電路,耦接于所述收發器與所述接口電路之間,通過所述接口電路接收所述響應信號,并對所述響應信號進行載波操作;以及
濾波解碼電路,耦接于所述收發器與所述接口電路之間,通過所述多個電源接腳的所述至少一個接腳來接收所述已編碼信號,并對所述已編碼信號進行濾波操作以及解碼操作。
5.如權利要求4所述的數據儲存裝置,其特征在于,所述濾波解碼電路是用來濾除所述電源上的直流(DC)成分來擷取出所述已編碼信號。
6.如權利要求5所述的數據儲存裝置,其特征在于,所述連接接口是符合下列通信接口規范的其特征在于一種:序列先進技術附件(SATA)接口規范,整合設備電子(IDE)接口規范、快捷外設互聯標準(PCIE)接口規范、以及通用序列總線(USB.3x)接口規范。
7.如權利要求4所述的數據儲存裝置,其特征在于,所述載波電路包括有:
增益控制電路,用來調整關聯所述載波操作的增益以調變所述響應信號。
8.如權利要求7所述的數據儲存裝置,其特征在于,所述載波電路包括有:
電平偵測電路,用來偵測所述多個電源接腳的所述至少一個接腳的電位來產生偵測電位,并依據所述偵測電位來控制所述增益控制電路,以使得所述連接接口中的所述多個電源接腳的電氣特性符合通信接口規范。
9.如權利要求1所述的數據儲存裝置,其特征在于,所述多個電源接腳的所述至少一個接腳是所述連接接口的數字電源接腳。
10.如權利要求9所述的數據儲存裝置,其特征在于,多個電源接腳包括具有較高電位的第一數字電位接腳以及具有較低電位第二數字電位接腳時,則所述多個電源接腳的所述至少一個接腳是所述第一數字電位接腳。
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