[發明專利]一種數據處理方法及裝置有效
| 申請號: | 201910243905.4 | 申請日: | 2019-03-28 |
| 公開(公告)號: | CN109976939B | 公開(公告)日: | 2021-03-19 |
| 發明(設計)人: | 葉懷勝 | 申請(專利權)人: | 聯想(北京)有限公司 |
| 主分類號: | G06F11/10 | 分類號: | G06F11/10 |
| 代理公司: | 北京金信知識產權代理有限公司 11225 | 代理人: | 喻嶸;郭迎俠 |
| 地址: | 100085 北京市海淀*** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 數據處理 方法 裝置 | ||
1.一種數據處理方法,其中,包括,
獲取指令,所述指令用于指示向非易失性內存寫入第一數據;
基于所述第一數據生成第一校驗碼,所述第一校驗碼用于表示所述第一數據完整寫入所述非易失性內存中的狀態;
將所述第一校驗碼寫入非易失性內存;
執行所述指令,向非易失性內存中寫入數據,得到第二數據;
基于所述第二數據生成第二校驗碼;
比較所述第一校驗碼和所述第二校驗碼,以判斷所述第一數據是否被完整寫入所述非易失性內存;
所述基于所述第一數據生成第一校驗碼,包括,
所述第一數據包括N個第一單元數據,計算每個所述第一單元數據的第一單元數據校驗碼;
所述向非易失性內存中寫入數據,包括,
當所述第一單元數據的部分數據被寫入非易失性內存時,基于所述部分數據所在的第一單元數據生成第一單元數據校驗碼;
將所述第一單元數據校驗碼寫入所述非易失性內存中;
將所述第一單元數據的部分數據寫入所述非易失性內存中。
2.根據權利要求1所述的方法,其中,所述方法還包括,
若所述第一校驗碼和所述第二校驗碼相同,表示所述第一數據已經被完整寫入所述非易失性內存;
若所述第一校驗碼和所述第二校驗碼不相同,發出提示信息,所述提示信息用以提示所述第一數據未被完整寫入所述非易失性內存。
3.根據權利要求1所述的方法,其中,
所述基于所述第二數據生成第二校驗碼,包括,
所述第二數據包括M個能夠與所述第一單元數據對應的第二單元數據,其中M小于等于N;
計算每個所述第二單元數據的第二單元數據校驗碼;
所述比較所述第一校驗碼和所述第二校驗碼,包括:
分別比較根據第一單元數據計算得到的第一單元數據校驗碼和根據與該第一單元數據對應的第二單元數據計算得到的第二單元數據校驗碼。
4.根據權利要求1所述的方法,其中,在將所述第一校驗碼寫入非易失性內存之前,包括,
將非易失性內存的存儲區域劃分為第一區域和第二區域;
其中,第一區域用于存儲所述第一校驗碼;
第二區域用于存儲所述第二數據。
5.根據權利要求1所述的方法,其中,所述比較所述第一校驗碼和所述第二校驗碼,包括:
判斷第一校驗碼和第二校驗碼的生成時間;
比較一預設時間段內生成的第一校驗碼和第二校驗碼。
6.根據權利要求1所述的方法,其中,所述方法還包括,
當電子設備發生電氣異常狀態,執行重新上電后,基于所述第二數據生成所述第二校驗碼。
7.根據權利要求1所述的方法,其中,所述方法還包括,
當判斷所述第一數據未被完整寫入所述非易失性內存中時,恢復不完整的數據。
8.一種數據處理裝置,所述裝置包括處理器和非易失性內存;
所述處理器用于,獲取指令,所述指令用于指示向非易失性內存寫入第一數據;
基于所述第一數據生成第一校驗碼,所述第一校驗碼用于表示所述第一數據完整寫入所述非易失性內存中的狀態;
將所述第一校驗碼寫入非易失性內存;
執行所述指令,向非易失性內存中寫入數據,得到第二數據;
基于所述第二數據生成第二校驗碼;
比較所述第一校驗碼和所述第二校驗碼,以判斷所述第一數據是否被完整寫入所述非易失性內存;
所述基于所述第一數據生成第一校驗碼,包括,
所述第一數據包括N個第一單元數據,計算每個所述第一單元數據的第一單元數據校驗碼;
所述向非易失性內存中寫入數據,包括,
當所述第一單元數據的部分數據被寫入非易失性內存時,基于所述部分數據所在的第一單元數據生成第一單元數據校驗碼;
將所述第一單元數據校驗碼寫入所述非易失性內存中;將所述第一單元數據的部分數據寫入所述非易失性內存中。
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