[發明專利]接收器前端電路及其運作方法有效
| 申請號: | 201910243334.4 | 申請日: | 2019-03-28 |
| 公開(公告)號: | CN111416579B | 公開(公告)日: | 2023-03-24 |
| 發明(設計)人: | 張家華 | 申請(專利權)人: | 瑞鼎科技股份有限公司 |
| 主分類號: | H03F1/26 | 分類號: | H03F1/26 |
| 代理公司: | 中國商標專利事務所有限公司 11234 | 代理人: | 張立晶 |
| 地址: | 中國臺灣新竹市*** | 國省代碼: | 臺灣;71 |
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| 摘要: | |||
| 搜索關鍵詞: | 接收器 前端 電路 及其 運作 方法 | ||
1.一種接收器前端電路,其特征在于,包含:
一共模抑制電路,用以接收一外部輸入共模電壓信號并對該外部輸入共模電壓信號進行共模噪聲抑制處理后輸出一內部輸入共模電壓信號;以及
一后級電路,耦接該共模抑制電路,用以接收該內部輸入共模電壓信號;
其中,該內部輸入共模電壓信號的動態擺幅小于該外部輸入共模電壓信號的動態擺幅;該后級電路為一接收器前端均衡器,該接收器前端均衡器包含:
一第一電阻;
一第二電阻;
一第一晶體管,耦接該第一電阻,該第一晶體管的柵極耦接至該共模抑制電路;
一第二晶體管,耦接該第二電阻,該第二晶體管的柵極耦接至該共模抑制電路;
一第三晶體管,耦接于該第一晶體管與一接地端之間;
一第四晶體管,耦接于該第二晶體管與該接地端之間;
一電阻,其一端耦接至該第一晶體管與該第三晶體管之間且其另一端耦接至該第二晶體管與該第四晶體管之間;以及
一電容,其一端耦接至該第一晶體管與該第三晶體管之間且其另一端耦接至該第二晶體管與該第四晶體管之間。
2.根據權利要求1所述的接收器前端電路,其特征在于,該后級電路為一放大級電路。
3.根據權利要求1所述的接收器前端電路,其特征在于,該共模抑制電路包含:
一第一電容,耦接于一第一輸入端與一第一接點之間;
一第二電容,耦接于一第二輸入端與一第二接點之間;
一第一電阻,耦接該第一接點;
一第二電阻,耦接于該第一接點與接地端之間;
一第三電阻,耦接該第二接點;
一第四電阻,耦接于該第二接點與接地端之間;
一第五晶體管,其柵極耦接該第一接點;
一第六晶體管,其柵極耦接該第二接點;
一第七晶體管,耦接該第五晶體管及該第六晶體管于一第三接點;
一第八晶體管,耦接于該第七晶體管與接地端之間;
一第五電阻,耦接該第五晶體管于一第一輸出端;
一第六電阻,耦接該第六晶體管于一第二輸出端。
4.根據權利要求3所述的接收器前端電路,其特征在于,當該共模抑制電路的該第一輸入端及該第二輸入端接收到該外部輸入共模電壓信號時,先通過該第一電容及該第二電容阻絕該外部輸入共模電壓信號的直流電壓。
5.根據權利要求4所述的接收器前端電路,其特征在于,通過串接的該第一電阻與該第二電阻以及串接的該第三電阻與該第四電阻進行分壓,或是電流源搭配電阻串,或是反饋放大器產生偏壓的方式,以產生該內部輸入共模電壓信號。
6.根據權利要求5所述的接收器前端電路,其特征在于,通過流經串接的該第七晶體管與該第八晶體管的一串疊尾端電流提供共模噪聲抑制能力,以消除該內部輸入共模電壓信號的動態擺幅。
7.根據權利要求1所述的接收器前端電路,其特征在于,該第一晶體管、該第二晶體管、該第三晶體管及該第四晶體管均為N型晶體管。
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