[發(fā)明專利]一種磁阻型傳感器芯片時序控制電路及控制方法有效
| 申請?zhí)枺?/td> | 201910137613.2 | 申請日： | 2019-02-25 |
| 公開（公告）號： | CN109765828B | 公開（公告）日： | 2023-08-25 |
| 發(fā)明（設(shè)計）人： | 肖登艷;陳忠志;彭卓;趙翔 | 申請（專利權(quán)）人： | 成都芯進(jìn)電子有限公司 |
| 主分類號： | G05B19/042 | 分類號： | G05B19/042 |
| 代理公司： | 成都行之專利代理有限公司 51220 | 代理人： | 張超 |
| 地址： | 610000 四川省成都市高新*** | 國省代碼： | 四川;51 |
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| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 磁阻 傳感器 芯片 時序 控制電路 控制 方法 | ||
本發(fā)明公開了一種磁阻型傳感器芯片時序控制電路，檢測采樣控制器接入振蕩器輸出的時鐘信號；所述移位寄存器和組合邏輯運算單元均連接于分頻器，且分頻器接入振蕩器輸出的時鐘信號；所述移位寄存器連接于組合邏輯運算單元，且組合邏輯運算單元向AMR和比較器輸出檢測使能時鐘信號。本發(fā)明還公開了一種磁阻型傳感器芯片時序控制方法。本發(fā)明一種磁阻型傳感器芯片時序控制電路及控制方法，有效的實現(xiàn)了對磁阻橋和比較器等功耗較大的器件進(jìn)行工作?睡眠控制，同時，本發(fā)明時序控制電路架構(gòu)清晰，組合邏輯運算量小，不易產(chǎn)生毛刺信號，可以靈活的調(diào)整芯片的工作?睡眠?工作的占空比，滿足不同的實際應(yīng)用需求。
技術(shù)領(lǐng)域
本發(fā)明涉及傳感器控制電路領(lǐng)域，具體涉及一種磁阻型傳感器芯片時序控制電路及控制方法。
背景技術(shù)
各向異形磁阻(Anisotropic?Magneto?Resistance,AMR)效應(yīng)是鐵磁材料中的電阻率隨磁化強度(外加磁場)和電流方向的改變而變化的現(xiàn)象。基于這一效應(yīng)制作的磁阻傳感器由于靈敏度高，便于集成化等優(yōu)點得到了廣泛的應(yīng)用。由于AMR開關(guān)芯片是用于檢測磁場的有或無，只要響應(yīng)靈敏，實時的檢測并非必要。AMR開關(guān)芯片中，磁阻橋和比較器等功耗較大的器件長時間開啟時，會造成芯片功耗提高，甚至造成芯片發(fā)熱量增大。
發(fā)明內(nèi)容
本發(fā)明所要解決的技術(shù)問題是AMR開關(guān)芯片中，磁阻橋和比較器等功耗較大的器件長時間開啟時，會造成芯片功耗提高，甚至造成芯片發(fā)熱量增大，目的在于提供一種磁阻型傳感器芯片時序控制電路及控制方法，解決上述問題。
本發(fā)明通過下述技術(shù)方案實現(xiàn)：
一種磁阻型傳感器芯片時序控制電路，包括檢測采樣控制器、分頻器、移位寄存器和組合邏輯運算單元；所述分頻器、移位寄存器和組合邏輯運算單元均連接于檢測采樣控制器，且檢測采樣控制器接入振蕩器輸出的時鐘信號；所述移位寄存器和組合邏輯運算單元均連接于分頻器，且分頻器接入振蕩器輸出的時鐘信號；所述移位寄存器連接于組合邏輯運算單元，且組合邏輯運算單元向AMR和比較器輸出檢測使能時鐘信號；所述組合邏輯運算單元還向比較器輸出采樣時鐘信號；所述分頻器對輸入的振蕩器時鐘信號進(jìn)行分頻，計數(shù)；所述檢測采樣控制器檢測采樣時鐘占空比控制信號；所述移位寄存器對分頻器的輸出進(jìn)行移位輸出；所述組合邏輯運算單元產(chǎn)生芯片的檢測使能信號和比較器判別輸出的采樣信號。
本發(fā)明應(yīng)用時，振蕩器輸出的時鐘信號為基本時鐘信號，分頻器對基本時鐘信號進(jìn)行分頻和計數(shù)，分頻次數(shù)根據(jù)AMR磁阻開關(guān)芯片的工作-睡眠-工作的頻率及振蕩器頻率來共同決定；檢測采樣控制器檢測采樣時鐘占空比控制信號，用于設(shè)置開關(guān)芯片的工作時間，控制信號的選取由開關(guān)芯片的工作時間和振蕩器的頻率決定；移位寄存器對分頻器的輸出進(jìn)行移位輸出，移位的大小由檢測采樣占空比選擇控制器控制及寄存器的位數(shù)控制；組合邏輯運算單元對分頻器輸出，移位寄存器輸出及檢測采樣占空比選擇控制器的信號進(jìn)行邏輯運算，產(chǎn)生開關(guān)芯片的檢測使能EN信號和比較器判別輸出采樣Sampling信號，在組合邏輯運算單元控制下，開關(guān)芯片的時序工作方式為：在EN為高電平期間，芯片正常工作，Sampling信號對芯片內(nèi)比較器的輸出結(jié)果進(jìn)行采樣，采樣結(jié)果送芯片的輸出驅(qū)動，而EN為低電平期間，芯片進(jìn)入休眠，從而有效的實現(xiàn)了對磁阻橋和比較器等功耗較大的器件進(jìn)行工作-睡眠控制，同時，本發(fā)明時序控制電路架構(gòu)清晰，組合邏輯運算量小，不易產(chǎn)生毛刺信號，可以靈活的調(diào)整芯片的工作-睡眠-工作的占空比，滿足不同的實際應(yīng)用需求。
進(jìn)一步的，所述分頻器包括多個級聯(lián)的觸發(fā)器；首級的觸發(fā)器接收振蕩器輸出的時鐘信號，且首級的觸發(fā)器連接于檢測采樣控制器；末級的觸發(fā)器連接于移位寄存器。
本發(fā)明應(yīng)用時，級聯(lián)(cascade)一般是一系列同樣的單元器件首尾相連，形成新的邏輯單元，來自振蕩器的時鐘信號經(jīng)過級聯(lián)的觸發(fā)器后，由末級的觸發(fā)器進(jìn)行輸出，級聯(lián)的數(shù)量由分頻的需求所決定。
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