[實用新型]模擬向量-矩陣乘法運算電路有效
| 申請號: | 201821242450.1 | 申請日: | 2018-08-02 |
| 公開(公告)號: | CN208547942U | 公開(公告)日: | 2019-02-26 |
| 發明(設計)人: | 王紹迪 | 申請(專利權)人: | 北京知存科技有限公司 |
| 主分類號: | G06F17/16 | 分類號: | G06F17/16 |
| 代理公司: | 暫無信息 | 代理人: | 暫無信息 |
| 地址: | 100083 北京市*** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 可編程半導體器件 矩陣乘法運算 模擬電壓輸入端 偏置電壓輸入端 模擬電流 模擬向量 輸出端 漏極 源極 電路 可編程存儲器 本實用新型 等效模擬 陣列實現 閾值電壓 可變的 權重 | ||
1.一種模擬向量-矩陣乘法運算電路,其特征在于,包括:多個模擬電壓輸入端、可編程半導體器件陣列、多個第一端以及多個第二端;
所述可編程半導體器件陣列中,每一行的所有可編程半導體器件的柵極均連接至同一模擬電壓輸入端,多行可編程半導體器件對應連接多個模擬電壓輸入端,每一列的所有可編程半導體器件的漏極均連接至同一第一端,多列可編程半導體器件對應連接多個第一端,每一列的所有可編程半導體器件的源極均連接至同一第二端,多列可編程半導體器件對應連接多個第二端,每個所述可編程半導體器件的閾值電壓均可調節;
其中,所述第一端為偏置電壓輸入端,所述第二端為模擬電流輸出端,實現柵極耦合、源極求和的拓撲結構;
或者,所述第一端為模擬電流輸出端,所述第二端為偏置電壓輸入端,實現柵極耦合、漏極求和的拓撲結構。
2.根據權利要求1所述模擬向量-矩陣乘法運算電路,其特征在于,還包括:
編程電路,連接可編程半導體器件陣列中每一個可編程半導體器件的源極、柵極和/或襯底,用于調控可編程半導體器件的閾值電壓。
3.根據權利要求2所述模擬向量-矩陣乘法運算電路,其特征在于,所述編程電路包括:電壓產生電路和電壓控制電路,所述電壓產生電路用于產生編程電壓或者擦除電壓,所述電壓控制電路用于將所述編程電壓加載至選定的可編程半導體器件的源極,或者,將擦除電壓加載至選定的可編程半導體器件的柵極或襯底,以調控可編程半導體器件的閾值電壓。
4.根據權利要求3所述模擬向量-矩陣乘法運算電路,其特征在于,還包括:
控制器,連接所述編程電路,通過控制所述編程電路工作,控制投入工作的可編程半導體器件的數量以及各可編程半導體器件的閾值電壓。
5.根據權利要求4所述模擬向量-矩陣乘法運算電路,其特征在于,所述控制器包括:行列譯碼器,用于選通待編程的可編程半導體器件。
6.根據權利要求1所述模擬向量-矩陣乘法運算電路,其特征在于,還包括:轉換裝置,連接在多個所述模擬電壓輸入端之前,用于將多個模擬電流輸入信號分別轉換為模擬電壓輸入信號,輸至對應的所述模擬電壓輸入端。
7.根據權利要求6所述模擬向量-矩陣乘法運算電路,其特征在于,所述轉換裝置包括多個可編程半導體器件;
每個所述可編程半導體器件的柵極與漏極相連,并連接至對應的所述模擬電壓輸入端;
每個所述可編程半導體器件的源極接入第一偏置電壓。
8.根據權利要求1所述模擬向量-矩陣乘法運算電路,其特征在于,還包括:電流檢測輸出電路,連接在所述模擬電流輸出端之后,用于對所述模擬電流輸出端輸出的模擬電流輸出信號進行處理和輸出。
9.根據權利要求8所述模擬向量-矩陣乘法運算電路,其特征在于,所述電流檢測輸出電路包括:多個運算放大器,每個所述運算放大器的正相輸入端連接第二偏置電壓,反相輸入端連接至對應的所述模擬電流輸出端,并且,反相輸入端與輸出端之間連接一電阻器或晶體管。
10.根據權利要求1至9任一項所述模擬向量-矩陣乘法運算電路,其特征在于,所述可編程半導體器件采用浮柵晶體管。
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