[實用新型]一種可編程邏輯芯片的保護電路及控制系統有效
| 申請號: | 201820198240.0 | 申請日: | 2018-02-02 |
| 公開(公告)號: | CN207924500U | 公開(公告)日: | 2018-09-28 |
| 發明(設計)人: | 劉勇 | 申請(專利權)人: | 深圳配天智能技術研究院有限公司 |
| 主分類號: | G05B23/02 | 分類號: | G05B23/02 |
| 代理公司: | 深圳市威世博知識產權代理事務所(普通合伙) 44280 | 代理人: | 李慶波 |
| 地址: | 518104 廣東省深圳市寶安區沙*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 可編程邏輯芯片 開關管 中央處理芯片 電路 電阻 電路及控制系統 輸出端連接 反饋端 輸入端 輸入端連接 參考電壓 加載程序 控制系統 一端接收 作業安全 第一端 控制端 輸出端 申請 保證 | ||
1.一種可編程邏輯芯片的保護電路,其特征在于,所述保護電路分別連接中央處理芯片和可編程邏輯芯片,所述保護電路的輸入端與所述中央處理芯片的輸出端連接,用于從所述中央處理芯片接收第一控制信號;所述保護電路的輸出端與所述可編程邏輯芯片的輸入端連接;所述保護電路的控制端與所述可編程邏輯芯片的反饋端連接,其中:
所述保護電路包括開關管和電阻,所述電阻的一端接收第一參考電壓,所述電阻的另一端分別與所述可編程邏輯芯片的輸入端和所述開關管的第一端連接,所述開關管的第二端與所述中央處理芯片的輸出端連接,所述開關管的第三端與所述可編程邏輯芯片的反饋端連接。
2.根據權利要求1所述的保護電路,其特征在于,所述保護電路包括第一電阻,所述保護電路的控制端和所述可編程邏輯芯片的反饋端通過所述第一電阻接地。
3.根據權利要求2所述的保護電路,其特征在于,所述開關管為PNP型三極管,所述開關管的第一端為所述三極管的發射極,所述開關管的第二端為所述三極管的基極,所述開關管的第三端為所述三極管的集電極。
4.根據權利要求3所述的保護電路,其特征在于,在所述可編程邏輯芯片加載程序時,所述保護電路的控制端從所述可編程邏輯芯片的反饋端接收到第一反饋信號,所述保護電路根據所述第一反饋信號將所述第一控制信號發送至所述可編程邏輯芯片,所述可編程邏輯芯片根據所述第一控制信號從所述中央處理芯片接收所述程序,并加載所述程序;在所述可編程邏輯芯片加載程序后,所述保護電路的控制端從所述可編程邏輯芯片的反饋端接收到第二反饋信號,所述保護電路根據所述二反饋信號和所述第一控制信號產生第二控制信號,所述可編程邏輯芯片接收到所述第二控制信號,根據所述第二控制信號停止接收所述程序。
5.根據權利要求4所述的保護電路,其特征在于,在所述可編程邏輯芯片加載程序時,所述第一控制信號為低電平,所述第一反饋信號為低電平,所述開關管導通;在所述可編程邏輯芯片加載程序完成后,所述第二反饋信號為高電平,所述開關管截止,所述第二控制信號為高電平。
6.一種控制系統,其特征在于,所述控制系統至少包括:
存儲器,用于存儲程序;
中央處理芯片,與所述存儲器連接;
保護電路,所述保護電路的輸入端與所述中央處理芯片的輸出端連接,用于從所述中央處理芯片接收第一控制信號;
可編程邏輯芯片,所述保護電路的輸出端與所述可編程邏輯芯片的輸入端連接,所述保護電路的控制端與所述可編程邏輯芯片的反饋端連接;
所述保護電路包括開關管和電阻,所述電阻的一端接收第一參考電壓,所述電阻的另一端分別與所述可編程邏輯芯片的輸入端和所述開關管的第一端連接,所述開關管的第二端與所述中央處理芯片的輸出端連接,所述開關管的第三端與所述可編程邏輯芯片的反饋端連接。
7.根據權利要求6所述的控制系統,其特征在于,所述保護電路包括第一電阻,所述保護電路的控制端和所述可編程邏輯芯片的反饋端通過所述第一電阻接地。
8.根據權利要求7所述的控制系統,其特征在于,所述開關管為PNP型三極管,所述開關管的第一端為所述三極管的發射極,所述開關管的第二端為所述三極管的基極,所述開關管的第三端為所述三極管的集電極。
9.根據權利要求8所述的控制系統,其特征在于,在所述可編程邏輯芯片加載程序時,所述保護電路的控制端從所述可編程邏輯芯片的反饋端接收到第一反饋信號,所述保護電路根據所述第一反饋信號將所述第一控制信號發送至所述可編程邏輯芯片,所述可編程邏輯芯片根據所述第一控制信號從所述中央處理芯片接收所述程序,并加載所述程序;在所述可編程邏輯芯片加載程序后,所述保護電路的控制端從所述可編程邏輯芯片的反饋端接收到第二反饋信號,所述保護電路根據所述二反饋信號和所述第一控制信號產生第二控制信號,所述可編程邏輯芯片接收到所述第二控制信號,根據所述第二控制信號停止接收所述程序。
10.根據權利要求9所述的控制系統,其特征在于,在所述可編程邏輯芯片加載程序時,所述第一控制信號為低電平,所述第一反饋信號為低電平,所述開關管導通;在所述可編程邏輯芯片加載程序完成后,所述第二反饋信號為高電平,所述開關管截止,所述第二控制信號為高電平。
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