[發(fā)明專利]一種基于FPGA的自適應(yīng)LCD控制器在審
| 申請?zhí)枺?/td> | 201811522309.1 | 申請日： | 2018-12-13 |
| 公開（公告）號： | CN109698937A | 公開（公告）日： | 2019-04-30 |
| 發(fā)明（設(shè)計）人： | 孫智慧;賀永亮;楊小光;陳國際;曹雨;張偉;何春;金學(xué)彬 | 申請（專利權(quán)）人： | 中電科儀器儀表（安徽）有限公司 |
| 主分類號： | H04N7/18 | 分類號： | H04N7/18;H04N5/265 |
| 代理公司： | 青島智地領(lǐng)創(chuàng)專利代理有限公司 37252 | 代理人： | 陳海濱 |
| 地址： | 233010 安徽*** | 國省代碼： | 安徽;34 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 圖像輸出控制 時序發(fā)生 讀寫控制模塊 主控模塊 自適應(yīng) 圖像采集模塊 圖像處理模塊 控制技術(shù)領(lǐng)域 控制信號 模塊發(fā)送 模塊提供 時序信號 依次相連 外部 | ||
1.一種基于FPGA的自適應(yīng)LCD控制器，其特征在于，包括圖像采集模塊、FIFO緩存模塊、SDRAM讀寫控制模塊、圖像處理模塊、主控模塊、時序發(fā)生模塊和圖像輸出控制模塊；所述圖像采集模塊、FIFO緩存模塊和SDRAM讀寫控制模塊依次相連，SDRAM讀寫控制模塊上連接外部SDRAM存儲器，SDRAM讀寫控制模塊分別與圖像處理模塊和圖像輸出控制模塊相連，主控模塊分別與圖像輸出控制模塊和時序發(fā)生模塊相連，時序發(fā)生模塊與圖像輸出控制模塊相連。主控模塊向圖像輸出控制模塊和時序發(fā)生模塊發(fā)送控制信號，時序發(fā)生模塊給圖像輸出控制模塊提供時序信號，具體包括以下控制步驟：
步驟①圖像采集模塊將視頻圖像數(shù)據(jù)存入FIFO緩存模塊；
步驟②SDRAM讀寫控制模塊將FIFO緩存模塊中的視頻圖像數(shù)據(jù)寫入外部SDRAM存儲器中的第一存儲區(qū)；
步驟③圖像處理模塊通過SDRAM讀寫控制模塊讀取視頻圖像數(shù)據(jù)，經(jīng)過處理后再通過SDRAM讀寫控制模塊將處理后的視頻圖像數(shù)據(jù)存入外部SDRAM存儲器中的第二存儲區(qū)；
步驟④主控模塊將圖像輸出命令發(fā)送給圖像輸出控制模塊；根據(jù)不同類型的LCD顯示器，主控模塊將時序命令發(fā)送給時序發(fā)生模塊；
步驟⑤時序發(fā)生模塊根據(jù)主控模塊發(fā)送的時序命令產(chǎn)生相應(yīng)時序信號；
步驟⑥圖像輸出控制模塊按照主控模塊發(fā)來的圖像輸出命令，通過SDRAM讀寫控制模塊將存儲在外部SDRAM存儲器中的視頻圖像數(shù)據(jù)送到LCD顯示器中顯示。
2.如權(quán)利要求1所述的一種基于FPGA的自適應(yīng)LCD控制器，其特征在于所述步驟④中圖像輸出命令包括圖像顯示模式和存儲在外部SDRAM存儲器中待顯示數(shù)據(jù)的地址。
3.如權(quán)利要求2所述的一種基于FPGA的自適應(yīng)LCD控制器，其特征在于，所述步驟④中主控模塊發(fā)送的圖像顯示模式命令包括單攝像頭顯示模式和雙攝像頭合成顯示模式；
當(dāng)顯示模式為單攝像頭顯示模式時，主控模塊根據(jù)LCD顯示器顯示區(qū)尺寸，直接將SDRAM存儲器中待顯數(shù)據(jù)的起止地址發(fā)送給圖像輸出模塊，圖像輸出模塊根據(jù)主控模塊發(fā)來的數(shù)據(jù)地址，通過SDRAM讀寫控制模塊將存儲在外部SDRAM存儲器中的視頻圖像數(shù)據(jù)讀出，送到LCD顯示器中進(jìn)行顯示；
當(dāng)顯示模式為雙攝像頭合成顯示模式時，主控模塊根據(jù)LCD顯示器顯示區(qū)尺寸及要求，將SDRAM存儲器中待顯數(shù)據(jù)進(jìn)行拼接，然后將合成后的數(shù)據(jù)地址發(fā)送給圖像輸出模塊，圖像輸出模塊根據(jù)主控模塊發(fā)來的數(shù)據(jù)地址，通過SDRAM讀寫控制模塊將存儲在外部SDRAM存儲器中的視頻圖像數(shù)據(jù)讀出，送到LCD顯示器中進(jìn)行顯示。
4.如權(quán)利要求1所述的一種基于FPGA的自適應(yīng)LCD控制器，其特征在于，所述步驟④中時序命令包括視頻圖像尺寸及數(shù)據(jù)顯示模式。
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