[發(fā)明專利]一種ADS-B多通道信號產(chǎn)生方法有效
| 申請?zhí)枺?/td> | 201811399243.1 | 申請日: | 2018-11-22 |
| 公開(公告)號: | CN109547161B | 公開(公告)日: | 2020-06-16 |
| 發(fā)明(設(shè)計)人: | 劉光倫 | 申請(專利權(quán))人: | 四川九洲電器集團(tuán)有限責(zé)任公司 |
| 主分類號: | H04L1/00 | 分類號: | H04L1/00;H04L29/06;H04B17/00;G08G5/00;G08G5/04 |
| 代理公司: | 北京天達(dá)知識產(chǎn)權(quán)代理事務(wù)所(普通合伙) 11386 | 代理人: | 李明里;龐許倩 |
| 地址: | 621000 四*** | 國省代碼: | 四川;51 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 ads 通道 信號 產(chǎn)生 方法 | ||
1.一種ADS-B多通道信號產(chǎn)生方法,其特征在于,包括以下步驟:
上位機(jī)獲取多路報文數(shù)據(jù),并確定ADS-B報文輸出方案;
根據(jù)所述報文的輸出方案,將多路報文數(shù)據(jù)處理成多通道傳輸合成幀發(fā)送到終端機(jī);
所述多通道傳輸合成幀,包括同步頭、通道使能字段、延時字段、幀數(shù)據(jù)段和CRC;
所述同步頭,包括2字節(jié);
所述通道使能字段,包括N個BIT;N為ADS-B報文輸出方案中確定的輸出通道數(shù);每個通道使能為1BIT,0表示通道禁止,1表示通道使能輸出;
所述延時字段,包括N個字節(jié);其中,字節(jié)與輸出通道相對應(yīng),表示N個輸出通道的延時時間;
所述幀數(shù)據(jù)段,包括N個數(shù)據(jù)字段;其中,每個幀數(shù)據(jù)字段為每個輸出通道經(jīng)過編碼后的ADS-B報文數(shù)據(jù);
CRC為循環(huán)冗余校驗碼,為整個傳輸幀的校驗碼;
終端機(jī)接收多通道傳輸合成幀數(shù)據(jù),進(jìn)行數(shù)據(jù)解析、調(diào)制、放大和多通道延時控制后,形成多路射頻信號經(jīng)由天線發(fā)射;
所述終端機(jī)的處理過程包括:
1)接收到幀數(shù)據(jù)流后,先檢測同步幀頭,找到同步頭后,進(jìn)行傳輸幀的數(shù)據(jù)校驗;
2)數(shù)據(jù)校驗無誤后,并對各通道的ADS-B報文數(shù)據(jù)流CRC校驗和解析;
3)分別提取出各通道幀數(shù)據(jù)、使能位及延時大小,進(jìn)行PPM調(diào)制和精確延時控制后,生成各通道ADS-B基帶信號;
具體的精確延時控制是在終端機(jī)上采用恒溫晶振為PLL管理芯片提供源時鐘;所述PLL管理芯片再輸出穩(wěn)定時鐘給終端機(jī)的FPGA;FPGA通過分頻對各通道的延時進(jìn)行控制;控制報文輸出的時鐘控制周期在20納秒,保證輸出的控制時鐘誤差不會超過1納秒;
通過各通道的延時控制,用于模擬ADS-B多通道信號通道之間的多徑和交織特性;通道延時為信號的多徑延時;
4)把各通道ADS-B基帶信號調(diào)制到1090MHz載波上后進(jìn)行放大,經(jīng)天線發(fā)送出去。
2.根據(jù)權(quán)利要求1所述的多通道信號產(chǎn)生方法,其特征在于,還包括地圖顯示方法,所述方法包括:
上位機(jī)獲得GNSS信息,對獲取多路報文數(shù)據(jù)中包含的位置信息進(jìn)行初始位置定位,在GIS地圖上顯示;
在上位機(jī)進(jìn)行數(shù)據(jù)發(fā)送后,同步將產(chǎn)生的飛行軌跡數(shù)據(jù),在GIS地圖上顯示;
重要的飛機(jī)參數(shù)數(shù)據(jù)以伴飛標(biāo)牌形式,實時在地圖上疊加顯示。
該專利技術(shù)資料僅供研究查看技術(shù)是否侵權(quán)等信息,商用須獲得專利權(quán)人授權(quán)。該專利全部權(quán)利屬于四川九洲電器集團(tuán)有限責(zé)任公司,未經(jīng)四川九洲電器集團(tuán)有限責(zé)任公司許可,擅自商用是侵權(quán)行為。如果您想購買此專利、獲得商業(yè)授權(quán)和技術(shù)合作,請聯(lián)系【客服】
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