[發明專利]FPGA原型驗證系統在審
| 申請號： | 201811072493.4 | 申請日： | 2018-09-14 |
| 公開（公告）號： | CN109190276A | 公開（公告）日： | 2019-01-11 |
| 發明（設計）人： | 趙玉林;呂平;劉勤讓;沈劍良;張霞;汪欣;張波;王盼;朱珂;王銳;張進;李楊;毛英杰;李慶龍;董春雷 | 申請（專利權）人： | 天津市濱海新區信息技術創新中心;國家數字交換系統工程技術研究中心 |
| 主分類號： | G06F17/50 | 分類號： | G06F17/50 |
| 代理公司： | 北京超凡志成知識產權代理事務所(普通合伙) 11371 | 代理人： | 唐維虎 |
| 地址： | 300457 天津市濱海新區經*** | 國省代碼： | 天津;12 |
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| 摘要： | |||
| 搜索關鍵詞： | 驗證板 原型 原型驗證系統 高速連接器 光接口模塊 互連接口 后一級 前一級 級聯 技術效果 靈活的 板級 可用 芯片 驗證 | ||
1.一種FPGA原型驗證系統，其特征在于，包括：至少兩個級聯的FPGA原型驗證板；
前一級FPGA原型驗證板的高速連接器的I/O端口與后一級FPGA原型驗證板的高速連接器的I/O端口連接；
前一級FPGA原型驗證板的光接口模塊的I/O端口與后一級FPGA原型驗證板的光接口模塊的I/O端口連接。
2.根據權利要求1所述的FPGA原型驗證系統，其特征在于，所述FPGA原型驗證板包括：FPGA模塊、光接口模塊及高速連接器；
所述FPGA模塊的GTH高速接口與所述光接口模塊的光接口對應連接；
所述FPGA模塊的高性能I/O接口與所述高速連接器的I/O端口對應連接。
3.根據權利要求2所述的FPGA原型驗證系統，其特征在于，多個由所述FPGA模塊的高性能I/O接口至所述高速連接器的I/O端口之間的布線長度分別經過等長約束處理，以使任意兩個所述布線長度之間的長度差小于預設約束閾值,保證總線數據傳輸的時序約束要求。
4.根據權利要求2所述的FPGA原型驗證系統，其特征在于，高速連接器的I/O端口采用LVDS電平。
5.根據權利要求2所述的FPGA原型驗證系統，其特征在于，所述FPGA原型驗證板還包括：處理器；
所述處理器與所述FPGA模塊之間通過通信總線連接。
6.根據權利要求5所述的FPGA原型驗證系統，其特征在于，所述通信總線包括：I2C通信總線、RapidIO通信總線、PCIe通信總線和10GBase-KR通信總線。
7.根據權利要求2所述的FPGA原型驗證系統，其特征在于，所述FPGA原型驗證板還包括：CPLD模塊；
所述CPLD模塊與所述FPGA模塊之間通過并行總線連接。
8.根據權利要求2所述的FPGA原型驗證系統，其特征在于，所述FPGA原型驗證板還包括：電源模塊；
所述電源模塊為所述FPGA原型驗證板供電。
9.根據權利要求2所述的FPGA原型驗證系統，其特征在于，所述FPGA原型驗證板還包括：時鐘模塊；
所述時鐘模塊為所述FPGA原型驗證板提供時鐘信號。
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