[發明專利]數模轉換器中的最低有效位動態元件匹配在審
| 申請號： | 201811064111.3 | 申請日： | 2018-09-12 |
| 公開（公告）號： | CN109586723A | 公開（公告）日： | 2019-04-05 |
| 發明（設計）人： | K·D·波爾頓;R·E·朱厄特 | 申請（專利權）人： | 是德科技股份有限公司 |
| 主分類號： | H03M1/66 | 分類號： | H03M1/66 |
| 代理公司： | 北京坤瑞律師事務所 11494 | 代理人： | 封新琴 |
| 地址： | 美國加利*** | 國省代碼： | 美國;US |
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| 摘要： | |||
| 搜索關鍵詞： | 數字輸入 有效位 數模轉換器 輸出節點 抖動 動態元件 數模轉換 唯一數字 輸出 電荷 電荷源 減去 分段 匹配 抵消 電路 | ||
1.一種用于數模轉換的電路(圖1、圖2、圖3及圖4)，其包括：
第一數模轉換器((DAC)105/205/305)，其從分段為用于該第一DAC(105/205/305)的數字輸入的最高有效位的第一組(125-127)和用于該數字輸入的最低有效位的第二組(121-124)的多個第一電荷源(121-127)提供電荷；
多個第一開關器(131-137)，其各自對應于該多個第一電荷源(121-127)中的不同第一電荷源并且基于該數字輸入從該多個第一電荷源(121-127)中的該不同第一電荷源可變地提供電荷；
第二DAC(206/306/406)；及
輸出節點(108/208/308/408)，
其中抖動(202/302)被添加到該第一DAC(105/205/305)的該數字輸入并且用作該第二DAC(206/306/406)的唯一數字輸入，且
在該輸出節點(108/208/308/408)處從該第一DAC(105/205/305)的模擬輸出中減去來自該第二DAC(206/306/406)的模擬輸出以便抵消被添加到該第一DAC(105/205/305)的該抖動(202/302)。
2.權利要求1的電路，
其中對用于該最高有效位的該第一組(125-127)的第一電荷源(121-127)進行相等加權，且
對用于該最低有效位的該第二組(121-124)的第一電荷源(121-127)進行二進制加權。
3.權利要求2的電路，
其中用于第一樣本的數字輸入的該第一電荷源(121-127)中的一組電荷源可以與用于第二樣本的相同數字輸入的該第一電荷源(121-127)中的一組電荷源不同。
4.權利要求1的電路，其進一步包括：
該多個第一電荷源(121-127)，
其中該第一電荷源(121-127)包括電流源。
5.權利要求2的電路，
其中該第二DAC(206/306/406)從多個第二電荷源(421-424)提供電荷，且
該第二電荷源(421-424)的數量等于用于該最低有效位的該第二組(121-124)的第一電荷源(121-127)的數量。
6.權利要求5的電路，
其中對該第二電荷源(421-424)及該第一電荷源(121-127)的該第二組(121-124)進行二進制加權。
7.權利要求1的電路，
其中該第一DAC(105/205/305)的該模擬輸出和該第二DAC(206/306/406)的該模擬輸出是差分信號。
8.權利要求1的電路，
其中該第二DAC(206/306/406)添加來自通過該第二DAC(206/306/406)的該唯一數字輸入來控制的第二開關器(431-434)的電荷。
9.權利要求1的電路，
其中該抖動(202/302)包括L位偽隨機抖動，其中L是該最低有效位的數量。
10.權利要求1的電路，
其中該第二DAC(206/306/406)從多個第二電荷源(421-424)提供電荷；
對該多個第一電荷源(121-127)的該第二組(121-124)不進行二進制加權；且
對該多個第二電荷源(421-424)不進行二進制加權。
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