[發明專利]訪問控制有效
| 申請號: | 201810569933.0 | 申請日: | 2018-06-05 |
| 公開(公告)號: | CN109032963B | 公開(公告)日: | 2023-09-05 |
| 發明(設計)人: | 布魯斯·詹姆斯·馬修森;潘尼德拉·庫馬爾·馬納瓦;馬修·盧西恩·埃文斯;保羅·吉爾伯特·梅耶;安德魯·布魯克菲爾德·斯溫 | 申請(專利權)人: | ARM有限公司 |
| 主分類號: | G06F12/06 | 分類號: | G06F12/06;G06F12/10;G06F15/163 |
| 代理公司: | 北京東方億思知識產權代理有限責任公司 11258 | 代理人: | 林強 |
| 地址: | 英國*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 訪問 控制 | ||
本技術涉及訪問控制。訪問控制電路包括:檢測器,檢測虛擬存儲器地址空間中的虛擬存儲器地址與物理存儲器地址空間中的物理存儲器地址之間的存儲器地址轉換,存儲器地址轉換是響應于另外的電路的轉換請求而提供的;地址轉換存儲器,響應于另外的電路的轉換請求而存儲表示先前提供給該另外的電路的一組物理存儲器地址的數據;接口,從另外的電路接收供該另外的電路進行存儲器訪問的物理存儲器地址;比較器,將從另外的電路接收到的物理存儲器地址與由地址轉換存儲器存儲的一組物理地址進行比較,并且允許另外的電路訪問包括在那組的一個或多個物理存儲器地址中的物理地址。
技術領域
本技術涉及訪問控制領域。
背景技術
在數據處理裝置中,能夠使用所謂的片外加速器或協處理器,其可以以更有效的方式執行特定的功能。一種方法是使用FPGA(現場可編程門陣列)加速器,使得FPGA可以重新編程以執行不同的加速任務。
為了改善片外加速器的性能,可以在加速器和主機設備之間使用一致性接口。這允許在數據結構共享時加速器在本地緩存的存儲器上運行,而無需軟件緩存維護。
完全一致性加速器和IO一致性加速器(不本地緩存數據)之間的區別在于:完全一致性加速器應使用物理地址(PA)來進行本地緩存。這是必需的,以便來自主機芯片的任何監聽事務將檢測到加速器中正確的緩存行并執行正確的動作。
發明內容
在示例布置中,提供了訪問控制電路,該訪問控制電路包括:
檢測器,檢測虛擬存儲器地址空間中的虛擬存儲器地址與物理存儲器地址空間中的物理存儲器地址之間的存儲器地址轉換,存儲器地址轉換響應于另外的電路的轉換請求而提供;
地址轉換存儲器,響應于另外的電路的轉換請求,存儲表示先前提供給該另外的電路的一組物理存儲器地址的數據;
接口,從另外的電路接收供該另外的電路進行存儲器訪問的物理存儲器地址;以及
比較器,將從另外的電路接收到的物理存儲器地址與由地址轉換存儲器所存儲的一組物理地址進行比較,并且允許另外的電路訪問包括在所述一組的一個或多個物理存儲器地址中的物理地址。
在另一示例布置中,提供了訪問控制電路,該訪問控制電路包括:
用于檢測虛擬存儲器地址空間中的虛擬存儲器地址與物理存儲器地址空間中的物理存儲器地址之間的存儲器地址轉換的裝置,存儲器地址轉換響應于另外的電路的轉換請求而提供;
用于響應于另外的電路的轉換請求而存儲表示先前提供給該另外的電路的一組物理存儲器地址的數據的裝置;
用于從另外的電路接收供該另外的電路進行存儲器訪問的物理存儲器地址的裝置;
用于將從另外的電路接收到的物理存儲器地址與由存儲裝置所存儲的所述一組物理地址進行比較的裝置;以及
用于允許另外的電路訪問包括在所述一組的一個或多個物理存儲器地址中的物理地址的裝置。
在另一示例布置中,提供了一種方法,該方法包括:
檢測虛擬存儲器地址空間中的虛擬存儲器地址與物理存儲器地址空間中的物理存儲器地址之間的存儲器地址轉換,存儲器地址轉換響應于另外的電路的轉換請求而提供;
響應于另外的電路的轉換請求,存儲表示先前提供給該另外的電路的一組物理存儲器地址的數據;
從另外的電路接收供該另外的電路進行存儲器訪問的物理存儲器地址;
將從另外的電路接收到的物理存儲器地址與由地址轉換存儲器所存儲的一組物理地址進行比較;以及
允許另外的電路訪問包括在所述一組的一個或多個物理存儲器地址中的物理地址。
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