[發明專利]一種BMC收發器有效
| 申請號: | 201810478180.2 | 申請日: | 2018-05-18 |
| 公開(公告)號: | CN108829931B | 公開(公告)日: | 2022-07-05 |
| 發明(設計)人: | 陶成;徐希;季翔宇;付家喜 | 申請(專利權)人: | 龍迅半導體(合肥)股份有限公司 |
| 主分類號: | G06F30/36 | 分類號: | G06F30/36;G06F30/39;H03K17/00 |
| 代理公司: | 北京集佳知識產權代理有限公司 11227 | 代理人: | 王寶筠 |
| 地址: | 230601 安徽省合肥市*** | 國省代碼: | 安徽;34 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 bmc 收發 | ||
1.一種BMC收發器,其特征在于,包括:運算放大器電路和模式切換開關組,所述運算放大器電路以分時復用的方式工作,其中:
當工作在發送器模式下時,所述模式切換開關組將所述運算放大器電路配置為BMC發送器,將數據編碼和協議處理單元生成的待發送數據txd通過所述運算放大器電路發送到CC通道;
當工作在接收器模式下時,所述模式切換開關組將所述運算放大器電路配置為BMC接收器,接收來自所述CC通道由下游發送過來的BMC數據,并發送給所述數據編碼和協議處理單元處理;
在所述發送器模式下時,輸出波形上升下降時間的調節通過改變所述運算放大器電路自身的偏執電流來改變所述運算放大器電路在階躍輸入信號下對電容的充放電速度來實現。
2.根據權利要求1所述的BMC收發器,其特征在于,所述運算放大器電路為差分輸入差分輸出的運算放大器或差分輸入單端輸出的運算放大器。
3.根據權利要求2所述的BMC收發器,其特征在于,所述差分輸入差分輸出的運算放大器包括:正極性輸入端、負極性輸入端、正極性輸出端和負極性輸出端,其中:
所述正極性輸入端和所述負極性輸入端的輸入數據,來自所述數據編碼和協議處理單元的待發送數據txd或者CC通道由下游發送過來的待接收數據;
所述正極性輸出端和所述負極性輸出端的輸出數據,連接所述CC通道的數據或所述數據編碼和協議處理單元待接收數據rxd。
4.根據權利要求3所述的BMC收發器,其特征在于,所述模式切換開關組合包括:第一開關、第二開關、第三開關和第四開關;
當所述BMC收發器工作于發送模式時,控制所述第一開關和所述第三開關閉合、所述第二開關和所述第四開關斷開,使得所述運算放大器的所述正極性輸入端與所述數據編碼和協議處理單元的發送數據端txd相連,所述運算放大器的所述正極性輸出端和所述負極性輸入端相連,形成單位增益緩沖器,驅動CC通道形成最終的BMC輸出波形;
當所述BMC收發器工作于接收模式時,控制所述第一開關和所述第三開關斷開、所述第二開關和所述第四開關閉合,使得所述運算放大器的所述負極性輸入端與所述CC通道相連,接收來自下游設備發送過來的BMC數據,所述運算放大器的所述負極性輸出端和所述正極性輸入端相連,形成單位增益緩沖器,并將接收到的輸入波形整形后送給所述數據編碼和協議處理單元處理。
5.根據權利要求2所述的BMC收發器,其特征在于,所述差分輸入單端輸出的運算放大器包括:正極性輸入端、負極性輸入端和正極性輸出端,其中:
所述正極性輸入端和所述負極性輸入端的輸入數據,來自所述數據編碼和協議處理單元的待發送數據txd或者CC通道由下游發送過來的待接收數據;
所述正極性輸出端的輸出數據,連接所述CC通道的數據或所述數據編碼和協議處理單元的待接收數據rxd。
6.根據權利要求5所述的BMC收發器,其特征在于,所述模式切換開關組合包括:第一開關、第二開關、第三開關和第四開關;
當所述BMC收發器工作于發送模式時,控制所述第一開關和所述第三開關閉合、所述第二開關和所述第四開關斷開,使得所述運算放大器的所述正極性輸入端與所述數據編碼和協議處理單元的發送數據端txd相連,所述運算放大器的所述正極性輸出端與所述負極性輸入端相連,與所述CC通道相連,驅動所述CC通道形成最終的BMC輸出波形;
當所述BMC收發器工作于接收模式時,控制所述第一開關和所述第三開關斷開、所述第二開關和所述第四開關閉合,使得所述運算放大器的所述正極性輸入端與所述CC通道相連,接收來自下游設備發送過來的BMC數據,所述運算放大器的所述正極性輸出端與所述負極性輸入端相連,與所述數據編碼和協議處理單元的接收數據端rxd相連,并將接收到的輸入波形整形后送給所述數據編碼和協議處理單元處理。
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