[發(fā)明專利]一種移位寄存器、其驅(qū)動方法及柵極驅(qū)動電路、顯示裝置有效
| 申請?zhí)枺?/td> | 201810358665.8 | 申請日： | 2018-04-20 |
| 公開（公告）號： | CN108538233B | 公開（公告）日： | 2020-12-01 |
| 發(fā)明（設(shè)計）人： | 馮雪歡 | 申請（專利權(quán)）人： | 京東方科技集團股份有限公司;合肥鑫晟光電科技有限公司 |
| 主分類號： | G09G3/20 | 分類號： | G09G3/20;G11C19/28 |
| 代理公司： | 北京同達信恒知識產(chǎn)權(quán)代理有限公司 11291 | 代理人： | 郭潤湘 |
| 地址： | 100015 *** | 國省代碼： | 北京;11 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 移位寄存器 驅(qū)動 方法 柵極 電路 顯示裝置 | ||
1.一種移位寄存器，其特征在于，包括：輸入模塊、輸出模塊、防干擾模塊和輸出控制模塊；
其中，所述輸出模塊與第一節(jié)點、第一時鐘信號端和信號輸出端相連，用于在輸入階段和輸出階段在所述第一節(jié)點的控制下，將所述第一時鐘信號端的第一時鐘信號寫入所述信號輸出端；
所述輸入模塊與信號輸入端、第二時鐘信號端、所述第一節(jié)點和第二節(jié)點相連，用于在所述輸入階段在所述信號輸入端與所述第二時鐘信號端的共同控制下，將所述信號輸入端的輸入信號經(jīng)所述第二節(jié)點寫入所述第一節(jié)點，并在復(fù)位階段在所述第二時鐘信號端的控制下，將所述信號輸入端的輸入信號寫入所述第二節(jié)點；
所述防干擾模塊與復(fù)位信號端、低電平信號端、所述信號輸入端、所述信號輸出端、所述第一節(jié)點和所述第二節(jié)點相連，用于在所述輸入階段在所述信號輸入端的控制下，防止所述復(fù)位信號端的復(fù)位信號寫入所述第一節(jié)點；并用于在所述復(fù)位階段在所述復(fù)位信號端的控制下，將所述低電平信號端的低電平信號寫入所述信號輸出端，且將所述信號輸入端的輸入信號寫入所述第一節(jié)點；
所述輸出控制模塊與所述第一時鐘信號端、所述第二時鐘信號端、所述第一節(jié)點、所述第二節(jié)點、所述低電平信號端和高電平信號端相連，用于在所述輸出階段在所述第一時鐘信號端和所述高電平信號端的共同控制下拉高所述第一節(jié)點的電位，并在所述復(fù)位階段在所述第二時鐘信號端和所述高電平信號端的共同控制下拉低所述第一節(jié)點的電位；
或者，所述輸出控制模塊與所述第一時鐘信號端、所述第二時鐘信號端、所述第一節(jié)點、所述第二節(jié)點、所述信號輸出端、所述低電平信號端和所述高電平信號端相連，用于在所述輸出階段在所述第一時鐘信號端和所述信號輸出端的共同控制下拉高所述第一節(jié)點的電位，并在所述復(fù)位階段在所述第二時鐘信號端的控制下拉低所述第一節(jié)點的電位。
2.如權(quán)利要求1所述的移位寄存器，其特征在于，所述輸入模塊包括第一開關(guān)晶體管和第二開關(guān)晶體管；
其中，所述第一開關(guān)晶體管的柵極與所述第二時鐘信號端相連，第一極與所述信號輸入端相連，第二極與所述第二節(jié)點相連；
所述第二開關(guān)晶體管的柵極與所述信號輸入端相連，第一極與所述第二節(jié)點相連，第二極與所述第一節(jié)點相連。
3.如權(quán)利要求1所述的移位寄存器，其特征在于，所述輸出模塊包括第三開關(guān)晶體管和第一電容；
其中，所述第三開關(guān)晶體管的柵極與所述第一節(jié)點相連，第一極與所述第一時鐘信號端相連，第二極與所述信號輸出端相連；
所述第一電容的一端與所述第一節(jié)點相連，另一端與所述信號輸出端相連。
4.如權(quán)利要求1所述的移位寄存器，其特征在于，所述防干擾模塊包括第四開關(guān)晶體管、第五開關(guān)晶體管、第六開關(guān)晶體管、第七開關(guān)晶體管、第八開關(guān)晶體管和第九開關(guān)晶體管；
其中，所述第四開關(guān)晶體管的柵極和第一極均與所述復(fù)位信號端相連，第二極與第三節(jié)點相連；
所述第五開關(guān)晶體管的柵極與所述第三節(jié)點相連，第一極與所述復(fù)位信號端相連，第二極與第四節(jié)點相連；
所述第六開關(guān)晶體管的柵極與所述第四節(jié)點相連，第一極與所述第二節(jié)點相連，第二極與所述第一節(jié)點相連；
所述第七開關(guān)晶體管的柵極與所述第三節(jié)點相連，第一極與所述低電平信號端相連，第二極與所述信號輸出端相連；
所述第八開關(guān)晶體管的柵極與所述信號輸入端相連，第一極與所述低電平信號端相連，第二極與所述第三節(jié)點相連；
所述第九開關(guān)晶體管的柵極與所述信號輸入端相連，第一極與所述低電平信號端相連，第二極與所述第四節(jié)點相連；
所述第八開關(guān)晶體管的寬長比大于所述第四開關(guān)晶體管的寬長比。
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