[發(fā)明專利]存儲系統(tǒng)有效
| 申請?zhí)枺?/td> | 201810089339.1 | 申請日: | 2018-01-30 |
| 公開(公告)號: | CN108492839B | 公開(公告)日: | 2023-05-16 |
| 發(fā)明(設(shè)計)人: | 樸宰漢;郭顯禹 | 申請(專利權(quán))人: | 愛思開海力士有限公司 |
| 主分類號: | G11C5/04 | 分類號: | G11C5/04;G11C7/10;G11C11/00;G06F3/06 |
| 代理公司: | 北京弘權(quán)知識產(chǎn)權(quán)代理有限公司 11363 | 代理人: | 李少丹;許偉群 |
| 地址: | 韓國*** | 國省代碼: | 暫無信息 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 存儲系統(tǒng) | ||
一種存儲系統(tǒng)包括存儲器控制器、第一存儲模塊、第二存儲模塊以及通道。第一存儲模塊包括第一組第一存儲芯片和第二組第一存儲芯片;第二存儲模塊包括第一組第二存儲芯片和第二組第二存儲芯片;通道包括適用于將存儲器控制器與第一存儲模塊耦接的第一組信號線和適用于將存儲器控制器與第二存儲模塊耦接的第二組信號線。
相關(guān)申請的交叉引用
本申請要求2017年2月2日提交的申請?zhí)枮?5/423012、題為“MEMORY?SYSTEM(存儲系統(tǒng))”的美國專利申請的優(yōu)先權(quán),其通過引用整體合并于此。
技術(shù)領(lǐng)域
本專利文件涉及一種存儲系統(tǒng)。
背景技術(shù)
圖1是示出包括存儲器控制器110以及兩個存儲模塊120和130的存儲系統(tǒng)的配置圖。
參考圖1,存儲模塊120和130可以分別包括多個存儲芯片DRAM0至DRAM15,寄存時鐘驅(qū)動器121和131以及多個緩沖芯片DB0至DB7。
存儲芯片DRAM0至DRAM15可以由從存儲器控制器110提供的命令信號、地址信號以及時鐘信號來控制。存儲芯片DRAM0至DRAM15可以儲存從存儲器控制器110提供的數(shù)據(jù)以及可以將儲存的數(shù)據(jù)讀出到存儲器控制器110。
寄存時鐘驅(qū)動器121和131可以將從存儲器控制器110提供的命令信號、地址信號和時鐘信號傳輸?shù)蕉鄠€相應(yīng)的存儲芯片DRAM0至DRAM15。
緩沖芯片DB0至DB7中的每個緩沖芯片可以緩沖在存儲器控制器110與多個存儲芯片DRAM0至DRAM15之中的一個或更多個對應(yīng)的存儲芯片之間傳輸?shù)臄?shù)據(jù)。
信號經(jīng)由將存儲器控制器110與存儲模塊120和130耦接的通道CHANNEL來在存儲器控制器110與存儲模塊120和130之間傳輸。通道CHANNEL通常包括用于傳輸各種信號的多個線。包括在通道CHANNEL中的全部線由存儲模塊120和130共享。然而,在至少兩個存儲模塊120和130以這種方式共享線的情況下,經(jīng)由這些線傳輸?shù)男盘柕馁|(zhì)量可能惡化。在圖1中,省略用于在寄存時鐘驅(qū)動器121和131與相應(yīng)的存儲芯片DRAM0至DRAM15之間傳輸各種信號的通道CHANNEL的多個線的圖示。
發(fā)明內(nèi)容
各種實施例針對一種具有降低的負(fù)載的存儲系統(tǒng),該負(fù)載為在存儲模塊和存儲器控制器之間傳輸信號的通道的負(fù)載。
在實施例中,存儲系統(tǒng)可以包括:存儲器控制器;第一存儲模塊,其包括第一組第一存儲芯片和第二組第一存儲芯片;第二存儲模塊,其包括第一組第二存儲芯片和第二組第二存儲芯片;以及通道,其包括適用于將存儲器控制器與第一存儲模塊耦接的第一組信號線和適用于將存儲器控制器與第二存儲模塊耦接的第二組信號線。
第一存儲模塊還可以包括第一組第一緩沖芯片和第二組第一緩沖芯片,以及第二存儲模塊還可以包括第一組第二緩沖芯片和第二組第二緩沖芯片。
第一組第一緩沖芯片可以耦接在第一組第一存儲芯片與第一組信號線之間,而第二組第二緩沖芯片可以耦接在第二組第二存儲芯片與第二組信號線之間。
第一組第一存儲芯片可以經(jīng)由第一組第一緩沖芯片來與第一組信號線交換數(shù)據(jù),以及第二組第一存儲芯片可以經(jīng)由第一組第一存儲芯片和第一組第一緩沖芯片來與第一組信號線交換數(shù)據(jù)。
第二組第二存儲芯片可以經(jīng)由第二組第二緩沖芯片來與第二組信號線交換數(shù)據(jù),以及第一組第二存儲芯片可以經(jīng)由第二組第二存儲芯片和第二組第二緩沖芯片來與第二組信號線交換數(shù)據(jù)。
第一存儲模塊還可以包括適用于在第一組第一存儲芯片與第二組第一存儲芯片之間傳輸數(shù)據(jù)的第一數(shù)據(jù)總線,以及第二存儲模塊還可以包括適用于在第一組第二存儲芯片與第二組第二存儲芯片之間傳輸數(shù)據(jù)的第二數(shù)據(jù)總線。
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