[發明專利]存儲器控制器以及用于對存儲模塊進行訪問的方法有效
| 申請號: | 201810015105.2 | 申請日: | 2018-01-08 |
| 公開(公告)號: | CN110008147B | 公開(公告)日: | 2021-11-19 |
| 發明(設計)人: | 山崗;楊崇和;李毅 | 申請(專利權)人: | 瀾起科技股份有限公司 |
| 主分類號: | G06F13/16 | 分類號: | G06F13/16 |
| 代理公司: | 北京市君合律師事務所 11517 | 代理人: | 毛健;杜小鋒 |
| 地址: | 200233 上海*** | 國省代碼: | 上海;31 |
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| 摘要: | |||
| 搜索關鍵詞: | 存儲器 控制器 以及 用于 存儲 模塊 進行 訪問 方法 | ||
本申請公開了一種存儲器控制器和用于對存儲模塊進行訪問的方法。存儲器控制器耦接在存儲模塊與主控制器之間以控制主控制器對存儲模塊的訪問,所述存儲器控制器包括:中心緩沖器,其耦接到所述主控制器,用于從所述主控制器接收數據訪問命令,并且耦接到所述存儲模塊,用于向所述存儲模塊提供修改的數據訪問命令;其中,所述中心緩沖器包括訪問命令處理模塊,其用于對所述數據訪問命令進行處理以生成所述修改的數據訪問命令;數據緩沖器,其耦接到所述中心緩沖器,用于從所述中心緩沖器接收所述修改的數據訪問命令,并且耦接在所述主控制器與所述存儲模塊之間,用于在所述修改的數據訪問命令的控制下在所述主控制器與所述存儲模塊之間交互數據。
技術領域
本申請涉及存儲器技術領域,更具體地,涉及一種存儲器控制器以及用于對存儲模塊進行訪問的方法。
背景技術
在現今的計算機系統中,內存模組提供中央處理器(CPU)運算時的數據訪問以及存儲。隨著內存模組讀取速度的不斷提高,為了確保CPU和內存模組之間的信號傳輸質量,內存模組會使用具有緩沖功能的控制芯片來緩沖由CPU發出的操作命令以及對應的存儲地址,并且內存模組上還具有可以雙向緩沖數據的數據緩沖器。
然而,現有的內存模組的操作方式較為單一,僅支持讀取、寫入等簡單操作,這限制了內存模組的功能。因此,有必要改進現有的內存模組的數據訪問方法。
發明內容
本申請的一個目的在于提供一種存儲器控制器以及用于對存儲模塊進行訪問的方法,其能夠實現復雜的數據訪問操作。
根據本申請的一個方面,提供了一種存儲器控制器,其耦接在存儲模塊與主控制器之間以控制所述主控制器對所述存儲模塊的訪問,所述存儲器控制器包括:中心緩沖器,其耦接到所述主控制器,用于從所述主控制器接收數據訪問命令,并且耦接到所述存儲模塊,用于向所述存儲模塊提供修改的數據訪問命令;其中,所述中心緩沖器包括訪問命令處理模塊,其用于對所述數據訪問命令進行處理以生成所述修改的數據訪問命令;數據緩沖器,其耦接到所述中心緩沖器,用于從所述中心緩沖器接收所述修改的數據訪問命令,并且耦接在所述主控制器與所述存儲模塊之間,用于在所述修改的數據訪問命令的控制下在所述主控制器與所述存儲模塊之間交互數據。
在一些實施例中,所述訪問命令處理模塊對所述數據訪問命令進行處理包括:對所述數據訪問命令中的訪問地址進行編碼,從而所述修改的數據訪問命令包括經編碼的訪問地址。
在一些實施例中,所述訪問命令處理模塊對所述數據訪問命令進行處理包括:以預定地址處理算法對所述數據訪問命令中的訪問地址進行處理以生成基于所述訪問地址的一組訪問地址,其中該組訪問地址中的每個訪問地址對應于一個修改的數據訪問命令。
在一些實施例中,該組訪問地址包括遞增或遞減的連續的多個訪問地址。
在一些實施例中,該組訪問地址包括等間隔或非等間隔的不連續的多個訪問地址。
在一些實施例中,所述修改的數據訪問命令具有與所述數據訪問命令相同的訪問類型。
在一些實施例中,所述數據緩沖器包括數據處理模塊,所述數據處理模塊用于從所述主控制器或所述存儲模塊接收數據,以預定數據處理算法對所述數據進行處理,并且將經處理的數據發送給所述主控制器或所述存儲模塊。
在一些實施例中,所述數據緩沖器包括數據處理模塊,所述數據處理模塊用于從所述存儲模塊接收數據,以預定數據處理算法對所述數據進行處理,并且將經處理的數據發送給所述存儲模塊。
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