[發(fā)明專利]用于補(bǔ)償延遲失配的電路及方法有效
| 申請?zhí)枺?/td> | 201710940678.1 | 申請日: | 2017-10-11 |
| 公開(公告)號: | CN108233915B | 公開(公告)日: | 2021-12-14 |
| 發(fā)明(設(shè)計)人: | 亨利·阿諾德·帕克;塔梅爾·穆罕默德·阿里 | 申請(專利權(quán))人: | 聯(lián)發(fā)科技股份有限公司 |
| 主分類號: | H03K19/003 | 分類號: | H03K19/003;H03K19/0175 |
| 代理公司: | 北京市萬慧達(dá)律師事務(wù)所 11111 | 代理人: | 王蕊;白華勝 |
| 地址: | 中國臺灣新竹市*** | 國省代碼: | 臺灣;71 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 用于 補(bǔ)償 延遲 失配 電路 方法 | ||
1.一種用于補(bǔ)償延遲失配的電路,該電路包括:
集成電路,該集成電路包括:
第一觸點(diǎn)和第二觸點(diǎn),該第一觸點(diǎn)耦接到位于該集成電路外部的第一連接線路,該第二觸點(diǎn)耦接到位于該集成電路外部的第二連接線路;
輸入驅(qū)動器;
第一信號路徑部分,該第一信號路徑部分是從該輸入驅(qū)動器至負(fù)載的第一信號路徑的一部分,該第一信號路徑部分包括該集成電路的該第一觸點(diǎn);
第二信號路徑部分,該第二信號路徑部分是從該輸入驅(qū)動器至該負(fù)載的第二信號路徑的一部分,該第二信號路徑部分包括該集成電路的該第二觸點(diǎn);
第一時鐘路徑,被配置為提供第一時鐘信號以控制該第一信號路徑部分的定時;
第二時鐘路徑,被配置為提供第二時鐘信號以控制該第二信號路徑部分的定時;以及
控制電路,被配置為:
控制該第一時鐘路徑,在第一時間段期間與反饋電路形成第一環(huán)形振蕩器并檢測該第一環(huán)形振蕩器的第一節(jié)奏;
控制該第二時鐘路徑,在第二時間段期間與該反饋電路形成第二環(huán)形振蕩器并檢測該第二環(huán)形振蕩器的第二節(jié)奏;以及
至少部分地基于該第一節(jié)奏和該第二節(jié)奏,在該第一信號路徑部分接收的該第一時鐘信號和在該第二信號路徑部分接收的該第二時鐘信號之間引入延遲失配,使得在該集成電路的該第一觸點(diǎn)處的第一輸出信號相對于在該集成電路的該第二觸點(diǎn)處的第二輸出信號具有延遲。
2.如權(quán)利要求1所述的電路,其特征在于,該第一信號路徑部分包括第一重定時器。
3.如權(quán)利要求2所述的電路,其特征在于,該第二信號路徑部分包括第二重定時器。
4.如權(quán)利要求1所述的電路,其特征在于,該控制電路進(jìn)一步被配置為檢測由作為該第一時鐘路徑的一部分的第一延遲元件引入的第一延遲,檢測由該第二時鐘路徑的第二延遲元件引入的第二延遲,以及計算該第一延遲和該第二延遲之間的差異。
5.如權(quán)利要求1所述的電路,其特征在于,該第一節(jié)奏包括第一振蕩周期,該第二節(jié)奏包括第二振蕩周期。
6.如權(quán)利要求1所述的電路,其特征在于,該電路進(jìn)一步包括計數(shù)器,該計數(shù)器被配置為通過計數(shù)在整個檢測時間間隔期間發(fā)生轉(zhuǎn)換的次數(shù),提供該第一節(jié)奏的指示。
7.如權(quán)利要求1所述的電路,其特征在于,該控制電路基于位于該集成電路外部的該第一連接線路與該第二連接線路之間存在的延遲失配來引入該延遲失配。
8.如權(quán)利要求7所述的電路,其特征在于,該集成電路安裝于印刷電路板上,并且該第一連接線路和該第二連接線路分別將該第一觸點(diǎn)和該第二觸點(diǎn)連接到該負(fù)載。
9.如權(quán)利要求1所述的電路,其特征在于,該第一時間段和該第二時間段不重疊。
10.一種用于補(bǔ)償延遲失配的電路,該電路包括:
集成電路,該集成電路包括:
第一觸點(diǎn)和第二觸點(diǎn),該第一觸點(diǎn)耦接到位于該集成電路外部的第一連接線路,該第二觸點(diǎn)耦接到位于該集成電路外部的第二連接線路;
時鐘驅(qū)動器;
反饋電路;
第一信號路徑部分,包括第一重定時器和該集成電路的該第一觸點(diǎn);
第一延遲元件,耦接在該第一重定時器和該時鐘驅(qū)動器之間;
第二信號路徑部分,包括第二重定時器和該集成電路的該第二觸點(diǎn);
第二延遲元件,耦接在該第二重定時器和該時鐘驅(qū)動器之間;以及
控制電路,被配置為通過控制該第一延遲元件和該第二延遲元件,使得在該集成電路的該第一觸點(diǎn)處的第一輸出信號相對于在該集成電路的該第二觸點(diǎn)處的第二輸出信號具有延遲;
其中,該反饋電路和該第一延遲元件形成第一環(huán)形振蕩器,該反饋電路和該第二延遲元件形成第二環(huán)形振蕩器。
11.如權(quán)利要求10所述的電路,其特征在于,該第一環(huán)形振蕩器被配置提供第一振蕩信號,該第二環(huán)形振蕩器被配置為提供第二振蕩信號。
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