[發明專利]一種中藥粉末的真空上料包裝結構在審
| 申請號: | 201710902834.5 | 申請日: | 2017-09-29 |
| 公開(公告)號: | CN107521728A | 公開(公告)日: | 2017-12-29 |
| 發明(設計)人: | 趙方云 | 申請(專利權)人: | 貴州苗立克中藥科技有限公司 |
| 主分類號: | B65B1/16 | 分類號: | B65B1/16;B65B1/32 |
| 代理公司: | 遵義浩嘉知識產權代理事務所(普通合伙)52112 | 代理人: | 李明 |
| 地址: | 561300 貴州省安順市關嶺*** | 國省代碼: | 貴州;52 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 中藥 粉末 真空 包裝 結構 | ||
技術領域
本發明涉及中藥粉末上料包裝結構技術領域,具體為一種中藥粉末的真空上料包裝結構。
背景技術
真空上料又稱真空輸送,是一種借助于真空吸力來傳送顆粒和粉末狀物料的無塵密閉管道輸送設備,利用真空與環境空間的氣壓差,形成管道內氣體流動,帶動粉狀物料運動,從而完成粉體的輸送。我國引進先進的國外真空技術,不斷完善,不斷改進,現廣泛用于化工、制藥、食品、冶金、建材、農副等各輕、重工業行業。
在包裝中藥粉末的時候,為了防止中藥粉末被污染,防止中藥的藥力降低,同時為了加快中藥粉末的包裝效率,需要用到真空上料包裝結構。現有的真空上料包裝結構多是采用抽真空裝置將上料管內抽成真空,將中藥粉末吸入包裝袋中并封住包裝袋。
但是,現有的真空上料包裝結構存在以下缺陷:
(1)現有的真空上料包裝結構上料管在向包裝袋內倒入中藥粉末時,各個包裝袋內中藥粉末的質量存在一定的偏差,使得產品的品質降低,影響中藥的藥效。
(2)現有的真空上料包裝結構在抽真空裝置將中藥粉末吸入上料管時,容易因吸入過多而使上料管堵塞,降低了中藥粉末上料包裝的效率,影響生產加工的進程。
為了解決這些問題,因而設計了一種中藥粉末的真空上料包裝結構。
發明內容
為了克服現有技術方案的不足,本發明提供一種中藥粉末的真空上料包裝結構,該裝置能夠使包裝袋內倒入的中藥粉末質量更精準,使產品的品質更高,同時可以防止抽真空裝置吸入中藥粉末過多而使上料管堵塞,使生產加工的效率更高,值得推廣。
本發明解決其技術問題所采用的技術方案是:一種中藥粉末的真空上料包裝結構,包括殼體、抽真空機構和包裝機構,所述殼體的底部設置有儲料箱,且在儲料箱的頂部設置有出料口,所述抽真空機構包括安裝在殼體頂部的抽真空裝置,且在抽真空裝置的側端連接有倒“L”形結構的上料管,所述上料管與抽真空裝置連接處的底端設置有回料口,且在回料口的中央設置有旋轉軸,所述旋轉軸的左、右兩側面均固定連接有旋轉片;
所述包裝機構包括傳送帶,且在傳送帶的頂面設置有均勻分布的包裝帶托盤,所述包裝帶托盤位于上料管底端的正下方,且在上料管的底端設置有電磁閥,所述包裝帶托盤的表面安裝有壓力傳感器;
所述壓力傳感器通過壓力轉換電路連接信號調理電路,所述壓力轉換電路能夠將壓力轉換為電壓信號,再通過信號調理電路將電壓信號轉化為數字信號,所述信號調理電路連接有微處理器,且微處理器完成對數字信號的采集與計算,所述微處理器連接有電磁閥控制電路,且電磁閥控制電路控制電磁閥的通斷。
作為本發明一種優選的技術方案,所述傳送帶的正上方設置有包裝袋封口裝置,且包裝袋封口裝置位于上料管的右側。
作為本發明一種優選的技術方案,所述包裝帶托盤的上表面連接有包裝袋夾具。
作為本發明一種優選的技術方案,所述出料口設置有過濾網,且出料口位于抽真空裝置的正下方。
作為本發明一種優選的技術方案,所述上料管的底端連接有中通式結構的伸縮桿。
作為本發明一種優選的技術方案,兩個所述的旋轉片的面積之和與回料口的面積相當。
與現有技術相比,本發明的有益效果是:
(1)本發明通過在上料管的底端設置有電磁閥,在包裝帶托盤的表面安裝有壓力傳感器,壓力傳感器通過微處理器連接電磁閥控制電路,使得當包裝袋裝入的中藥粉末質量剛好時,微處理器會通過電磁閥控制電路控制電磁閥關閉,使得上料管不再倒入中藥粉末,使包裝袋內倒入的中藥粉末質量更精準,使產品的品質更高,使中藥的藥效更好。
(2)本發明通過在上料管與抽真空裝置連接處的底端設置有回料口,且在回料口的中央設置有旋轉軸,旋轉軸的左、右兩側面均固定連接有旋轉片,使得當上料管內中藥粉末沒有超出范圍時,抽真空裝置吸入的中藥粉末會直接從回料口的上方飄過,當上料管內中藥粉末過多時,會在上料管內積累,使得右側的旋轉片因中藥粉末的重力而向下傾斜,使中藥粉末從回料口落下,左側的旋轉片向上傾斜堵住上料管的管口,使上料管內不再注入中藥粉末,使得上料管不會因抽真空裝置吸入的粉末過多而堵塞,有利于提高生產加工的效率。
附圖說明
圖1為本發明的整體結構示意圖;
圖2為本發明的仰視出料口結構示意圖;
圖3為本發明的微處理器控制電路示意圖。
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