[發(fā)明專(zhuān)利]一種飛機(jī)電臺(tái)軟件無(wú)線(xiàn)電演示平臺(tái)在審
| 申請(qǐng)?zhí)枺?/td> | 201710899683.2 | 申請(qǐng)日: | 2017-09-28 |
| 公開(kāi)(公告)號(hào): | CN107563098A | 公開(kāi)(公告)日: | 2018-01-09 |
| 發(fā)明(設(shè)計(jì))人: | 鄭永龍;姚旭成;張子明;彭虎;周勇軍 | 申請(qǐng)(專(zhuān)利權(quán))人: | 國(guó)營(yíng)蕪湖機(jī)械廠 |
| 主分類(lèi)號(hào): | G06F17/50 | 分類(lèi)號(hào): | G06F17/50 |
| 代理公司: | 暫無(wú)信息 | 代理人: | 暫無(wú)信息 |
| 地址: | 24100*** | 國(guó)省代碼: | 安徽;34 |
| 權(quán)利要求書(shū): | 查看更多 | 說(shuō)明書(shū): | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 飛機(jī) 電臺(tái) 軟件 無(wú)線(xiàn)電 演示 平臺(tái) | ||
1.一種飛機(jī)電臺(tái)軟件無(wú)線(xiàn)電演示平臺(tái),其特征在于:包括FPGA模塊(1)、ARM模塊(2)、DSP模塊(3)、A/D/A模塊(4)、電源模塊(5)、時(shí)鐘模塊(6),所述A/D/A模塊(4)連接所述FPGA模塊(1)完成信號(hào)的模數(shù)和數(shù)模轉(zhuǎn)換,所述FPGA模塊(1)完成DDC下變頻、DUC上變頻、直擴(kuò)和解擴(kuò)功能,所述DSP模塊(3)連接所述FPGA模塊(1)接收傳輸?shù)男盘?hào),完成同步,調(diào)制解調(diào),調(diào)頻控制功能,所述ARM模塊(2)連接所述FPGA模塊(1)和所述DSP模塊(3)完成程序加載,模式控制功能。
2.根據(jù)權(quán)利要求1所述的一種飛機(jī)電臺(tái)軟件無(wú)線(xiàn)電演示平臺(tái),其特征在于:所述電源模塊(5)輸出多種電壓的電源,包括TPS79601芯片產(chǎn)生數(shù)字1.4V電源和數(shù)字1.2V電源,TPS79518芯片產(chǎn)生數(shù)字1.8V電源,TPS72515芯片產(chǎn)生數(shù)字1.5V電源,TPS79326芯片產(chǎn)生數(shù)字2.5V電源,TPS79533芯片產(chǎn)生模擬3.3V電源。
3.根據(jù)權(quán)利要求1所述的一種飛機(jī)電臺(tái)軟件無(wú)線(xiàn)電演示平臺(tái),其特征在于:所述時(shí)鐘模塊(6)包括主時(shí)鐘晶振(XP13),AD晶振(XP14)和時(shí)鐘緩沖器(D8),所述主時(shí)鐘晶振(XP13)頻率為16.256Mhz,所述時(shí)鐘緩沖器(D8)采用CY2304芯片,所述主時(shí)鐘晶振(XP13)連接所述時(shí)鐘緩沖器產(chǎn)生所述FPGA模塊(1)和所述DSP模塊(3)需要的32.512Mhz時(shí)鐘,所述ARM模塊(2)需要的16.256Mhz時(shí)鐘,所述AD晶振(XP14)產(chǎn)生所述A/D/A模塊(4)需要的外部參考時(shí)鐘19.2Mhz。
4.根據(jù)權(quán)利要求1所述的一種飛機(jī)電臺(tái)軟件無(wú)線(xiàn)電演示平臺(tái),其特征在于:所述A/D/A模塊(4)包括第一AD芯片(D41),第二AD芯片(D42)和第三AD芯片(D43),所述第一AD芯片(D41)采用AD9862,第二AD芯片(D42)采用AD8138,第三AD芯片(D43)采用AD8009,外部無(wú)線(xiàn)信號(hào)接入所述第二AD芯片(D42)將單端信號(hào)轉(zhuǎn)換成差分信號(hào),所述第二AD芯片(D42)連接所述第一AD芯片(D41)進(jìn)行AD采樣,所述第一AD芯片(D41)連接所述第三AD芯片(D43)將需要發(fā)射的差分信號(hào)合成為無(wú)線(xiàn)信號(hào)發(fā)出。
5.根據(jù)權(quán)利要求1或4所述的一種飛機(jī)電臺(tái)軟件無(wú)線(xiàn)電演示平臺(tái),其特征在于:所述FPGA模塊(1)采用雙FPGA芯片設(shè)計(jì),包括第一FPGA芯片(D11),第二FPGA芯片(D12),所述第一FPGA芯片(D11)采用XC2V250芯片,所述第二FPGA芯片(D12)采用XC3S1000芯片,所述第二FPGA芯片(D12)完成對(duì)待發(fā)信號(hào)的直擴(kuò)和對(duì)接收到的信號(hào)的解擴(kuò)功能,所述第二FPGA芯片(D12)連接所述所述第一AD芯片(D41)傳輸數(shù)據(jù)信號(hào),所述第一FPGA芯片(D11)連接所述DSP模塊產(chǎn)生偽隨機(jī)序列的調(diào)頻圖案,供跳頻控制使用。
6.根據(jù)權(quán)利要求1所述的一種飛機(jī)電臺(tái)軟件無(wú)線(xiàn)電演示平臺(tái),其特征在于:所述DSP模塊(3)包括DSP芯片(D3),所述DSP芯片(D3)采用TMS320C6416芯片,完成同步,調(diào)制解調(diào),調(diào)頻控制功能。
7.根據(jù)權(quán)利要求1所述的一種飛機(jī)電臺(tái)軟件無(wú)線(xiàn)電演示平臺(tái),其特征在于:所述ARM模塊(2)包括ARM芯片(D21)和串口數(shù)據(jù)芯片(D22),所述ARM芯片(D21)采用S3C2410A,所述串口數(shù)據(jù)芯片(D22)采用ST16C554,所述ARM芯片(D21)通過(guò)串口連接于述串口數(shù)據(jù)芯片(D22)接收上層數(shù)據(jù),通過(guò)RAM接口連接有SDRAM同步動(dòng)態(tài)內(nèi)存,通過(guò)SPI接口連接有FLASH非易失性存儲(chǔ)器保存數(shù)據(jù)。
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