[發(fā)明專利]一種GOA電路及液晶顯示裝置在審
| 申請?zhí)枺?/td> | 201710702450.9 | 申請日: | 2017-08-16 |
| 公開(公告)號: | CN107369421A | 公開(公告)日: | 2017-11-21 |
| 發(fā)明(設(shè)計)人: | 石龍強;陳書志 | 申請(專利權(quán))人: | 深圳市華星光電半導(dǎo)體顯示技術(shù)有限公司 |
| 主分類號: | G09G3/36 | 分類號: | G09G3/36 |
| 代理公司: | 廣州三環(huán)專利商標代理有限公司44202 | 代理人: | 郝傳鑫,熊永強 |
| 地址: | 518132 廣東省深*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 goa 電路 液晶 顯示裝置 | ||
技術(shù)領(lǐng)域
本發(fā)明涉及液晶顯示技術(shù)領(lǐng)域,特別是涉及一種GOA電路以及液晶顯示裝置。
背景技術(shù)
液晶顯示裝置以其顯示品質(zhì)高、價格低廉、攜帶方便等優(yōu)點,成為移動通訊設(shè)備、PC、TV等的顯示裝置。目前液晶顯示裝置驅(qū)動技術(shù)逐漸趨向于采用GOA技術(shù),GOA技術(shù)能簡化平板顯示面板的制作工序,省去水平掃描線方向的接合(bonding)工藝,可提升產(chǎn)能、降低產(chǎn)品成本,同時可以提升顯示面板的集成度使之更適合制作窄邊框或無邊框顯示產(chǎn)品,滿足現(xiàn)代人們的視覺追求。
GOA技術(shù),即Gate Driver on Array技術(shù),也就是利用現(xiàn)有薄膜晶體管液晶顯示器Array制程將Gate行掃描驅(qū)動信號電路制作在Array基板上,實現(xiàn)對Gate逐行掃描的驅(qū)動方式。現(xiàn)有的GOA電路包括多個級聯(lián)的GOA單元,圖1是現(xiàn)有的第N級GOA單元的電路圖,圖2是本發(fā)明各個節(jié)點或者各個輸出端的波形,請參照圖1和圖2,第N級的GOA單元包括上拉控制單元110、上拉單元120、下拉單元130、下拉維持單元140、下傳單元150和自舉電容單元160。
上拉單元120主要負責將時鐘信號CK輸出給顯示區(qū)域第N級水平掃描線G(N),包括第三晶體管T3。上拉控制單元110負責控制上拉單元120的打開時間,包括第一晶體管T1,前一級的下傳信號ST(N-1)或者起始信號STV輸入到第一晶體管T1的柵極和源極,第一晶體管T1的漏極連接到第一節(jié)點Q(N)。下拉單元130負責將第N級水平掃描線G(N)上的水平掃描信號拉低為低電位,即關(guān)閉水平掃描信號,包括晶體管T4和T5,后一級的下傳信號ST(N+1)輸入到晶體管T4和T5的柵極。下拉維持單元140則負責將第N級水平掃描線G(N)上的水平掃描信號和第一節(jié)點Q(N)維持在關(guān)閉狀態(tài)(即負電位)。自舉電容單元160則負責所述第一節(jié)點Q(N)電位的二次抬升,這樣有利于上拉單元120的輸出。下傳單元150用于輸出本級下傳信號ST(N)。VSS表示直流低電壓。
在日常應(yīng)用中,由于信號干擾等環(huán)境影響,時鐘信號CK在一個周期中突然消失,時鐘訊號CK的消失導(dǎo)致下一級GOA單元的下傳信號ST(N+1)沒有輸出。因為下一級GOA單元的下傳信號ST(N+1)的輸出正常的高電位作用是將本級GOA單元的第一節(jié)點Q(N)的高電位拉低,而當下一級GOA單元的下傳信號ST(N+1)沒有輸出時,本級的第一節(jié)點Q(N)的高電位會一直維持,請參見圖3,這樣會導(dǎo)致大電流,液晶顯示裝置有可能受到損傷。
發(fā)明內(nèi)容
本發(fā)明實施例所要解決的技術(shù)問題在于,提供一種GOA電路及液晶顯示裝置。當時鐘信號失效時可以拉低第一節(jié)點的電位,從而可以防止液晶顯示裝置損傷。
為了解決上述技術(shù)問題,本發(fā)明第一方面實施例提供了一種GOA電路,該GOA驅(qū)動電路包括多個級聯(lián)的GOA單元,按照第N級GOA單元輸出柵極驅(qū)動信號給顯示區(qū)域第N級水平掃描線,該第N級GOA單元包括上拉單元、上拉控制單元、下拉單元、下拉維持單元、下傳單元以及自舉電容單元;所述上拉單元、所述下拉單元以、所述下拉維持單元及所述自舉電容單元均分別與第一節(jié)點以及第N級水平掃描線電連接,所述上拉控制單元以及所述下傳單元與第一節(jié)點電連接,其中N為正整數(shù);該GOA單元還包括:
強制下拉單元,其用于時鐘信號消失時強迫所述第一節(jié)點為低電平。
在本發(fā)明第一方面一實施例中,所述強制下拉單元包括第十二薄膜晶體管,所述第十二薄膜晶體管的柵極接入重置信號,其源極與第一節(jié)點電連接,其漏極接入第一低電平,所述重置信號在時鐘信號消失時由低電平轉(zhuǎn)為高電平。
在本發(fā)明第一方面一實施例中,所述下拉維持單元包括第六薄膜晶體管、第七薄膜晶體管、第八薄膜晶體管、第九薄膜晶體管、第十薄膜晶體管、第十一薄膜晶體管,所述第六薄膜晶體管的源極與第一節(jié)點電連接,其漏極接入第一低電平,其柵極與第N級第二節(jié)點電連接,所述七薄膜晶體管的源極與第N級水平掃描線電連接,其漏極接入第一低電平,其柵極與第N級第二節(jié)點電連接,所述第八薄膜晶體管的柵極與源極與高電平電連接,其漏極分別與第九薄膜晶體管的柵極和第十一薄膜晶體管的源極電連接,第九薄膜晶體管的源極與高電平電連接,其漏極與第N級第二節(jié)點電連接,第十薄膜晶體管的源極與第N級第二節(jié)點電連接,其漏極接入第一低電平,其柵極與第一節(jié)點電連接,第十一薄膜晶體管的漏極接入第一低電平,其柵極與第一節(jié)點電連接。
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