[發明專利]圖像編碼方法和系統在審
| 申請號: | 201710687370.0 | 申請日: | 2017-08-11 |
| 公開(公告)號: | CN107277538A | 公開(公告)日: | 2017-10-20 |
| 發明(設計)人: | 李聰聰;鐘炎培 | 申請(專利權)人: | 西安萬像電子科技有限公司 |
| 主分類號: | H04N19/42 | 分類號: | H04N19/42;H04N7/18 |
| 代理公司: | 北京康信知識產權代理有限責任公司11240 | 代理人: | 趙囡囡 |
| 地址: | 710075 陜西省西安*** | 國省代碼: | 陜西;61 |
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| 摘要: | |||
| 搜索關鍵詞: | 圖像 編碼 方法 系統 | ||
1.一種圖像編碼系統,其特征在于,包括:
視頻采集卡,用于通過視頻接口采集數據,得到初始圖像數據;
現場可編程門陣列FPGA,用于對所述初始圖像數據執行預處理,得到預處理圖像數據;
處理器CPU,用于根據所述預處理圖像數據的像素特性和/或文件屬性確認所述預處理圖像數據對應的類別,并采用與所述預處理圖像數據的類別相對應的編碼器對所述預處理圖像數據進行編碼。
2.根據權利要求1所述的系統,其特征在于,所述視頻采集卡與所述FPGA集成在外接設備中,所述CPU集成在終端中,所述外接設備與所述CPU通過預設接口連接。
3.根據權利要求2所述的系統,其特征在于,所述外接設備中還集成有直接存儲器訪問DMA控制器和緩存,所述緩存用于緩存所述預處理圖像數據,所述DMA控制器用于控制所述緩存與其它存儲器之間的數據傳輸。
4.根據權利要求3所述的系統,其特征在于,所述DMA控制器集成在所述FPGA中,所述FPGA還包括緩存控制器,所述緩存控制器用于與所述緩存連接并控制與所述緩存之間的數據傳輸。
5.根據權利要求3所述的系統,其特征在于,所述終端上還包括存儲器,與所述CPU相連接,用于讀取所述緩存中存儲的所述預處理圖像數據,和/或,為所述CPU提供所述預處理圖像數據,其中,所述CPU用于控制所述存儲器是否開啟與所述緩存之間的通訊通道。
6.根據權利要求2所述的系統,其特征在于,所述外接設備為minipcie卡上,所述終端包括用于插入所述minipcie卡的卡槽。
7.根據權利要求1所述的系統,其特征在于,所述FPGA與所述CPU之間基于PCIE通訊標準進行通訊。
8.根據權利要求1所述的系統,其特征在于,所述視頻接口為高清晰度多媒體HDMI接口或數字視頻DVI接口。
9.一種圖像編碼方法,其特征在于,所述方法應用于權利要求1至8中任一項所述的圖像編碼系統,所述方法包括:
獲取初始圖像數據;
對所述初始圖像數據執行預處理以得到預處理圖像數據;
根據所述預處理圖像數據的像素特性和/或文件屬性確認所述預處理圖像數據對應的類別;
采用與所述預處理圖像數據的類別相對應的編碼器對所述預處理圖像數據進行編碼。
10.根據權利要求9所述的方法,其特征在于,所述系統包括視頻采集卡,獲取初始圖像數據包括:
通過所述視頻采集卡采集視頻終端上的當前屏幕圖像,得到所述初始圖像數據。
11.根據權利要求9所述的方法,其特征在于,所述系統包括CPU,根據所述預處理圖像數據的像素特性和/或文件屬性確認所述預處理圖像數據對應的類別包括:
基于PCIE通訊標準將所述預處理圖像數據發送至CPU;
通過所述CPU確認所述預處理圖像數據對應的類別。
12.根據權利要求9所述的方法,其特征在于,所述系統還包括FPGA、DMA控制器、緩存和存儲器,所述FPGA用于對所述初始圖像數據執行預處理以得到預處理圖像數據,所述視頻采集卡、所述FPGA、所述DMA控制器和所述緩存集成在外接設備中,所述CPU和所述存儲器集成在終端中,
根據所述預處理圖像數據的像素特性和/或文件屬性確認所述預處理圖像數據對應的類別包括:
通過所述CPU控制開啟所述存儲器與所述緩存之間的通訊通道;
通過所述DMA控制器控制所述存儲器從所述緩存中獲取并存儲所述預處理圖像數據;
通過所述CPU獲取所述存儲器中存儲的所述預處理圖像數據并確認所述預處理圖像數據對應的類別。
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