[發明專利]一種相位插值器有效
| 申請號: | 201710471202.8 | 申請日: | 2017-06-20 |
| 公開(公告)號: | CN107104660B | 公開(公告)日: | 2023-04-25 |
| 發明(設計)人: | 皮德義;劉昌 | 申請(專利權)人: | 新港海岸(北京)科技有限公司 |
| 主分類號: | H03K5/13 | 分類號: | H03K5/13 |
| 代理公司: | 北京集佳知識產權代理有限公司 11227 | 代理人: | 王寶筠 |
| 地址: | 100102 北京市朝陽區*** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 相位 插值器 | ||
1.一種相位插值器,其特征在于,包括:第一電阻、第二電阻、6組晶體管電路和M個電流切換單元,M為正整數;其中,
所述第一電阻的一端、所述第二電阻的一端分別與電源連接;
所述6組晶體管電路中,每組晶體管電路分別包括第一NMOS晶體管、第二NMOS晶體管和第三NMOS晶體管,所述第一NMOS晶體管的漏極與所述第一電阻的另一端連接,所述第二NMOS晶體管的漏極與所述第二電阻的另一端連接,所述第一NMOS晶體管的源極、所述第二NMOS晶體管的源極分別與所述第三NMOS晶體管的漏極連接;
所述6組晶體管電路中,其中3組晶體管電路中的第三NMOS晶體管的源極分別與所述M個電流切換單元的第一端連接,剩余3組晶體管電路中的第三NMOS晶體管的源極分別與所述M個電流切換單元的第二端連接;
其中,所述6組晶體管電路中,每組晶體管電路中的第一NMOS晶體管的柵極作為所述相位插值器的第一輸入端,第二NMOS晶體管的柵極作為所述相位插值器的第二輸入端;所述第一輸入端接收到的第一路時鐘信號與所述第二輸入端接收到的第二路時鐘信號組成差分時鐘信號,所述第一路時鐘信號和所述第二路時鐘信號頻率相同、相位相差180°;所述第一NMOS晶體管的漏極、第二NMOS晶體管的漏極分別作為所述相位插值器的輸出端。
2.根據權利要求1所述的相位插值器,其特征在于,所述相位插值器用于接收三組頻率相同、相位不同的差分時鐘信號。
3.根據權利要求2所述的相位插值器,其特征在于,所述電流切換單元包括:第四NMOS晶體管、第五NMOS晶體管和第六NMOS晶體管;
所述第四NMOS晶體管的源極、所述第五NMOS晶體管的源極分別與所述第六NMOS晶體管的漏極連接;
所述第六NMOS晶體管的柵極連接偏置電壓,所述第六NMOS晶體管的源極接地;
所述第四NMOS晶體管的漏極作為所述電流切換單元的第一端,所述第五NMOS晶體管的漏極作為所述電流切換單元的第二端。
4.根據權利要求3所述的相位插值器,其特征在于,
所述6組晶體管電路中,每組晶體管電路中的第三NMOS晶體管的柵極與編碼電路連接,用于接收所述編碼電路輸出的需要編碼的高位信號;
所述第四NMOS晶體管的柵極、所述第五NMOS晶體管的柵極分別與所述編碼電路連接,用于接收所述編碼電路輸出的需要編碼的低位信號。
5.根據權利要求1-4任一項所述的相位插值器,其特征在于,
當所述相位插值器處于工作狀態時,任意相鄰的兩組晶體管電路中的第三NMOS晶體管閉合,且剩余晶體管電路中的第三NMOS晶體管斷開;
其中所述相鄰的兩組晶體管電路是指,所述兩組晶體管電路中,各自第一輸入端接收到的第一路時鐘信號相鄰,第二輸入端接收到的第二路時鐘信號相鄰。
6.根據權利要求1-4任一項所述的相位插值器,其特征在于,
當所述相位插值器中,任意一組差分時鐘信號對應的兩組晶體管電路中的第三NMOS晶體管斷開時,所述相位插值器作為接收2組差分時鐘信號的現有相位插值器使用。
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