[發(fā)明專利]一種基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)

在審

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• 申請日: 2017-06-19
• 公開（公告）號: CN107329423A
• 公開（公告）日: 2017-11-07
• 發(fā)明（設(shè)計）人: 潘紅兵;吳格;王浩;秦子迪;何書專;李麗;李偉
• 申請（專利權(quán)）人: 南京大學(xué)
• 主分類號: G05B19/042
• 分類號: G05B19/042
• 代理公司: 南京匯盛專利商標(biāo)事務(wù)所(普通合伙)32238
• 代理人: 陳揚,吳揚帆

技術(shù)領(lǐng)域

本發(fā)明屬于嵌入式模塊設(shè)計，尤其涉及一種基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)。

背景技術(shù)

近年來，伴隨著嵌入式處理器與FPGA的普及，許多的項目模塊和智能設(shè)備應(yīng)用了此類技術(shù)，嵌入式處理器的應(yīng)用成為了產(chǎn)業(yè)界關(guān)注的焦點。

目前市面上有許多運用嵌入式技術(shù)的產(chǎn)品，但部分產(chǎn)品存在人機(jī)交互有限，用戶難以對內(nèi)部邏輯錯誤進(jìn)行排查等缺點。

發(fā)明內(nèi)容

本發(fā)明目的在于克服上述現(xiàn)有技術(shù)的不足，提供一種基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)，具有以下技術(shù)方案實現(xiàn)：

所述基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)，與FPGA通信連接包括：

嵌入式模塊，將FPGA發(fā)送的監(jiān)測信息進(jìn)行讀取、打包、發(fā)送操作，對發(fā)送速率進(jìn)行調(diào)整，并對FPGA配置；

上位機(jī)，提供UI界面，完成監(jiān)測信息接收、存儲、統(tǒng)計、分析以及報表打印，并發(fā)出配置信息。

網(wǎng)絡(luò)通信模塊，接收上位機(jī)發(fā)送的配置信息，并向上位機(jī)發(fā)送所述監(jiān)測信息。

所述基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)的進(jìn)一步設(shè)計在于，所述上位機(jī)基于UI界面及后臺分析，對監(jiān)測信息進(jìn)行分類、分析和顯示，對所需數(shù)據(jù)進(jìn)行保存和調(diào)用。

所述基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)的進(jìn)一步設(shè)計在于，上位機(jī)分完成接收數(shù)據(jù)后，默認(rèn)將數(shù)據(jù)保存至本地數(shù)據(jù)庫，再對數(shù)據(jù)進(jìn)行分析，將錯誤信息寫入錯誤信息表，同時更新日志。

所述基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)的進(jìn)一步設(shè)計在于，上位機(jī)對數(shù)據(jù)的保存和調(diào)用操作基于Mysql數(shù)據(jù)庫。

所述基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)的進(jìn)一步設(shè)計在于，所述網(wǎng)絡(luò)通信模塊通過Socket函數(shù)接口基于TCP/IP協(xié)議實現(xiàn)上位機(jī)與嵌入式模塊之間的網(wǎng)絡(luò)通信與數(shù)據(jù)傳輸。

所述基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)的進(jìn)一步設(shè)計在于，所述嵌入式模塊，將監(jiān)測信息進(jìn)行實時打包發(fā)送，接收配置信息并配置FPGA模塊。

所述基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)的進(jìn)一步設(shè)計在于，嵌入式模塊與FPGA的數(shù)據(jù)交互通過總線連接到兩片F(xiàn)PGA內(nèi)部SRAM的方式，其中一片SRAM用于FPGA上傳監(jiān)測信息至嵌入式處理器，另一片SRAM用于嵌入式處理器向FPGA傳輸配置數(shù)據(jù)。

根據(jù)權(quán)利要求1所述的基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)，其特征在于監(jiān)測信息包含多種監(jiān)測信息表，每個監(jiān)測信息表包含ram地址、lbc地址、屬性、名稱、單位、描述、計數(shù)信息。

本發(fā)明的優(yōu)點

本發(fā)明提供的基于PC和PowerPC嵌入式處理器的監(jiān)控系統(tǒng)，基于高速網(wǎng)絡(luò)接口進(jìn)行網(wǎng)絡(luò)通信，基于Mysql數(shù)據(jù)庫進(jìn)行數(shù)據(jù)存儲。對嵌入式處理器發(fā)送的監(jiān)測信息進(jìn)行鑒別與分析，并由上位機(jī)可視化界面進(jìn)行顯示與告警。

該系統(tǒng)通過PC上位機(jī)提供的可視化界面和數(shù)據(jù)監(jiān)測模塊可直接分析得到錯誤信息，用戶不需要面對成百上千條監(jiān)測信息一一比對，大大減少了人工成本，提高工作效率。利用Mysql數(shù)據(jù)庫對數(shù)據(jù)進(jìn)行存儲，便于調(diào)用及查詢。上位機(jī)與嵌入式處理器間采用高速網(wǎng)絡(luò)傳遞信息，數(shù)據(jù)吞吐率大大提高。能夠在上位機(jī)的操作下進(jìn)行實時控制，操作簡便，通用性更高。通過PC上位機(jī)發(fā)送配置信息至嵌入式處理器，實現(xiàn)了FPGA運行時實時監(jiān)測和實時配置，大大提高了整個系統(tǒng)的工作效率。

附圖說明

圖1是監(jiān)測系統(tǒng)架構(gòu)圖。

圖2是上位機(jī)的工作流程圖。

圖3是上位機(jī)UI界面示意圖。

圖4是數(shù)據(jù)分析模塊流程圖。

圖5是嵌入式模塊的工作流程圖。

具體實施方式

下面結(jié)合附圖對本發(fā)明方案進(jìn)行詳細(xì)說明。