[發(fā)明專利]嵌入式多媒體芯片數(shù)據(jù)讀取方法、設(shè)備及系統(tǒng)在審
| 申請?zhí)枺?/td> | 201710375651.2 | 申請日: | 2017-05-24 |
| 公開(公告)號: | CN107273314A | 公開(公告)日: | 2017-10-20 |
| 發(fā)明(設(shè)計)人: | 郭紫仕 | 申請(專利權(quán))人: | 深圳市紫光同創(chuàng)電子有限公司 |
| 主分類號: | G06F13/12 | 分類號: | G06F13/12;G06F13/38;G06F13/40 |
| 代理公司: | 深圳鼎合誠知識產(chǎn)權(quán)代理有限公司44281 | 代理人: | 江婷 |
| 地址: | 518057 廣東省深圳市南山區(qū)*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關(guān)鍵詞: | 嵌入式 多媒體 芯片 數(shù)據(jù) 讀取 方法 設(shè)備 系統(tǒng) | ||
1.一種嵌入式多媒體芯片數(shù)據(jù)讀取設(shè)備,其特征在于,包括FPGA讀取器以及電源系統(tǒng);
所述電源系統(tǒng)用于為所述FPGA讀取器和待進行數(shù)據(jù)讀取的嵌入式多媒體芯片提供電源;
所述FPGA讀取器與所述嵌入式多媒體芯片連接,用于讀取所述嵌入式多媒體芯片中的數(shù)據(jù),并將讀取的數(shù)據(jù)進行上傳。
2.如權(quán)利要求1所述的嵌入式多媒體芯片數(shù)據(jù)讀取設(shè)備,其特征在于,所述FPGA讀取器包括:時鐘生成單元、芯片控制單元、芯片數(shù)據(jù)采集單元和數(shù)據(jù)上傳單元;
所述時鐘生成單元用于生成工作時鐘發(fā)給所述芯片控制單元;
所述芯片控制單元用于基于所述工作時鐘與所述嵌入式多媒體芯片進行交互對所述嵌入式多媒體芯片進行初始化;
所述芯片數(shù)據(jù)采集單元用于從所述嵌入式多媒體芯片中采集數(shù)據(jù)并進行緩存;
所述數(shù)據(jù)上傳單元用于將所述芯片數(shù)據(jù)采集單元緩存的數(shù)據(jù)進行上傳。
3.如權(quán)利要求2所述的嵌入式多媒體芯片數(shù)據(jù)讀取設(shè)備,其特征在于,所述芯片控制單元對所述嵌入式多媒體芯片進行初始化包括:
所述芯片控制單元對所述嵌入式多媒體芯片進行總線復位、總線寬度設(shè)置、傳輸模式設(shè)置,以及獲取所述嵌入式多媒體芯片的供電需求、芯片識別信息和芯片容量;
所述芯片數(shù)據(jù)采集單元用于根據(jù)所述芯片控制單元獲取的芯片識別信息從所述嵌入式多媒體芯片中采集相應的數(shù)據(jù)并進行緩存。
4.如權(quán)利要求3所述的嵌入式多媒體芯片數(shù)據(jù)讀取設(shè)備,其特征在于,所述電源系統(tǒng)包括控制器和能提供至少兩個電壓的電源管理器;
所述電源管理器與所述FPGA讀取器和所述嵌入式多媒體芯片連接;
所述控制器用于接收所述芯片控制單元發(fā)送的供電需求,根據(jù)所述供電需求控制所述電源管理器提供與該供電需求匹配的電壓為所述FPGA讀取器和所述嵌入式多媒體芯片供電。
5.如權(quán)利要求3所述的嵌入式多媒體芯片數(shù)據(jù)讀取設(shè)備,其特征在于,所述芯片數(shù)據(jù)采集單元還用于對從所述嵌入式多媒體芯片采集的數(shù)據(jù)量進行統(tǒng)計,以及將當前統(tǒng)計的數(shù)據(jù)量與所述芯片控制單元獲取的芯片容量進行比對以判斷數(shù)據(jù)是否讀取完畢。
6.如權(quán)利要求2-5任一項所述的嵌入式多媒體芯片數(shù)據(jù)讀取設(shè)備,其特征在于,所述FPGA讀取器還包括與所述芯片數(shù)據(jù)采集單元連接的數(shù)據(jù)校驗單元;
所述芯片數(shù)據(jù)采集單元還用于將從所述嵌入式多媒體芯片中采集的數(shù)據(jù)進行緩存之前,將采集的數(shù)據(jù)發(fā)給所述數(shù)據(jù)校驗單元;以及用于接收到緩存通知時將采集的所述數(shù)據(jù)進行緩存,接收到重新采集通知時重新從所述嵌入式多媒體芯片中采集相應的數(shù)據(jù);
所述數(shù)據(jù)校驗單元用于對接收到的數(shù)據(jù)進行校驗,并在校驗成功時發(fā)送緩存通知給所述芯片數(shù)據(jù)采集單元,否則,發(fā)送重新采集通知給所述芯片數(shù)據(jù)采集單元。
7.如權(quán)利要求2-5任一項所述的嵌入式多媒體芯片數(shù)據(jù)讀取設(shè)備,其特征在于,所述FPGA讀取器還包括與所述芯片數(shù)據(jù)采集單元連接的采集訓練單元;
所述芯片控制單元還用于在所述芯片數(shù)據(jù)采集單元從所述嵌入式多媒體芯片中采集數(shù)據(jù)之前,向所述嵌入式多媒體芯片發(fā)送調(diào)諧指令;
所述芯片數(shù)據(jù)采集單元還用于接收所述嵌入式多媒體芯片根據(jù)所述調(diào)諧指令發(fā)送的調(diào)諧數(shù)據(jù)塊;
所述采集訓練單元用于根據(jù)接收到的調(diào)諧數(shù)據(jù)塊進行時鐘采樣點的確定,并將確定的時鐘采樣點發(fā)給所述芯片數(shù)據(jù)采集單元,以供其在確定的時鐘采樣點進行數(shù)據(jù)采集。
8.如權(quán)利要求2-5任一項所述的嵌入式多媒體芯片數(shù)據(jù)讀取設(shè)備,其特征在于,所述數(shù)據(jù)上傳單元用于判斷所述芯片數(shù)據(jù)采集單元緩存的數(shù)據(jù)滿足上傳條件時,將緩存的數(shù)據(jù)進行上傳;以及用于在判斷當前上傳隊列當前存滿時,向所述芯片控制單元發(fā)送暫停傳輸指令;
所述芯片控制單元還用于根據(jù)所述暫停傳輸指令向所述嵌入式多媒體芯片發(fā)送傳輸停止指令,以暫時停止向所述芯片數(shù)據(jù)采集單元傳輸數(shù)據(jù)。
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