[發(fā)明專利]半導(dǎo)體裝置有效
| 申請?zhí)枺?/td> | 201710282990.6 | 申請日： | 2017-04-26 |
| 公開（公告）號： | CN107527658B | 公開（公告）日： | 2021-05-04 |
| 發(fā)明（設(shè)計）人： | 村上洋樹;妹尾真言 | 申請（專利權(quán)）人： | 華邦電子股份有限公司 |
| 主分類號： | G11C16/30 | 分類號： | G11C16/30;G11C5/14 |
| 代理公司： | 北京同立鈞成知識產(chǎn)權(quán)代理有限公司 11205 | 代理人： | 馬雯雯;臧建明 |
| 地址： | 中國臺灣臺*** | 國省代碼： | 臺灣;71 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 半導(dǎo)體 裝置 | ||
1.一種半導(dǎo)體裝置，其特征在于，包括：
第1電路，分別串行輸出時鐘信號、數(shù)據(jù)以及地址信號；
第2電路，根據(jù)從所述第1電路輸出的所述時鐘信號來串行輸入所述數(shù)據(jù)，且包括多個保持部及生成部，所述多個保持部保持所輸入的數(shù)據(jù)，所述生成部基于從所述多個保持部并行輸出的數(shù)據(jù)來生成輸出；以及
連接部件，將所述第1電路與所述第2電路予以電連接，
所述連接部件包含第1信號線及第2信號線，所述第1信號線傳輸從所述第1電路輸出的所述時鐘信號，所述第2信號線傳輸從所述第1電路輸出的所述數(shù)據(jù)，
所述地址信號用于選擇所述多個保持部中的任一個，所述多個保持部各自根據(jù)所述地址信號能夠進(jìn)行選擇，根據(jù)所述地址信號所選擇的保持部串行輸入從所述第1電路輸出的所述數(shù)據(jù)。
2.根據(jù)權(quán)利要求1所述的半導(dǎo)體裝置，其特征在于，從所述第1電路輸出的所述數(shù)據(jù)包含n位的階度數(shù)據(jù)，所述生成部生成與所述階度數(shù)據(jù)相應(yīng)的電平輸出。
3.根據(jù)權(quán)利要求1或2所述的半導(dǎo)體裝置，其特征在于，
所述第1電路進(jìn)而輸出控制數(shù)據(jù)，所述控制數(shù)據(jù)對由所述多個保持部所保持的數(shù)據(jù)的并行輸出進(jìn)行控制，
所述連接部件包含傳輸所述控制數(shù)據(jù)的第3信號線，
所述多個保持部響應(yīng)所述控制數(shù)據(jù)而將所保持的數(shù)據(jù)并行輸出至所述生成部。
4.根據(jù)權(quán)利要求1或2所述的半導(dǎo)體裝置，其特征在于，所述第1電路在所述生成部生成輸出的期間，將下個數(shù)據(jù)串行輸出至所述多個保持部。
5.根據(jù)權(quán)利要求4所述的半導(dǎo)體裝置，其特征在于，所述第1電路在所述半導(dǎo)體裝置執(zhí)行一連串的動作時，輸出與所述一連串的動作分別對應(yīng)的數(shù)據(jù)。
6.根據(jù)權(quán)利要求1或2所述的半導(dǎo)體裝置，其特征在于，
所述第1電路進(jìn)而輸出時鐘使能信號，
所述連接部件包含傳輸所述時鐘使能信號的第4信號線，
所述多個保持部響應(yīng)所述時鐘使能信號來串行輸入從所述第1電路串行輸出的所述數(shù)據(jù)。
7.根據(jù)權(quán)利要求1或2所述的半導(dǎo)體裝置，其特征在于，
所述第1電路在所述半導(dǎo)體裝置的動作結(jié)束時，串行輸出關(guān)聯(lián)于下次動作的初始值的數(shù)據(jù)，所述第2電路保持串行輸入的所述初始值的數(shù)據(jù)。
8.根據(jù)權(quán)利要求7所述的半導(dǎo)體裝置，其特征在于，所述地址信號被共同輸入至多個保持部，多個保持部各自包括判定部，所述判定部判定是否根據(jù)所述地址信號而選擇了自身。
9.根據(jù)權(quán)利要求7所述的半導(dǎo)體裝置，其特征在于，所述連接部件包含傳輸所述地址信號的第5信號線。
10.根據(jù)權(quán)利要求7所述的半導(dǎo)體裝置，其特征在于，所述地址信號是由所述第2信號線予以傳輸。
11.一種半導(dǎo)體裝置，其特征在于，包括：
第1電路，并行輸出地址信號及n位的數(shù)據(jù)；
第2電路，包括多個保持部及生成部，所述生成部基于由所述多個保持部所保持的數(shù)據(jù)來生成輸出；以及
連接部件，將所述第1電路與所述第2電路予以電連接，
所述連接部件包含傳輸?shù)刂沸盘柕男盘柧€、及并行傳輸所述n位的數(shù)據(jù)的n條信號線，
所述多個保持部各自根據(jù)所述地址信號能夠進(jìn)行選擇，根據(jù)所述地址信號所選擇的保持部并行輸入從所述第1電路輸出的所述數(shù)據(jù)，
所述多個保持部各自包括判定部，所述判定部判定是否根據(jù)所述地址信號而選擇了自身，
從所述第1電路輸出的所述數(shù)據(jù)包含選擇數(shù)據(jù)，所述選擇數(shù)據(jù)用于選擇由所述生成部所生成的多個輸出，
所述第2電路包含選擇部，所述選擇部基于從所述保持部并行輸出的選擇數(shù)據(jù)，來選擇由所述生成部所生成的多個輸出中的任一個。
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