[發明專利]一種服務器及其處理數據的方法在審
| 申請號: | 201710047334.8 | 申請日: | 2017-01-22 |
| 公開(公告)號: | CN106708779A | 公開(公告)日: | 2017-05-24 |
| 發明(設計)人: | 姜凱;于治樓;王子彤 | 申請(專利權)人: | 濟南浪潮高新科技投資發展有限公司 |
| 主分類號: | G06F15/78 | 分類號: | G06F15/78 |
| 代理公司: | 濟南信達專利事務所有限公司37100 | 代理人: | 李世喆 |
| 地址: | 250100 山東省濟南市*** | 國省代碼: | 山東;37 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 服務器 及其 處理 數據 方法 | ||
1.一種服務器,其特征在于,包括:處理器、第一總線、至少一條第二總線以及至少一個異構單元;
每一個所述異構單元分別通過一條所述第二總線與所述處理器相連;每一個所述異構單元均與所述第一總線相連;
所述處理器,用于當確定接收到外部輸入的數據為非事務型數據時,在所述至少一個異構單元中確定至少一個目標異構單元,并將所述非事務型數據發送至所述至少一個目標異構單元;
每一個所述異構單元,用于在接收到所述處理器發送的所述非事務型數據時,對所述非事務型數據進行處理。
2.根據權利要求1所述的服務器,其特征在于,所述異構單元,包括:至少三個FPGA芯片和第三總線;
所述至少三個FPGA芯片均與所述第三總線相連;
所述至少三個FPGA芯片中的任一個FPGA芯片與對應的所述第二總線相連。
3.根據權利要求1所述的服務器,其特征在于,所述異構單元中可以包括:至少兩個FPGA芯片;
每一個所述FPGA芯片分別與對應的所述第二總線相連。
4.根據權利要求1所述的服務器,其特征在于,所述異構單元,包括:至少三個FPGA芯片;
所述至少三個FPGA芯片依次連接;
處于首位的FPGA芯片和處于末位的FPGA芯片分別與對應的所述第二總線相連。
5.根據權利要求2至4任一所述的服務器,其特征在于,
與對應的所述第二總線相連的任一所述FPGA芯片與外部的至少一個存儲硬盤相連。
6.根據權利要求1所述的服務器,其特征在于,進一步包括:固態硬盤和機械硬盤;
所述處理器,進一步用于接收每一個所述異構單元反饋的處理結果;將所述處理結果發送至所述固態硬盤;
所述固態硬盤,分別與所述處理器和所述機械硬盤相連,用于接收所述處理器發送的所述處理結果,存儲所述處理結果;將存儲的所述處理結果傳輸至所述機械硬盤;當接收到所述處理器發送處理結果時開始計時,當累積時長達到預先設定的時長時,刪除存儲的所述處理結果;
所述機械硬盤,用于接收所述固態硬盤傳輸的所述處理結果,并存儲。
7.根據權利要求1所述的服務器,其特征在于,進一步包括:內存;
每一個所述異構單元,進一步用于將處理所述非事務型數據的過程中產生的中間數據發送至所述處理器;發送調用指令至所述處理器,接收所述處理器傳輸的所述中間數據;
所述處理器,進一步用于將所述中間數據發送至所述內存;根據所述異構單元發送的所述調用指令從所述內存中調取所述中間數據,并將所述中間數據發送給所述異構單元;
所述內存,用于存儲所述處理器發送的所述中間數據。
8.根據權利要求1至4任一所述的服務器,其特征在于,
所述總線包括:外設部件互連標準PCIE總線或高速串行口SRIO總線;
和/或,
所述固態硬盤為非易失性存儲器標準NVMe固態存儲硬盤;
所述機械硬盤為串行連接SAS擴展盤陣。
9.一種利用權利要求1至8任一所述服務器處理數據的方法,其特征在于,包括:
當所述處理器確定接收到外部輸入的數據為非事務型數據時,在所述至少一個異構單元中確定至少一個目標異構單元,并將所述非事務型數據發送至所述至少一個所述目標異構單元;
利用每一個所述目標異構單元接收所述處理器發送的所述非事務型數據,對所述非事務型數據進行處理。
10.根據權利要求9所述的方法,其特征在于,所述利用每一個所述目標異構單元接收所述處理器發送的所述非事務型數據,對所述非事務型數據進行處理之后,進一步包括:
利用所述處理器接收每一個所述目標異構單元反饋的處理結果,將所述處理結果發送至所述固態硬盤;
利用所述固態硬盤接收所述處理器發送的處理結果,存儲所述處理結果,并將存儲的所述處理結果傳輸至所述機械硬盤;當接收到所述處理器發送處理結果時開始計時,當累積時長達到預先設定的時長時,刪除存儲的所述處理結果;
利用所述機械硬盤接收所述固態硬盤傳輸的所述處理結果,并存儲;
和/或,
進一步包括:
所述目標異構單元將處理所述非事務型數據的過程中產生的中間數據發送至所述處理器;
利用所述處理器接收所述目標異構單元發送的所述中間數據,并將所述中間數據發送至所述內存;
利用所述內存存儲所述處理器發送的所述中間數據;
當接收到所述目標異構單元發送的調取指令時,利用所述處理器調取所述內存中存儲的所述中間數據,并將所述中間數據發送給所述目標異構單元。
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